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quartus II

  • Xmodem協(xié)議中CRC算法的FPAG實(shí)現(xiàn)

    基于解決Xmodem協(xié)議中CRC校驗(yàn)的目的，以經(jīng)典的LFSR硬件電路為基礎(chǔ)，采用了按字節(jié)并行運(yùn)算CRC校驗(yàn)碼，以及多字節(jié)CRC算法的方法。在quartus II環(huán)境下，通過以VHDL語言仿真試驗(yàn)，得出Xmodem協(xié)議中CRC校驗(yàn)，以多字節(jié)循環(huán)并行CRC算法能夠滿足高速實(shí)時(shí)性要求的結(jié)論。

    標(biāo)簽： Xmodem FPAG CRC 協(xié)議

    上傳時(shí)間： 2013-10-09

    上傳用戶：胡蘿卜醬

  • 基于CycloneIII構(gòu)成的RS編碼系統(tǒng)

    本文采用Altera公司的FPGA器件Cyclone III系列EP3C10作為核心器件構(gòu)成了R-S（255，223）編碼系統(tǒng)；利用quartus II 9.0作為硬件仿真平臺(tái)，用硬件描述語言Verilog_HDL實(shí)現(xiàn)編程，并且通過JTAG接口與EP3C10連接。R-S（Reed-Solomon）碼是一類糾錯(cuò)能力很強(qiáng)的特殊的非二進(jìn)制BCH碼，能應(yīng)對(duì)隨機(jī)性和突發(fā)性錯(cuò)誤，廣泛應(yīng)用于各種通信系統(tǒng)中和保密系統(tǒng)中。R-S（255，223）碼能夠檢測(cè)32字節(jié)長(zhǎng)度和糾錯(cuò)16字節(jié)長(zhǎng)度的連續(xù)數(shù)據(jù)錯(cuò)誤信息。

    標(biāo)簽： CycloneIII RS編碼

    上傳時(shí)間： 2013-10-08

    上傳用戶：yuchunhai1990

  • MagicSOPC例程編譯異常及解決方法

    1.1 問題產(chǎn)生的環(huán)境1.1.1 軟件環(huán)境1. PC機(jī)的系統(tǒng)為Microsoft Window XP Professional版本2002 Service Pack 2；2. quartus II V7.0軟件，并安裝了MegaCore IP V7.0；3. NiosII IDE 7.0軟件。1.1.2 硬件環(huán)境核心板的芯片是EP2C35F672C8N的MagicSOPC實(shí)驗(yàn)箱的硬件系統(tǒng)。硬件的工作環(huán)境是在普通的環(huán)境下。1.2 問題的現(xiàn)象在使用MagicSOPC實(shí)驗(yàn)箱的光盤例程時(shí)，使用quartus II編譯工程時(shí)出現(xiàn)編譯錯(cuò)誤，錯(cuò)誤提示信息如圖1.1、圖1.2所示。

    標(biāo)簽： MagicSOPC 編譯

    上傳時(shí)間： 2013-11-23

    上傳用戶：Alick

  • Altera ModelSim 6.5仿真入門教程

        Altera ModelSim 6.5仿真入門教程，需要的可自行下載。 　　平臺(tái) 　　軟件：ModelSim-Altera 6.5e （quartus II 10.0） Starter Edition 　　內(nèi)容 　　1 設(shè)計(jì)流程 　　使用ModelSim仿真的基本流程為：       　　圖1.1 使用 ModelSim仿真的基本流程 　　2 開始 　　2.1 新建工程 　　打開ModelSim后，其畫面如圖2.1所示。

    標(biāo)簽： ModelSim Altera 6.5 仿真

    上傳時(shí)間： 2013-11-09

    上傳用戶：qitiand

  • 高清電視HDTV信號(hào)發(fā)生器

    高清電視HDTV信號(hào)發(fā)生器，576P逐行，VHDL語言，ALTERA的quartus II開發(fā)平臺(tái)

    標(biāo)簽： HDTV 高清電視 信號(hào)發(fā)生器

    上傳時(shí)間： 2015-07-06

    上傳用戶：yph853211

  • 這是我們做的一個(gè)作業(yè) 摸60計(jì)數(shù)器

    這是我們做的一個(gè)作業(yè) 摸60計(jì)數(shù)器，用quartus II 做的 ，內(nèi)容齊全 不可不看。

    標(biāo)簽： 計(jì)數(shù)器

    上傳時(shí)間： 2013-12-24

    上傳用戶：xauthu

  • 三八譯碼器的源代碼

    三八譯碼器的源代碼，在quartus II 6.0中進(jìn)行進(jìn)行設(shè)計(jì)的，有vhdl源代碼

    標(biāo)簽： 譯碼器 源代碼

    上傳時(shí)間： 2015-09-05

    上傳用戶：181992417

  • 在開發(fā)板上實(shí)現(xiàn)svga條形信號(hào)發(fā)生器的源代碼

    在開發(fā)板上實(shí)現(xiàn)svga條形信號(hào)發(fā)生器的源代碼，是在quartus II 6.0的開發(fā)環(huán)境中運(yùn)行的

    標(biāo)簽： svga 開發(fā)板 信號(hào)發(fā)生器 源代碼

    上傳時(shí)間： 2013-12-23

    上傳用戶：dave520l

  • 8位的加法器設(shè)計(jì)

    8位的加法器設(shè)計(jì)，分4個(gè)工程完成的，用的是quartus II軟件。

    標(biāo)簽： 8位 加法器

    上傳時(shí)間： 2014-01-20

    上傳用戶：myworkpost

  • VHDL實(shí)現(xiàn)了IIS接口程序

    VHDL實(shí)現(xiàn)了IIS接口程序，在quartus II 6.0上編譯通過，在板子上可以讀取IIS數(shù)據(jù)

    標(biāo)簽： VHDL IIS 接口程序

    上傳時(shí)間： 2014-06-06

    上傳用戶：1427796291

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