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quartus-ii

  • MagicSOPC例程編譯異常及解決方法

    1.1 問題產生的環境1.1.1 軟件環境1. PC機的系統為Microsoft Window XP Professional版本2002 Service Pack 2；2. Quartus II V7.0軟件，并安裝了MegaCore IP V7.0；3. NiosII IDE 7.0軟件。1.1.2 硬件環境核心板的芯片是EP2C35F672C8N的MagicSOPC實驗箱的硬件系統。硬件的工作環境是在普通的環境下。1.2 問題的現象在使用MagicSOPC實驗箱的光盤例程時，使用Quartus II編譯工程時出現編譯錯誤，錯誤提示信息如圖1.1、圖1.2所示。

    標簽： MagicSOPC 編譯

    上傳時間： 2013-11-23

    上傳用戶：Alick

  • Altera ModelSim 6.5仿真入門教程

        Altera ModelSim 6.5仿真入門教程，需要的可自行下載。 　　平臺 　　軟件：ModelSim-Altera 6.5e （Quartus II 10.0） Starter Edition 　　內容 　　1 設計流程 　　使用ModelSim仿真的基本流程為：       　　圖1.1 使用 ModelSim仿真的基本流程 　　2 開始 　　2.1 新建工程 　　打開ModelSim后，其畫面如圖2.1所示。

    標簽： ModelSim Altera 6.5 仿真

    上傳時間： 2013-11-09

    上傳用戶：qitiand

  • 高清電視HDTV信號發生器

    高清電視HDTV信號發生器，576P逐行，VHDL語言，ALTERA的Quartus II開發平臺

    標簽： HDTV 高清電視 信號發生器

    上傳時間： 2015-07-06

    上傳用戶：yph853211

  • 這是我們做的一個作業 摸60計數器

    這是我們做的一個作業 摸60計數器，用Quartus ii 做的 ，內容齊全 不可不看。

    標簽： 計數器

    上傳時間： 2013-12-24

    上傳用戶：xauthu

  • 三八譯碼器的源代碼

    三八譯碼器的源代碼，在quartus II 6.0中進行進行設計的，有vhdl源代碼

    標簽： 譯碼器 源代碼

    上傳時間： 2015-09-05

    上傳用戶：181992417

  • 在開發板上實現svga條形信號發生器的源代碼

    在開發板上實現svga條形信號發生器的源代碼，是在quartus II 6.0的開發環境中運行的

    標簽： svga 開發板 信號發生器 源代碼

    上傳時間： 2013-12-23

    上傳用戶：dave520l

  • 8位的加法器設計

    8位的加法器設計，分4個工程完成的，用的是Quartus II軟件。

    標簽： 8位 加法器

    上傳時間： 2014-01-20

    上傳用戶：myworkpost

  • VHDL實現了IIS接口程序

    VHDL實現了IIS接口程序，在Quartus II 6.0上編譯通過，在板子上可以讀取IIS數據

    標簽： VHDL IIS 接口程序

    上傳時間： 2014-06-06

    上傳用戶：1427796291

  • 簡易數字頻率計

    簡易數字頻率計，用Verilog HDL編寫的，基于Quartus II實現，結構清晰，功能較為全面，能滿足簡單的頻率測量要求

    標簽： 數字頻率計

    上傳時間： 2013-12-08

    上傳用戶：15071087253

  • FFT的VHDL源文件

    FFT的VHDL源文件，經過在Quartus II上的測試無錯誤

    標簽： VHDL FFT

    上傳時間： 2016-02-24

    上傳用戶：BIBI

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