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verilog learning

用verilog實(shí)現(xiàn)了一個數(shù)字秒表的設(shè)計(jì)

用verilog實(shí)現(xiàn)了一個數(shù)字秒表的設(shè)計(jì)

標(biāo)簽： verilog 數(shù)字秒表

上傳時間： 2015-11-15

上傳用戶：小眼睛LSL
一個可以綜合的Verilog 寫的FIFO存儲器內(nèi)附文檔說明

一個可以綜合的Verilog 寫的FIFO存儲器內(nèi)附文檔說明

標(biāo)簽： Verilog FIFO 存儲器文檔

上傳時間： 2015-11-15

上傳用戶：Avoid98
8051的verilog實(shí)現(xiàn)

8051的verilog實(shí)現(xiàn)，內(nèi)附testbench,c語言調(diào)試程序

標(biāo)簽： verilog 8051

上傳時間： 2014-01-02

上傳用戶：王楚楚
FIFO的verilog實(shí)現(xiàn)

FIFO的verilog實(shí)現(xiàn)，內(nèi)附testbench和文檔說明

標(biāo)簽： verilog FIFO

上傳時間： 2013-12-24

上傳用戶：it男一枚
YASMET: Yet Another Small MaxEnt Toolkit (Statistical Machine Learning) 由Franz Josef Och編寫

YASMET: Yet Another Small MaxEnt Toolkit (Statistical Machine Learning) 由Franz Josef Och編寫，一個簡短但非常經(jīng)典的最大熵統(tǒng)計(jì)模型實(shí)現(xiàn)源碼。

標(biāo)簽： Statistical Learning Another Machine

上傳時間： 2015-11-17

上傳用戶：xiaodu1124
該工程是基于verilog hdl 語言編寫的幀傳輸協(xié)議HDLC幀的發(fā)送端代碼

該工程是基于verilog hdl 語言編寫的幀傳輸協(xié)議HDLC幀的發(fā)送端代碼，會用QUATUSII的人都應(yīng)該知道如何使用，希望能給你帶來幫助

標(biāo)簽： verilog HDLC hdl 幀

上傳時間： 2014-11-22

上傳用戶：3到15
uart串行口,用Verilog編寫的.供大家參考

uart串行口,用Verilog編寫的.供大家參考

標(biāo)簽： Verilog uart 串行口編寫

上傳時間： 2013-12-15

上傳用戶：417313137
將16進(jìn)制文件轉(zhuǎn)換成RAM可讀的文件,verilog語言編寫

將16進(jìn)制文件轉(zhuǎn)換成RAM可讀的文件,verilog語言編寫

標(biāo)簽： verilog RAM 進(jìn)制文件轉(zhuǎn)換

上傳時間： 2013-12-02

上傳用戶：王者A
關(guān)于 linux密鑰的一些安全介紹 #ifndef COMMON_H #define COMMON_H #define MY_PROC_INTERFACE "/proc/learning

關(guān)于 linux密鑰的一些安全介紹 #ifndef COMMON_H #define COMMON_H #define MY_PROC_INTERFACE "/proc/learning-key/gateway" #define FRESH_SESSION _IO( C ,1) #define SUCCESS 0 #define FAILURE 1 #endif

標(biāo)簽： COMMON_H define MY_PROC_INTERFACE learning

上傳時間： 2015-11-19

上傳用戶：葉山豪
基于Verilog 的電子日歷與電子時鐘程序

基于Verilog 的電子日歷與電子時鐘程序，可以進(jìn)行調(diào)日期、星期、時間的分鐘與小時，通過幾種模式來顯示日歷與時間。

標(biāo)簽： Verilog 電子日歷電子時鐘程序

上傳時間： 2014-02-09

上傳用戶：sz_hjbf

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