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verilog-ieee

Verilog HDL實現的I2C Slave模擬

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mentor UART IP verilog源碼以通過驗證.

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IEEE標準文章格式,從國外網站下載的,具有極高的參考價值!

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是用verilog寫的,解復接程序,可以把復接的反過來,一般用在解碼程序中!

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用verilog編寫的程序,用來計算誤碼率的,可以在編碼和解碼過程中用的到的!

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IEEE的寫作要求,格式,以及相關幫助說明,供大家參考借鑒

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checksum fpga verilog

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pc104接口的verilog代碼

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the verilog model of sdram-mt48lc2m32b2 device.

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the verilog model of sram IS61LV25616AL device.

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