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verilog-ieee

crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC de

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第一章數字信號處理、計算、程序、算法和硬線邏輯的基本概念第二章 Verilog HDL設計方法概述第三章 Verilog HDL的基本語法第四章不同抽象級別的Verilog HDL

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非常多的verilog實例

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是一本好書,verilog HDL,a guide to digital design and synthesis

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verilog源碼

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verilog編寫的狀態機檢測00100序列. 實現 input:...011000010010000... output:...000000000100100... 并且用測試模塊來驗證狀

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VERILOG HDL 實際工控項目源碼開發工具 altera quartus2

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一個霹靂燈的Verilog源程序

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用verilog實現單片機計數器用verilog實現單片機計數器

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硬件描述語言,verilog HDL,實現了解碼器的設計

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