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verilog-ieee

the verilog model of async_fifo.

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周立功關于verilog的中文指南

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47譯碼器器的verilog源代碼,經過編譯仿真的

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８＊８的乘法器verilog源代碼,經過編譯仿真的

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pli_handbook_examples_pc verilog hdl 與C的接口的典型例子

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本CD-ROM包括《Verilog-HDL實踐與應用系統設計》一書中的全部例子

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verilog ADPLL file with testbench.v

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完整的用VERILOG語言開發的USB2.0 IP核源代碼

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Verilog HDL的PLI子程序接口

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Thomas課本中的verilog例子。Thomas的verilog在可編程期間領域很有名

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