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  標(biāo)簽： VERILOG GW 48 語言

  上傳時(shí)間： 2016-09-24

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  標(biāo)簽： VERILOG GW 48 語言

  上傳時(shí)間： 2016-09-24

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  標(biāo)簽： S6B33B0 IC C語言 編寫

  上傳時(shí)間： 2014-12-22

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• 用VERILOG語言編寫的FPGA控制PWM的程序免費(fèi)下載

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  標(biāo)簽： VERILOG FPGA PWM 語言

  上傳時(shí)間： 2013-08-16

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• 是一個(gè)用vhdl語言編寫的pwm程序免費(fèi)下載

  資源簡介：是一個(gè)用vhdl語言編寫的pwm程序，可以方便地用來和nios連接，實(shí)現(xiàn)對nios的功能擴(kuò)展。

  標(biāo)簽： vhdl pwm 語言 編寫

  上傳時(shí)間： 2015-04-04

  上傳用戶：xiaohuanhuan

• 這是一個(gè)用AUTOlisp語言編寫的畫圖程序免費(fèi)下載

  資源簡介：這是一個(gè)用AUTOlisp語言編寫的畫圖程序，可以用來畫出道路的縱橫斷面。

  標(biāo)簽： AUTOlisp 語言 編寫 畫圖

  上傳時(shí)間： 2013-12-18

  上傳用戶：yan2267246

• 一個(gè)用VERILOG語言編寫的用來模擬交通信號(hào)燈的程序免費(fèi)下載

  資源簡介：一個(gè)用VERILOG語言編寫的用來模擬交通信號(hào)燈的程序，包含測試文件

  標(biāo)簽： VERILOG 語言 編寫 模擬

  上傳時(shí)間： 2013-12-10

  上傳用戶：pinksun9

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  資源簡介：這是我用VERILOG語言編寫的矩陣鍵盤源程序

  標(biāo)簽： VERILOG 語言 編寫 矩陣鍵盤

  上傳時(shí)間： 2016-07-28

  上傳用戶：trepb001

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  標(biāo)簽： VERILOG FPGA PWM 語言

  上傳時(shí)間： 2014-12-08

  上傳用戶：ouyangtongze

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  標(biāo)簽： c語言 編寫 程序

  上傳時(shí)間： 2017-05-02

  上傳用戶：徐孺

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  標(biāo)簽： VERILOG FPGA 語言 編寫

  上傳時(shí)間： 2017-06-12

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• 本人用易語言編寫的一個(gè)程序、網(wǎng)頁監(jiān)視工具免費(fèi)下載

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  標(biāo)簽： 語言 編寫 程序 監(jiān)視

  上傳時(shí)間： 2017-07-23

  上傳用戶：lanwei

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  上傳時(shí)間： 2013-12-04

  上傳用戶：cooran

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  上傳時(shí)間： 2015-02-06

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  標(biāo)簽： C語言 編寫 程序 鋼琴

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  資源簡介：用VHDL語言編寫的FFT程序，有些參考價(jià)值哦

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  上傳時(shí)間： 2013-12-20

  上傳用戶：lifangyuan12

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  上傳時(shí)間： 2015-06-13

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  資源簡介：用c語言編寫的單片機(jī)程序，能夠?qū)崿F(xiàn)多串口通信及485通信，提供給大家分享。

  標(biāo)簽： c語言 編寫 單片機(jī)程序

  上傳時(shí)間： 2015-08-24

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  上傳時(shí)間： 2015-09-09

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  上傳時(shí)間： 2015-09-29

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  標(biāo)簽： modulewdt VERILOG 語言 編寫

  上傳時(shí)間： 2013-12-23

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  資源簡介：用C語言編的電子鐘程序，有空不妨看下

  標(biāo)簽： C語言 電子鐘 程序

  上傳時(shí)間： 2015-12-23

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  標(biāo)簽： Keil_C 語言 編寫 單片機(jī)程序

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  標(biāo)簽： haffmantree c語言 編寫 程序

  上傳時(shí)間： 2013-12-20

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  標(biāo)簽： VERILOG 語言 編寫 源代碼

  上傳時(shí)間： 2014-01-15

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  標(biāo)簽： 停車場 C語言 編寫 正

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  標(biāo)簽： VERILOG Flash NAND FIFO

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  上傳時(shí)間： 2016-09-28

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