47譯碼器器的verilog源代碼,經(jīng)過(guò)編譯仿真的,絕對(duì)真確,對(duì)初學(xué)者很有幫助
資源簡(jiǎn)介:47譯碼器器的verilog源代碼,經(jīng)過(guò)編譯仿真的,絕對(duì)真確,對(duì)初學(xué)者很有幫助
上傳時(shí)間: 2014-01-23
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資源簡(jiǎn)介:8*8的乘法器verilog源代碼,經(jīng)過(guò)編譯仿真的,絕對(duì)真確,對(duì)初學(xué)者很有幫助
上傳時(shí)間: 2014-01-14
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資源簡(jiǎn)介:AD轉(zhuǎn)換器TCL2543的測(cè)試源代碼 經(jīng)過(guò)測(cè)試 比較好用
上傳時(shí)間: 2016-04-23
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資源簡(jiǎn)介:通用串行異步收發(fā)器8251的verilog HDL源代碼,經(jīng)過(guò)仿真驗(yàn)證。
上傳時(shí)間: 2015-11-21
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資源簡(jiǎn)介:通用串行異步收發(fā)器8251的verilog HDL源代碼.doc
上傳時(shí)間: 2013-12-24
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資源簡(jiǎn)介:MODELSIM 環(huán)境下的verilog 源代碼,實(shí)現(xiàn)全加器功能
上傳時(shí)間: 2015-06-10
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資源簡(jiǎn)介:Keil 下編譯的基于mcs51單片機(jī)的PCA82C250CAN收發(fā)器控制的程序源代碼。
上傳時(shí)間: 2013-12-30
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資源簡(jiǎn)介:Content Addressable Memory 的verilog源代碼。經(jīng)過(guò)modelsim仿真。
上傳時(shí)間: 2013-12-31
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資源簡(jiǎn)介:感知器網(wǎng)絡(luò)的matlab源代碼,歡迎下載
上傳時(shí)間: 2016-06-30
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資源簡(jiǎn)介:一個(gè)全加器的VHDL程序,經(jīng)過(guò)編譯和仿真.
上傳時(shí)間: 2013-12-24
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資源簡(jiǎn)介:spartan3e microblaze 定時(shí)器使用的一個(gè)源代碼
上傳時(shí)間: 2017-03-27
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資源簡(jiǎn)介:3955步進(jìn)電機(jī)的驅(qū)動(dòng)的cpld的verilog程序,經(jīng)過(guò)測(cè)試,可以在ISPLEVER下調(diào)試,包括總線的譯碼等.非常完整
上傳時(shí)間: 2014-11-24
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資源簡(jiǎn)介:離散余弦變換的verilog源代碼,經(jīng)過(guò)驗(yàn)證可實(shí)現(xiàn)
上傳時(shí)間: 2016-01-11
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資源簡(jiǎn)介:PCI接口的verilog源代碼
上傳時(shí)間: 2013-12-28
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資源簡(jiǎn)介:主要完成數(shù)字電視前端信號(hào)處理和緩沖作用的verilog源代碼,可以直接使用
上傳時(shí)間: 2013-12-18
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資源簡(jiǎn)介:這是8位微處理器的verilog源代碼,可以欠在Flex10k10里面
上傳時(shí)間: 2014-01-24
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資源簡(jiǎn)介:基于FPGA的16點(diǎn)FFT快速傅立葉變換的verilog源代碼。
上傳時(shí)間: 2015-04-02
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資源簡(jiǎn)介:PLD與8051接口的參考設(shè)計(jì) Xilinx提供的verilog源代碼
上傳時(shí)間: 2014-01-01
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資源簡(jiǎn)介:本文件是pci的verilog源代碼程序
上傳時(shí)間: 2015-05-14
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資源簡(jiǎn)介:SDRAM 控制器的verilog代碼 經(jīng)過(guò)綜合驗(yàn)證過(guò)的.無(wú)截壓密碼
上傳時(shí)間: 2013-12-19
上傳用戶:semi1981
資源簡(jiǎn)介:usb1.1的verilog源代碼。以及其測(cè)試仿真文件,現(xiàn)在很難找其測(cè)試文件既testbench
上傳時(shí)間: 2013-12-15
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資源簡(jiǎn)介:Viterbi算法的verilog源代碼。
上傳時(shí)間: 2014-01-07
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資源簡(jiǎn)介:一個(gè)小單片機(jī)的verilog源代碼, 包含說(shuō)明文檔
上傳時(shí)間: 2013-12-05
上傳用戶:gaojiao1999
資源簡(jiǎn)介:一個(gè)視頻信號(hào)輸入的verilog源代碼,里面含有相關(guān)的使用文檔。
上傳時(shí)間: 2013-12-25
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資源簡(jiǎn)介:一個(gè)可綜合的同步FIFO的verilog源代碼
上傳時(shí)間: 2015-12-13
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資源簡(jiǎn)介:CPLD驅(qū)動(dòng)VGA顯示器的verilog源代碼.
上傳時(shí)間: 2013-12-25
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資源簡(jiǎn)介:freetype的C/C++ 的應(yīng)用源代碼,經(jīng)過(guò)實(shí)際使用,穩(wěn)定可靠 對(duì)于在嵌入式linux系統(tǒng)中使用TTF字庫(kù)的情況尤其適合
上傳時(shí)間: 2016-01-26
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資源簡(jiǎn)介:一個(gè)3階的32位抽取的cic濾波器的verilog源代碼
上傳時(shí)間: 2016-02-21
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資源簡(jiǎn)介:RS編碼的verilog源代碼,拿來(lái)和大家分享
上傳時(shí)間: 2014-01-17
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資源簡(jiǎn)介:符合8051協(xié)議規(guī)范的UART的verilog源代碼.該壓縮包是一個(gè)modelsim的工程.
上傳時(shí)間: 2014-07-09
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