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• 16*16有符號乘法器的 &#61548 編碼方式：Booth編碼免費下載

  資源簡介：16*16有符號乘法器的 &#61548 編碼方式：Booth編碼， &#61548 拓撲結構：簡單陣列 &#61548 加法器：Ripple Carry Adder

  標簽： 61548 Booth 16 符號

  上傳時間： 2014-01-13

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• Booth乘法器： 16*16有符號乘法器免費下載

  資源簡介：Booth乘法器：&#61550 16*16有符號乘法器，Booth編碼，簡單陣列，Ripple Carry Adder

  標簽： Booth 61550 16 乘法器

  上傳時間： 2014-01-16

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• 一種可以完成16位有符號／無符號二進制數乘法的乘法器。該乘法器采用了改進的Booth算法免費下載

  資源簡介：一種可以完成16位有符號／無符號二進制數乘法的乘法器。該乘法器采用了改進的Booth算法，簡化了部分積的符號擴展，采用Wallace樹和超前進位加法器來進一步提高電路的運算速度。本乘法器可以作為嵌入式CPU內核的乘法單元，整個設計用VHDL語言實現。

  標簽： Booth 符號 乘法器 二進制數

  上傳時間： 2013-12-23

  上傳用戶：skfreeman

• 設計一種可以實現16位有符號_無符號二進制數乘法的乘法器免費下載

  資源簡介：設計一種可以實現16位有符號_無符號二進制數乘法的乘法器，適合感興趣的學習者學習.

  標簽： 乘法器

  上傳時間： 2022-04-27

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• 用VerilogHDL的16*16乘法器的設計實現免費下載

  資源簡介：用VerilogHDL的16*16乘法器的設計實現，采用的是移位相乘方法

  標簽： VerilogHDL 16 乘法器 設計實現

  上傳時間： 2017-08-29

  上傳用戶：haoxiyizhong

• GF_2_m_域乘法器的快速設計及FPGA實現免費下載

  資源簡介：GF_2_m_域乘法器的快速設計及FPGA實現，對于rs編翼碼的理解和設計有幫助

  標簽： FPGA GF 乘法器

  上傳時間： 2013-08-16

  上傳用戶：tangsiyun

• 用walsh算法實現的符號數乘法器,asic流片時,可以不用公司的付費乘法器的ip core.免費下載

  資源簡介：用walsh算法實現的符號數乘法器,asic流片時,可以不用公司的付費乘法器的ip core.

  標簽： walsh asic core 乘法器

  上傳時間： 2015-06-22

  上傳用戶：liuchee

• 通過四位乘法器的實例詳細介紹了用ＶＨＤＬ語言設計數字系統的流程和方法免費下載

  資源簡介：通過四位乘法器的實例詳細介紹了用ＶＨＤＬ語言設計數字系統的流程和方法，通過仿真實現預定目的．

  標簽： 乘法器 詳細介紹 數字系統 流程

  上傳時間： 2016-02-16

  上傳用戶：古谷仁美

• 基于CPLD/FPGA的十六位乘法器的VHDL實現免費下載

  資源簡介：基于CPLD/FPGA的十六位乘法器的VHDL實現

  標簽： CPLD FPGA VHDL 十六位

  上傳時間： 2013-12-16

  上傳用戶：qq1604324866

• 乘法器的實現免費下載

  資源簡介：乘法器的實現，兩種方法，調用IPcore及手動編寫，基于ISE軟件下的VHDL語言實現

  標簽： 乘法器

  上傳時間： 2014-01-18

  上傳用戶：集美慧

• 本源碼是高速并行乘法器的設計源碼免費下載

  資源簡介：本源碼是高速并行乘法器的設計源碼，開發軟件為MAX+PLUS.輸入為兩個帶符號的二進制數

  標簽： 源碼 乘法器 高速并行

  上傳時間： 2015-10-18

  上傳用戶：sunjet

• GF_2_m_域乘法器的快速設計及FPGA實現免費下載

  資源簡介：GF_2_m_域乘法器的快速設計及FPGA實現，對于rs編翼碼的理解和設計有幫助

  標簽： FPGA GF 乘法器

  上傳時間： 2013-12-12

  上傳用戶：日光微瀾

• 復乘法器的FPGA實現免費下載

  資源簡介：復乘法器的FPGA實現， 希望對初學者有幫助

  標簽： FPGA 乘法器

  上傳時間： 2016-12-09

  上傳用戶：Pzj

• 四位乘法器的VHDL源程序免費下載

  資源簡介：四位乘法器的VHDL源程序

  標簽： VHDL 乘法器 源程序

  上傳時間： 2013-12-04

  上傳用戶：kristycreasy

• 布斯乘法器的VHDL程序,下載後直接解壓縮複製貼上到你的EDATOOL就可以.免費下載

  資源簡介：布斯乘法器的VHDL程序,下載後直接解壓縮複製貼上到你的EDATOOL就可以.

  標簽： EDATOOL VHDL 乘法器 程序

  上傳時間： 2015-05-20

  上傳用戶：zycidjl

• 用vhdl語言設計CPU中的一部分：乘法器的設計免費下載

  資源簡介：用vhdl語言設計CPU中的一部分：乘法器的設計，包括多種乘法器的設計方法！內容為英文

  標簽： vhdl CPU 語言 分

  上傳時間： 2015-06-11

  上傳用戶：450976175

• 有關于加法器的vhdl編程免費下載

  資源簡介：有關于加法器的vhdl編程，是用賽靈思的fpga實現的，可以在賽靈思網站上找到更具體的說明

  標簽： vhdl 加法器 編程

  上傳時間： 2013-12-21

  上傳用戶：Altman

• 32×32乘法器的一種設計.pdf32×32乘法器的一種設計.pdf免費下載

  資源簡介：32×32乘法器的一種設計.pdf32×32乘法器的一種設計.pdf

  標簽： 乘法器 32

  上傳時間： 2014-11-30

  上傳用戶：zm7516678

• 定點乘法器的設計免費下載

  資源簡介：定點乘法器的設計，挺經典的！大家好好琢磨．

  標簽： 定點乘法器

  上傳時間： 2013-12-22

  上傳用戶：wab1981

• 用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序免費下載

  資源簡介：用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序

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  上傳時間： 2016-01-15

  上傳用戶：王楚楚

• 用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序免費下載

  資源簡介：用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序

  標簽： Verilog HDL GF C程序

  上傳時間： 2016-01-15

  上傳用戶：chenbhdt

• 介紹了幾種常用的乘法器的設計免費下載

  資源簡介：介紹了幾種常用的乘法器的設計，carry_save_mult，ripple_carry_mult等，壓縮包中包含結構流程圖，用verilogHDL語言，采用modelsim仿真驗證

  標簽： 乘法器

  上傳時間： 2013-12-19

  上傳用戶：pompey

• 關于硬件平臺實現乘法器的構架的書免費下載

  資源簡介：關于硬件平臺實現乘法器的構架的書，不錯哦。

  標簽： 硬件平臺 乘法器 構架

  上傳時間： 2013-12-26

  上傳用戶：gxmm

• 用VHDL寫的一個32位并行乘法器的源代碼免費下載

  資源簡介：用VHDL寫的一個32位并行乘法器的源代碼，已經過驗證，可以直接使用

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  上傳時間： 2014-01-06

  上傳用戶：hoperingcong

• 32位并行乘法器的測試文件免費下載

  資源簡介：32位并行乘法器的測試文件，已經經過驗證，可以直接使用

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  上傳時間： 2014-01-10

  上傳用戶：qilin

• 32位浮點乘法器的設計免費下載

  資源簡介：32位浮點乘法器的設計，講的挺好的，供參考啊

  標簽： 浮點 乘法器

  上傳時間： 2013-11-28

  上傳用戶：manking0408

• 用c 實現乘法器的功能,我已經用過并調試過了免費下載

  資源簡介：用c 實現乘法器的功能,我已經用過并調試過了，很好的原代碼

  標簽： 乘法器 調試

  上傳時間： 2014-01-20

  上傳用戶：cc1

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  資源簡介：該模型用于搭建了一個基于時分割乘法器的電子式電能表的模型

  標簽： 模型 時分 乘法器 電子式

  上傳時間： 2013-12-09

  上傳用戶：趙云興

• 移位乘法器的輸入為兩個4位操作數a和b免費下載

  資源簡介：移位乘法器的輸入為兩個4位操作數a和b，啟動乘法器由stb控制，clk信號提供系統定時。乘法器的結果為8位信號result,乘法結束后置信號done為1. 乘法算法采用原碼移位乘法，即對兩個操作數進行逐位的移位相加，迭代4次后輸出結果。具體算法： 1. 被乘數...

  標簽： 移位 乘法器 位操作 輸入

  上傳時間： 2014-01-03

  上傳用戶：星仔

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  資源簡介：乘法器的vhdl語言描述.本人調試已經通過

  標簽： vhdl 乘法器 語言 調試

  上傳時間： 2013-12-17

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