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• 用vhdl語句描述4位等值比較器免費(fèi)下載

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  標(biāo)簽： vhdl 比較器

  上傳時(shí)間： 2014-01-15

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• 用vhdl設(shè)計(jì)一個(gè)4位二進(jìn)制并行半加器免費(fèi)下載

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  標(biāo)簽： vhdl 二進(jìn)制 并行 半加器

  上傳時(shí)間： 2014-11-24

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• 4位數(shù)值比較器MC14585B.能夠?qū)蓚€(gè)輸入信號(hào)比較的各種情況送到輸出端口上.本程序基于vhdl語言,開發(fā)環(huán)境是MAXPLUS2免費(fèi)下載

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  標(biāo)簽： MAXPLUS2 14585 vhdl MC

  上傳時(shí)間： 2016-03-09

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• 4位數(shù)據(jù)比較器 通過vhdl語言設(shè)計(jì)出4位數(shù)據(jù)比較器免費(fèi)下載

  資源簡介：4位數(shù)據(jù)比較器 通過vhdl語言設(shè)計(jì)出4位數(shù)據(jù)比較器，了解EDA對數(shù)字電路設(shè)計(jì)的效率和可靠性有極大地提高

  標(biāo)簽： vhdl 數(shù)據(jù) 比較器 語言

  上傳時(shí)間： 2016-08-12

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• 用vhdl語言實(shí)現(xiàn)4位乘法器免費(fèi)下載

  資源簡介：用vhdl語言實(shí)現(xiàn)4位乘法器，已被測試過，可參考使用

  標(biāo)簽： vhdl 語言 乘法器

  上傳時(shí)間： 2017-07-09

  上傳用戶：洛木卓

• 用vhdl編寫的8位全加器,數(shù)字分頻器等程序免費(fèi)下載

  資源簡介：用vhdl編寫的8位全加器,數(shù)字分頻器等程序

  標(biāo)簽： vhdl 8位 編寫 全加器

  上傳時(shí)間： 2013-12-16

  上傳用戶：ztj182002

• 用vhdl結(jié)構(gòu)描述設(shè)計(jì)一全減器免費(fèi)下載

  資源簡介：用vhdl結(jié)構(gòu)描述設(shè)計(jì)一全減器，全減器可由兩個(gè)半減器和一個(gè)或門組成。

  標(biāo)簽： vhdl 減

  上傳時(shí)間： 2013-12-22

  上傳用戶：思琦琦

• 用vhdl語言設(shè)計(jì)四位全加器免費(fèi)下載

  資源簡介：用vhdl語言設(shè)計(jì)四位全加器，有低位進(jìn)位和高位進(jìn)位。

  標(biāo)簽： vhdl 語言 全加器

  上傳時(shí)間： 2013-12-26

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• 最高優(yōu)先級(jí)編碼器 8位相等比較器 三人表決器（三種不同的描述方式） 加法器描述 8位總線收發(fā)器：74245 （注2） 地址譯碼（for m68008） 多路選擇器（使用select語句）免費(fèi)下載

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  標(biāo)簽： m68008 select 74245 for

  上傳時(shí)間： 2015-04-11

  上傳用戶：tianyi223

• 用vhdl語言采用串行方法實(shí)現(xiàn)用1位全加器實(shí)現(xiàn)4位全加器免費(fèi)下載

  資源簡介：用vhdl語言采用串行方法實(shí)現(xiàn)用1位全加器實(shí)現(xiàn)4位全加器

  標(biāo)簽： vhdl 全加器 語言 串行

  上傳時(shí)間： 2016-05-27

  上傳用戶：hongmo

• 此程序是用vhdl硬件描述語言編寫的,實(shí)現(xiàn)四位全加器的功能免費(fèi)下載

  資源簡介：此程序是用vhdl硬件描述語言編寫的,實(shí)現(xiàn)四位全加器的功能

  標(biāo)簽： vhdl 程序 硬件描述語言 全加器

  上傳時(shí)間： 2017-01-07

  上傳用戶：天誠24

• 一個(gè)用vhdl硬件描述語言實(shí)現(xiàn)的一個(gè)比較簡單的除法器免費(fèi)下載

  資源簡介：一個(gè)用vhdl硬件描述語言實(shí)現(xiàn)的一個(gè)比較簡單的除法器

  標(biāo)簽： vhdl 硬件描述語言 比較 除法器

  上傳時(shí)間： 2017-06-12

  上傳用戶：waitingfy

• 8位大小比較器的vhdl源代碼免費(fèi)下載

  資源簡介：8位大小比較器的vhdl源代碼，Magnitude Comparator vhdl description of a 4-bit magnitude comparator with expansion inputs

  標(biāo)簽： vhdl 8位 比較器 源代碼

  上傳時(shí)間： 2015-04-15

  上傳用戶：guanliya

• 用vhdl語言描述和實(shí)現(xiàn)的一個(gè)交通燈控制器免費(fèi)下載

  資源簡介：用vhdl語言描述和實(shí)現(xiàn)的一個(gè)交通燈控制器，該交通燈系統(tǒng)為一個(gè)十字路口交通管理信號(hào)燈，用于主干道與鄉(xiāng)間公路的交叉路口，要求是優(yōu)先保證主干道的暢通，因此平時(shí)處于“主干道綠燈，鄉(xiāng)間道紅燈”狀態(tài)，只有在鄉(xiāng)間公路有車輛要穿行主干道時(shí)才將交通燈切向“主干...

  標(biāo)簽： vhdl 語言 交通燈控制器

  上傳時(shí)間： 2013-12-01

  上傳用戶：遠(yuǎn)遠(yuǎn)ssad

• 數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用vhdl語言描述免費(fèi)下載

  資源簡介：數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用vhdl語言描述，集成在一個(gè)模塊中，提供vhdl源程序供大家學(xué)習(xí)和討論。\r\n

  標(biāo)簽： vhdl 寄存器 數(shù)控振蕩器 加法器

  上傳時(shí)間： 2013-09-04

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• 用vhdl硬件描述語言實(shí)現(xiàn)的對FPGA（Cyclone II）的配置的vhdl源代碼。免費(fèi)下載

  資源簡介：用vhdl硬件描述語言實(shí)現(xiàn)的對FPGA（Cyclone II）的配置的vhdl源代碼。

  標(biāo)簽： vhdl Cyclone FPGA 硬件描述語言

  上傳時(shí)間： 2015-04-02

  上傳用戶：nanxia

• 這是用vhdl編寫的四位加法器免費(fèi)下載

  資源簡介：這是用vhdl編寫的四位加法器，請多指教

  標(biāo)簽： vhdl 編寫 加法器

  上傳時(shí)間： 2013-12-12

  上傳用戶：yepeng139

• 數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用vhdl語言描述免費(fèi)下載

  資源簡介：數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用vhdl語言描述，集成在一個(gè)模塊中，提供vhdl源程序供大家學(xué)習(xí)和討論。

  標(biāo)簽： vhdl 寄存器 數(shù)控振蕩器 加法器

  上傳時(shí)間： 2014-08-31

  上傳用戶：yan2267246

• 用vhdl硬件描述語言開發(fā)的miniUART接口IP Core,用戶可以將其嵌入到自己的FPGA模塊中。免費(fèi)下載

  資源簡介：用vhdl硬件描述語言開發(fā)的miniUART接口IP Core,用戶可以將其嵌入到自己的FPGA模塊中。

  標(biāo)簽： miniUART vhdl Core FPGA

  上傳時(shí)間： 2015-07-22

  上傳用戶：稀世之寶039

• 該程序用vhdl硬件描述語言編寫而成,已調(diào)試通過,程序運(yùn)行后可實(shí)現(xiàn)三分頻,這樣就用軟件設(shè)計(jì)代替了硬件設(shè)計(jì),方便,穩(wěn)定,不需要硬件調(diào)試!免費(fèi)下載

  資源簡介：該程序用vhdl硬件描述語言編寫而成,已調(diào)試通過,程序運(yùn)行后可實(shí)現(xiàn)三分頻,這樣就用軟件設(shè)計(jì)代替了硬件設(shè)計(jì),方便,穩(wěn)定,不需要硬件調(diào)試!

  標(biāo)簽： vhdl 程序 硬件描述語言 三分頻

  上傳時(shí)間： 2013-12-24

  上傳用戶：huyiming139

• 用vhdl硬件描述語言編寫的FIR數(shù)字濾波器免費(fèi)下載

  資源簡介：用vhdl硬件描述語言編寫的FIR數(shù)字濾波器

  標(biāo)簽： vhdl FIR 硬件描述語言 數(shù)字濾波器

  上傳時(shí)間： 2014-01-22

  上傳用戶：cuibaigao

• 4位乘法器,4位除法器 8位數(shù)據(jù)鎖存器,8位相等比較器,帶同步復(fù)位的狀態(tài) 機(jī),元件例化與層次設(shè)計(jì),最高優(yōu)先級(jí)編碼器免費(fèi)下載

  資源簡介：4位乘法器,4位除法器 8位數(shù)據(jù)鎖存器,8位相等比較器,帶同步復(fù)位的狀態(tài) 機(jī),元件例化與層次設(shè)計(jì),最高優(yōu)先級(jí)編碼器

  標(biāo)簽： 乘法器 8位 除法器 數(shù)據(jù)

  上傳時(shí)間： 2014-12-07

  上傳用戶：pompey

• SDI接口的源程序,包括擾碼編碼,并串轉(zhuǎn)換,用vhdl硬件描述語言編寫免費(fèi)下載

  資源簡介：SDI接口的源程序,包括擾碼編碼,并串轉(zhuǎn)換,用vhdl硬件描述語言編寫

  標(biāo)簽： vhdl SDI 接口 源程序

  上傳時(shí)間： 2014-08-24

  上傳用戶：gtzj

• 用vhdl 語言描述度7段LED數(shù)碼顯示管免費(fèi)下載

  資源簡介：用vhdl 語言描述度7段LED數(shù)碼顯示管，其開發(fā)均在FPGA中

  標(biāo)簽： vhdl LED 語言 數(shù)碼

  上傳時(shí)間： 2015-11-11

  上傳用戶：lanhuaying

• 用vhdl 語言描述度三線八線譯碼器免費(fèi)下載

  資源簡介：用vhdl 語言描述度三線八線譯碼器，其開發(fā)均在FPGA中

  標(biāo)簽： vhdl 語言 譯碼器

  上傳時(shí)間： 2013-12-20

  上傳用戶：love1314

• 用vhdl 語言描述度八層電梯免費(fèi)下載

  資源簡介：用vhdl 語言描述度八層電梯，其開發(fā)均在FPGA中

  標(biāo)簽： vhdl 語言 電梯

  上傳時(shí)間： 2013-12-17

  上傳用戶：ljt101007

• 用vhdl 語言描述頻率計(jì)的設(shè)計(jì)免費(fèi)下載

  資源簡介：用vhdl 語言描述頻率計(jì)的設(shè)計(jì)，其開發(fā)均在FPGA中

  標(biāo)簽： vhdl 語言 頻率計(jì)

  上傳時(shí)間： 2013-12-24

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• 用vhdl語言描述十六路彩燈的設(shè)計(jì)其開發(fā)均在FPGA中免費(fèi)下載

  資源簡介：用vhdl語言描述十六路彩燈的設(shè)計(jì)其開發(fā)均在FPGA中

  標(biāo)簽： vhdl FPGA 語言 彩燈

  上傳時(shí)間： 2014-01-10

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• 基本數(shù)學(xué)運(yùn)算庫 包括各種用vhdl語言描述的基本數(shù)學(xué)運(yùn)算單元免費(fèi)下載

  資源簡介：基本數(shù)學(xué)運(yùn)算庫 包括各種用vhdl語言描述的基本數(shù)學(xué)運(yùn)算單元，瑞典聯(lián)邦技術(shù)研究院（ETH）提供

  標(biāo)簽： vhdl 運(yùn)算 語言

  上傳時(shí)間： 2013-12-24

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• 用verilog編寫的4位ALU免費(fèi)下載

  資源簡介：用verilog編寫的4位ALU，由算術(shù)運(yùn)算模塊、邏輯運(yùn)算模塊、選擇模塊組成

  標(biāo)簽： verilog ALU 編寫

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