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  標簽： VHDL 數據 比較器 語言

  上傳時間： 2016-08-12

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• 采用VHDL語言設計一個4通道的數據采集控制模塊。系統的功能描述如下： 1.系統主時鐘為100 MHz。 2.數據為16位-數據線上連續2次00FF后數據傳輸開始。 3.系統內部總線寬度為8位。免費下載

  資源簡介：采用VHDL語言設計一個4通道的數據采集控制模塊。系統的功能描述如下： 1.系統主時鐘為100 MHz。 2.數據為16位-數據線上連續2次00FF后數據傳輸開始。 3.系統內部總線寬度為8位。 4.共有4個通道（ch1、ch2、ch3、ch4），每個通道配備100 Bytes的RAM，當存滿...

  標簽： VHDL 100 MHz

  上傳時間： 2013-12-25

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• 采用VHDL語言設計一個4通道的數據采集控制模塊.免費下載

  資源簡介：采用VHDL語言設計一個4通道的數據采集控制模塊.

  標簽： VHDL 數據采集

  上傳時間： 2022-04-25

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• 四位全家器的VHDL語言模塊免費下載

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  標簽： VHDL 家 語言 模塊

  上傳時間： 2015-06-21

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• 4bit ALU 利用VHDL語言編寫的4位ALU 開發環境是在windows下免費下載

  資源簡介：4bit ALU 利用VHDL語言編寫的4位ALU 開發環境是在windows下

  標簽： ALU windows 4bit VHDL

  上傳時間： 2015-05-04

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• 這是用VHDL語言寫的32位分頻器的程序免費下載

  資源簡介：這是用VHDL語言寫的32位分頻器的程序，可直接運行，看結果，歡迎使用。多指正，交流。

  標簽： VHDL 語言 分頻器 程序

  上傳時間： 2015-05-11

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• 通過VHDL語言編寫的計數器程序,可以在一嗎器顯示管上分段顯示小時,分,秒,并且可以分別清零免費下載

  資源簡介：通過VHDL語言編寫的計數器程序,可以在一嗎器顯示管上分段顯示小時,分,秒,并且可以分別清零

  標簽： VHDL 分 語言 編寫

  上傳時間： 2013-12-16

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• 電子EDA,VHDL語言設計8位的fifo數據緩沖器的VHDL源程序免費下載

  資源簡介：電子EDA,VHDL語言設計8位的fifo數據緩沖器的VHDL源程序

  標簽： VHDL fifo VHDL EDA

  上傳時間： 2016-01-10

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• 通過VHDL語言實現四位無符號數的加法免費下載

  資源簡介：通過VHDL語言實現四位無符號數的加法，四位撥位置數，用數碼管輸出結果

  標簽： VHDL 語言 符號 加法

  上傳時間： 2013-12-21

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• 在 MAX+PLUS II開發環境下采用 VHDL語言 設計并實現了電表抄表器 討論了系統的四個 組成模塊的設計和 VHDL 的實現 每個模塊采用 RTL 級描述 整體的生成采用圖形輸入法 通過波形免費下載

  資源簡介：在 MAX+PLUS II開發環境下采用 VHDL語言 設計并實現了電表抄表器 討論了系統的四個 組成模塊的設計和 VHDL 的實現 每個模塊采用 RTL 級描述 整體的生成采用圖形輸入法 通過波形仿真 下載芯片測試 完成了抄表器的功能

  標簽： VHDL PLUS MAX RTL

  上傳時間： 2013-12-26

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• 8位全加器的VHDL語言描述免費下載

  資源簡介：8位全加器的VHDL語言描述，有需要的頂一下。

  標簽： VHDL 8位 全加器 語言

  上傳時間： 2017-05-30

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  資源簡介：自己使用VHDL語言編寫的24位寄存器.主要用于DDS中

  標簽： VHDL DDS 24位 語言

  上傳時間： 2013-12-27

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• 用VHDL語言設計四位全加器免費下載

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  標簽： VHDL 語言 全加器

  上傳時間： 2013-12-26

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• :介紹了基于FPGA的FIR數字濾波器的設計與實現,該設計利用Matlab工具箱設計窗函數計算FIR濾波器系數,并通過VHDL層次化設計方法,同時FPGA與單片機有機結合,采用C51及VHDL語言模塊免費下載

  資源簡介：:介紹了基于FPGA的FIR數字濾波器的設計與實現,該設計利用Matlab工具箱設計窗函數計算FIR濾波器系數,并通過VHDL層次化設計方法,同時FPGA與單片機有機結合,采用C51及VHDL語言模塊化的設計思想及進行優化編程,有效實現了鍵盤可設置參數及LCD顯示。結果表明此實現...

  標簽： FPGA VHDL FIR Matlab

  上傳時間： 2014-01-02

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• 基于VHDL語言的卷積碼編解碼器的設計免費下載

  資源簡介：本文在闡述卷積碼編解碼器基本工作原理的基礎上，提出了在MAX+PlusⅡ開發平臺上基于VHDL語言設計（2，1，6）卷積碼編解碼器的方法。

  標簽： VHDL 語言 卷積碼 編解碼器

  上傳時間： 2013-06-16

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• 通過VHDL語言進行數字信號處理的FIR操作免費下載

  資源簡介：通過VHDL語言進行數字信號處理的FIR操作，可以很好的實現濾波功能，有很好的作用，

  標簽： VHDL FIR 語言 數字信號處理

  上傳時間： 2013-08-11

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• VHDL語言實現的16位快速乘法器免費下載

  資源簡介：VHDL語言實現的16位快速乘法器

  標簽： VHDL 語言 乘法器

  上傳時間： 2013-11-30

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  資源簡介：一個比較老的C語言編譯器,WAVE的老板本仿真器只能用他

  標簽： WAVE 比較 C語言 仿真器

  上傳時間： 2013-12-18

  上傳用戶：凌云御清風

• 8-1024可變點數FFT/IFFT變換,VHDL語言設計, 仿真通過,可以很容易綜合.免費下載

  資源簡介：8-1024可變點數FFT/IFFT變換,VHDL語言設計, 仿真通過,可以很容易綜合.

  標簽： 1024 IFFT VHDL FFT

  上傳時間： 2014-01-18

  上傳用戶：coeus

• 一個用VHDL語言編成的可以讓蜂鳴器發聲的的程序。免費下載

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  上傳時間： 2015-06-06

  上傳用戶：it男一枚

• 16位1024點FFT的VHDL語言實現免費下載

  資源簡介：16位1024點FFT的VHDL語言實現

  標簽： 1024 VHDL FFT 語言

  上傳時間： 2013-11-29

  上傳用戶：鳳臨西北

• 利用VHDL語言編寫的一個16分頻器免費下載

  資源簡介：利用VHDL語言編寫的一個16分頻器，另外可以在程序中修改為任意2N的分頻器

  標簽： VHDL 語言 編寫 分頻器

  上傳時間： 2014-01-18

  上傳用戶：erkuizhang

• 用VHDL語言編寫的三位二進制的乘法器免費下載

  資源簡介：用VHDL語言編寫的三位二進制的乘法器，其原理是每位相乘后再錯位相加

  標簽： VHDL 語言 編寫 二進制

  上傳時間： 2014-08-31

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  資源簡介：用VHDL硬件語言設計的16位cpu，上傳的壓縮包既包含源代碼又包含詳細的文檔說明。

  標簽： VHDL cpu 硬件語言設計

  上傳時間： 2015-10-27

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• 用VHDL 語言描述度三線八線譯碼器免費下載

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  標簽： VHDL 語言 譯碼器

  上傳時間： 2013-12-20

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  資源簡介：基于fpga和sopc的用VHDL語言編寫的EDA數控分頻器

  標簽： fpga VHDL sopc EDA

  上傳時間： 2014-01-03

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• 基于fpga和sopc的用VHDL語言編寫的EDA8位16進制頻率計免費下載

  資源簡介：基于fpga和sopc的用VHDL語言編寫的EDA8位16進制頻率計

  標簽： fpga VHDL EDA8 sopc

  上傳時間： 2016-02-04

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• 8位十進制頻率計,通過驗證,目標芯片EPF10KLC84-4免費下載

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  標簽： EPF KLC 10 84

  上傳時間： 2013-12-24

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  標簽： 程序 C語言 家 人工

  上傳時間： 2016-10-14

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• 通過VHDL語言進行數字信號處理的FIR操作免費下載

  資源簡介：通過VHDL語言進行數字信號處理的FIR操作，可以很好的實現濾波功能，有很好的作用，

  標簽： VHDL FIR 語言 數字信號處理

  上傳時間： 2014-01-10

  上傳用戶：dianxin61