相 關 資 源

• 數字鎖相環(DPLL)技術在數字通信、無線電電子學等眾多領域得到了極為廣泛的應用。與傳統的模擬電路實現的PLL相比免費下載

  資源簡介：數字鎖相環(DPLL)技術在數字通信、無線電電子學等眾多領域得到了極為廣泛的應用。與傳統的模擬電路實現的PLL相比，DPLL具有精度高、不受溫度和電壓影響、環路帶寬和中心頻率編程可調、易于構建高階鎖相環等優點。

  標簽： DPLL PLL 數字鎖相環 數字通信

  上傳時間： 2013-12-18

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• 數字鎖相環DPLL源程序免費下載

  資源簡介：數字鎖相環DPLL源程序，用cpld編寫，展開后文件比較多，大家請耐心使用。謝謝，多多支持

  標簽： DPLL 數字鎖相環 源程序

  上傳時間： 2013-12-20

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• 數字鎖相環DPLL實例程序免費下載

  資源簡介：數字鎖相環DPLL實例程序，幫助理解PLL的結構和詳細原理

  標簽： DPLL 數字鎖相環 實例程序

  上傳時間： 2014-08-14

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• 數字鎖相環程序免費下載

  資源簡介：數字鎖相環程序，適合于FM、AM開發 數字鎖相環程序，適合于FM、AM開發

  標簽： 數字鎖相環 程序

  上傳時間： 2015-06-20

  上傳用戶：363186

• PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), 數字鎖相技術在通信領域應用非常廣泛免費下載

  資源簡介：PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), 數字鎖相技術在通信領域應用非常廣泛，本例用VHDL描述了一個鎖相環作為參考，源碼已經調試過。編譯器synplicty.Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致,...

  標簽： PLL 數字鎖相環 接收 數字

  上傳時間： 2013-12-31

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• PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿免費下載

  資源簡介：PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿上；頂層文件是PLL.GDF

  標簽： 數據 Q5 PLL 輸入

  上傳時間： 2014-06-09

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• 比較好的技術文章《基于VHDL的全數字鎖相環的設計》有關鍵部分的源代碼。免費下載

  資源簡介：比較好的技術文章《基于VHDL的全數字鎖相環的設計》有關鍵部分的源代碼。

  標簽： VHDL 比較 全數字 分

  上傳時間： 2013-12-24

  上傳用戶：362279997

• 技術文章《自采樣比例積分控制全數字鎖相環的性能分析和實現》有一定參考價值免費下載

  資源簡介：技術文章《自采樣比例積分控制全數字鎖相環的性能分析和實現》有一定參考價值

  標簽： 采樣 比例 控制 全數字

  上傳時間： 2015-08-21

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• 智能全數字鎖相環的設計用VHDL語言在CPLD上實現串行通信免費下載

  資源簡介：智能全數字鎖相環的設計用VHDL語言在CPLD上實現串行通信

  標簽： VHDL CPLD 全數字 串行通信

  上傳時間： 2014-01-08

  上傳用戶：weiwolkt

• 本文在說明全數字鎖相環的基礎上免費下載

  資源簡介：本文在說明全數字鎖相環的基礎上，提出了一種利用FPGA設計一階全數字鎖相環的方法，并 給出了關鍵部件的RTL可綜合代碼，并結合本設計的一些仿真波形詳細描述了數字鎖相環的工作過程，最后對一些有關的問題進行了討論。

  標簽： 全數字 鎖相環

  上傳時間： 2014-01-10

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• 數字鎖相環路原理與應用:全數字鎖相環。根據本資料可以自己編寫代碼在計算機上模擬實現。免費下載

  資源簡介：數字鎖相環路原理與應用:全數字鎖相環。根據本資料可以自己編寫代碼在計算機上模擬實現。

  標簽： 數字 全數字 代碼 鎖相環路

  上傳時間： 2016-11-01

  上傳用戶：edisonfather

• 使用VHDL語言進行設計DPLL（數字鎖相環）的相關文件免費下載

  資源簡介：使用VHDL語言進行設計DPLL（數字鎖相環）的相關文件

  標簽： VHDL DPLL 語言 數字鎖相環

  上傳時間： 2013-12-25

  上傳用戶：Miyuki

• 基于鎖相環Top-down的建模方法在MATLAB環境下建立數字鎖相環完整的仿真模型免費下載

  資源簡介：基于鎖相環Top-down的建模方法在MATLAB環境下建立數字鎖相環完整的仿真模型，并用SIMULINK對數字鎖相環的仿真模型進行仿真。　

  標簽： Top-down MATLAB 鎖相環 建模方法

  上傳時間： 2014-01-15

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• 數字式調頻收音機設計 介紹利用數字鎖相頻率合成技術構成收音機的電調諧部分并闡述了收音機的調臺、選臺、搜索與存儲等功能的電路設計原理,著重介紹了用收音機集成芯片CXA1019S構成的FM電路、頻率合成免費下載

  資源簡介：數字式調頻收音機設計 介紹利用數字鎖相頻率合成技術構成收音機的電調諧部分并闡述了收音機的調臺、選臺、搜索與存儲等功能的電路設計原理,著重介紹了用收音機集成芯片CXA1019S構成的FM電路、頻率合成器芯片BU2614構成的鎖相環電路。

  標簽： 1019S 1019 收音機 CXA

  上傳時間： 2013-12-16

  上傳用戶：ouyangtongze

• 一個實現簡單的數字鎖相環Verilog代碼免費下載

  資源簡介：一個實現簡單的數字鎖相環Verilog代碼，本人借鑒網上現有的代碼后經修改在Cyclone II上調通實現，里面有ModelSim仿真成功的波形圖

  標簽： Verilog 數字鎖相環 代碼

  上傳時間： 2014-01-22

  上傳用戶：003030

• PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定免費下載

  資源簡介：PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿上； 頂層文件是PLL.GDF

  標簽： Q5 數據 PLL 輸入

  上傳時間： 2017-07-24

  上傳用戶：璇珠官人

• 數字鎖相環原理與應用.pdf免費下載

  資源簡介：鎖相技術相關專輯 38冊 209M數字鎖相環原理與應用.pdf

  標簽：

  上傳時間： 2014-05-05

  上傳用戶：時代將軍

• 用數字鎖相環電路實現高精度寬范圍頻率控制.pdf免費下載

  資源簡介：鎖相技術相關專輯 38冊 209M用數字鎖相環電路實現高精度寬范圍頻率控制.pdf

  標簽：

  上傳時間： 2014-05-05

  上傳用戶：時代將軍

• 用一片CPLD實現數字鎖相環,用VHDL或V語言.rar免費下載

  資源簡介：用一片CPLD實現數字鎖相環,用VHDL或V語言

  標簽： CPLD VHDL 數字鎖相環

  上傳時間： 2013-05-27

  上傳用戶：hewenzhi

• 基于FPGA實現的一種新型數字鎖相環免費下載

  資源簡介：基于FPGA實現的一種新型數字鎖相環

  標簽： FPGA 新型數字 鎖相環

  上傳時間： 2013-08-07

  上傳用戶：2467478207

• 基于FPGA的全數字鎖相環設計免費下載

  資源簡介：基于FPGA的全數字鎖相環設計,內有設計過程和設計思想

  標簽： FPGA 全數字 鎖相環

  上傳時間： 2013-08-13

  上傳用戶：fqscfqj

• 基于FPGA設計數字鎖相環免費下載

  資源簡介：基于FPGA設計數字鎖相環，提出了一種由微分超前/滯后型檢相器構成數字鎖相環的Verilog-HDL建模方案

  標簽： FPGA 數字鎖相環

  上傳時間： 2013-08-19

  上傳用戶：Huge_Brother

• 關于數字鎖相環的一點東西免費下載

  資源簡介：關于數字鎖相環的一點東西,可以下來看看\r\n

  標簽： 數字鎖相環

  上傳時間： 2013-08-26

  上傳用戶：7891

• 用VHDL寫的數字鎖相環程序 PLL.vhd為源文件 PLLTB.vhd為testbench免費下載

  資源簡介：用VHDL寫的數字鎖相環程序 PLL.vhd為源文件 PLLTB.vhd為testbench

  標簽： vhd testbench PLLTB VHDL

  上傳時間： 2014-01-20

  上傳用戶：zwei41

• 數字瑣相環DPLL的VERLOG代碼免費下載

  資源簡介：數字瑣相環DPLL的VERLOG代碼，MODELSIM下的工程，有測試文件

  標簽： VERLOG DPLL 數字 代碼

  上傳時間： 2014-01-13

  上傳用戶：Thuan

• 用verilog語言編寫的全數字鎖相環的源代碼,基于fpga平臺免費下載

  資源簡介：用verilog語言編寫的全數字鎖相環的源代碼,基于fpga平臺

  標簽： verilog fpga 語言 編寫

  上傳時間： 2015-06-13

  上傳用戶：wanqunsheng

• 關于數字鎖相環的使用免費下載

  資源簡介：關于數字鎖相環的使用，結合FM,AM的使用來說明

  標簽： 數字鎖相環

  上傳時間： 2013-12-29

  上傳用戶：蟲蟲蟲蟲蟲蟲

• 全數字鎖相環ＶＨＤＬ描述并實現功能仿真免費下載

  資源簡介：全數字鎖相環ＶＨＤＬ描述并實現功能仿真，另附有圖形說明

  標簽： 全數字 鎖相環 功能仿真

  上傳時間： 2014-01-13

  上傳用戶：shawvi

• 直接式數字鎖相環頻率合成器.用ELANIX公司SYSTEMVIEW運行.免費下載

  資源簡介：直接式數字鎖相環頻率合成器.用ELANIX公司SYSTEMVIEW運行.

  標簽： SYSTEMVIEW ELANIX 數字鎖相環 頻率合成器

  上傳時間： 2015-07-18

  上傳用戶：妄想演繹師

• 一種改進的全數字鎖相環設計 一種改進的全數字鎖相環設計免費下載

  資源簡介：一種改進的全數字鎖相環設計 一種改進的全數字鎖相環設計

  標簽： 全數字 鎖相環

  上傳時間： 2013-12-24

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