用以實現(xiàn)信號的任意分頻,用于信號的精確分頻
資源簡介:用以實現(xiàn)信號的任意分頻,用于信號的精確分頻
上傳時間: 2016-05-31
上傳用戶:小眼睛LSL
資源簡介:能夠?qū)崿F(xiàn)0~99的任意分頻,并實現(xiàn)輸出頻率50%的占空比
上傳時間: 2016-05-09
上傳用戶:helmos
資源簡介:fpga上實現(xiàn)的最小是0.5分頻的任意分頻器
上傳時間: 2017-03-24
上傳用戶:417313137
資源簡介:實現(xiàn)對時鐘信號的技術分頻,程序簡單易懂,對于初學VHDL者來說,提供了一個良好的方法。
上傳時間: 2013-12-26
上傳用戶:asddsd
資源簡介:自己編寫的任意分頻VHDL程序,程序簡單,以供大家分享!
上傳時間: 2015-10-05
上傳用戶:xjz632
資源簡介:關于fpga硬件語言的任意分頻算法,對編程很有幫助
上傳時間: 2014-01-12
上傳用戶:sz_hjbf
資源簡介:一個好用的整數(shù)分頻電路 保證你喜歡 能夠?qū)崿F(xiàn)對任意整數(shù)的分頻電路設計
上傳時間: 2013-09-01
上傳用戶:909000580
資源簡介:Verilog_實現(xiàn)任意占空比、任意分頻的方法
上傳時間: 2013-11-07
上傳用戶:JasonC
資源簡介:Verilog_實現(xiàn)任意占空比、任意分頻的方法
上傳時間: 2013-11-20
上傳用戶:ccxzzhm
資源簡介:一個好用的整數(shù)分頻電路 保證你喜歡 能夠?qū)崿F(xiàn)對任意整數(shù)的分頻電路設計
上傳時間: 2013-12-24
上傳用戶:熊少鋒
資源簡介:任意分頻的vhdl實現(xiàn),若需要具體參數(shù),只需改變程序中的分頻參數(shù)即可實現(xiàn)。
上傳時間: 2016-05-14
上傳用戶:firstbyte
資源簡介:數(shù)控分頻器的輸出信號頻率為輸入數(shù)據(jù)的函數(shù)。用傳統(tǒng)的方法設計,其設計過程和電路都比較復雜,且設計成 果的可修改性和可移植性都較差。基于VHDL 的數(shù)控分頻器設計,整個過程簡單、快捷,極易修改,可移植性強。他可利用 并行預置數(shù)的加法計數(shù)器和減法計數(shù)器實現(xiàn)...
上傳時間: 2014-11-29
上傳用戶:1051290259
資源簡介:基于Quartus II的數(shù)控分頻器的項目設計,實現(xiàn)對時鐘信號的任意進制分頻,包含了項目文件和VHDL源代碼
上傳時間: 2017-07-18
上傳用戶:yangbo69
資源簡介:該程序是用VHDL語言實現(xiàn)的時鐘分頻程序,可以把高頻時鐘信號分成低頻時鐘信號,便于實際應用。
上傳時間: 2017-08-19
上傳用戶:wcl168881111111
資源簡介:用Verilog實現(xiàn)基于FPGA的通用分頻器
上傳時間: 2013-08-30
上傳用戶:xingyuewubian
資源簡介:用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設計
上傳時間: 2013-10-28
上傳用戶:xiaoxiang
資源簡介:基于FPGA的小數(shù)分頻實現(xiàn)方法
上傳時間: 2013-10-11
上傳用戶:jiangxiansheng
資源簡介:用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設計
上傳時間: 2015-01-02
上傳用戶:oooool
資源簡介:基于FPGA的小數(shù)分頻實現(xiàn)方法
上傳時間: 2013-11-05
上傳用戶:feifei0302
資源簡介:用vhdl實現(xiàn)占空比1:1的通用分頻模塊,非常實用,歡迎大家下載
上傳時間: 2013-12-19
上傳用戶:皇族傳媒
資源簡介:一個簡單的VHDL分頻模塊,可以嵌套自己的子程序?qū)崿F(xiàn)任意分頻
上傳時間: 2015-05-14
上傳用戶:qiaoyue
資源簡介:用Verilog實現(xiàn)基于FPGA的通用分頻器
上傳時間: 2015-08-20
上傳用戶:songrui
資源簡介:本文介紹了兩種分頻系數(shù)為整數(shù)或半整數(shù)的可控分頻器的設計方法。其中之一可以實現(xiàn)50%的奇數(shù)分頻。利用VHDL語言編程,并用QUARTERS||4.0進行仿真,用 FPGA 芯片實現(xiàn)。 關鍵詞:半整數(shù),可控分頻器,VHDL, FPGA
上傳時間: 2015-11-27
上傳用戶:tyler
資源簡介:由VHDL 語言實現(xiàn)的數(shù)控分頻 利用的是QUARTUES環(huán)境已經(jīng)得到驗證
上傳時間: 2014-01-12
上傳用戶:teddysha
資源簡介:對任意始終進行精確的5分頻處理,而且沒有毛刺,效果很好.
上傳時間: 2013-12-22
上傳用戶:watch100
資源簡介:用最少的CPLD資源,用Verilog在QuartusII7.1上實現(xiàn)的1280分頻.
上傳時間: 2016-03-18
上傳用戶:253189838
資源簡介:用VHDL硬件描述語言實現(xiàn)的良好運行的三分頻電路
上傳時間: 2014-06-29
上傳用戶:龍飛艇
資源簡介:華為的小數(shù)分頻專利 PDF文檔 里面的內(nèi)容比較詳細 分析了當前的小數(shù)分頻方法以及專利小數(shù)分頻方法的實現(xiàn)算法以及步驟
上傳時間: 2016-07-31
上傳用戶:qunquan
資源簡介:以C語言來實現(xiàn)DPSK(差分頻移鍵控)的調(diào)制與解調(diào)
上傳時間: 2013-12-27
上傳用戶:wsf950131
資源簡介:實用的任意時鐘分頻Verilog代碼 可以任意分頻的!
上傳時間: 2016-12-27
上傳用戶:watch100