數(shù)控分頻器的輸出信號頻率為輸入數(shù)據(jù)的函數(shù)。用傳統(tǒng)的方法設計,其設計過程和電路都比較復雜,且設計成 果的可修改性和可移植性都較差。基于VHDL 的數(shù)控分頻器設計,整個過程簡單、快捷,極易修改,可移植性強。他可利用 并行預置數(shù)的加法計數(shù)器和減法計數(shù)器實現(xiàn)。廣泛應用于電子儀器、樂器等數(shù)字電子系統(tǒng)中。
資源簡介:數(shù)控分頻器的輸出信號頻率為輸入數(shù)據(jù)的函數(shù)。用傳統(tǒng)的方法設計,其設計過程和電路都比較復雜,且設計成 果的可修改性和可移植性都較差。基于VHDL 的數(shù)控分頻器設計,整個過程簡單、快捷,極易修改,可移植性強。他可利用 并行預置數(shù)的加法計數(shù)器和減法計數(shù)器實現(xiàn)...
上傳時間: 2014-11-29
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資源簡介:介紹了基于VHDL的可編程分頻器在波形發(fā)生器中的應用的方法,利用這一方法, 可使波形頻率在大范圍內(nèi)變化。
上傳時間: 2014-01-08
上傳用戶:秦莞爾w
資源簡介:基于VHDL的數(shù)控分頻器設計的源代碼及仿真
上傳時間: 2016-02-11
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資源簡介:能用單片機控制DDS芯片實現(xiàn)對輸出信號頻率/相位的調(diào)節(jié),并具有調(diào)頻、點頻、掃頻等工作模式,并可以通過液晶顯示
上傳時間: 2014-01-26
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資源簡介:能用單片機控制DDS芯片實現(xiàn)對輸出信號頻率/相位的調(diào)節(jié),并具有調(diào)頻、點頻、掃頻等工作模式,并可以通過液晶顯示
上傳時間: 2013-12-22
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資源簡介:能用單片機控制DDS芯片實現(xiàn)對輸出信號頻率/相位的調(diào)節(jié),并具有調(diào)頻、點頻、掃頻等工作模式,并可以通過液晶顯示
上傳時間: 2013-11-29
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資源簡介:能用單片機控制DDS芯片實現(xiàn)對輸出信號頻率/相位的調(diào)節(jié),并具有調(diào)頻、點頻、掃頻等工作模式,并可以通過液晶顯示
上傳時間: 2016-11-26
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資源簡介:能用單片機控制DDS芯片實現(xiàn)對輸出信號頻率/相位的調(diào)節(jié),并具有調(diào)頻、點頻、掃頻等工作模式,并可以通過液晶顯示
上傳時間: 2013-12-10
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資源簡介:UART是一種廣泛應用于短距離、低速、低成本通信的串行傳輸接口.由于常用UART芯片比較復雜且移植性差,提出一種采用可編程器件FPGA實現(xiàn)UART的方法, 實現(xiàn)了對UART的模塊化設計.首先簡要介紹UART的基本特點,然后依據(jù)其系統(tǒng)組成設計頂層模塊,再采用有限狀態(tài)機設計...
上傳時間: 2013-12-01
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資源簡介:基于VHDL的分頻器設計,這是源碼希望對大家有用。
上傳時間: 2014-01-25
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資源簡介:EDA常用計數(shù)函數(shù)VHDL程序設計,基于VHDL的交通燈設計實例&分頻器
上傳時間: 2013-12-23
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資源簡介:如何設計和制造最佳的或最優(yōu)的濾波器。最佳濾波器是指能夠根據(jù)某一最佳準則進行濾波的濾波器。 維納濾波器最小均方誤差準則 (濾波器的輸出信號與需要信號之差的均方值最小) 最大輸出信噪比準則最佳濾波器最小二乘準則最佳濾波器統(tǒng)計檢測準則最佳濾...
上傳時間: 2016-05-20
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資源簡介:rc5 c語言源代碼。可修改性強。適合學習調(diào)試使用~
上傳時間: 2016-10-04
上傳用戶:sssl
資源簡介:基于VHDL的分頻器設計,分頻器在數(shù)字系統(tǒng)設計中應用頻繁
上傳時間: 2017-03-31
上傳用戶:腳趾頭
資源簡介:如今電力電子電路的控制旨在實現(xiàn)高頻開關的計算機控制,并向著更高頻率、更低損耗和全數(shù)字化的方向發(fā)展。現(xiàn)場可編程門陣列器件(Field Programmable Gate Arrays)是近年來嶄露頭角的一類新型集成電路,它具有簡潔、經(jīng)濟、高速度、低功耗等優(yōu)勢,又具有全集成化...
上傳時間: 2013-07-05
上傳用戶:duoshen1989
資源簡介:http://www.edacn.net/cgi-bin/forums.cgi?forum=7&topic=9127下,則R3~R0的輸出信號中會有一個為1,但我們還是是無法確定哪一個鍵被按下,必須要從R3 ~R0 的輸出信號與C3~C0的掃描信號共同決定那個按鍵被按下. 編寫VHDL的構思: 外部接口包括: a. INPUT腳 ...
上傳時間: 2015-04-09
上傳用戶:zm7516678
資源簡介:利用duffing振子檢測微弱信號頻率的matlab程序。可以檢測與周期策動力頻率相差0.03之內(nèi)的微弱信號頻率。信噪比達到-68db
上傳時間: 2013-12-31
上傳用戶:Breathe0125
資源簡介:UART 處理的是并行數(shù)據(jù)轉換為串行信號和串行信號轉換為并行數(shù)據(jù)。現(xiàn)有的時鐘不精確,這就需要用一個遠高于波特率的本地時鐘信號對輸入信號不斷采樣,以不斷讓接收器與發(fā)送器保持同步。
上傳時間: 2014-09-03
上傳用戶:xcy122677
資源簡介:基于VHDL的搶答器程序,包含完整的源代碼,鎖腳文件以及下載文件,可直接下載使用
上傳時間: 2013-12-12
上傳用戶:cc1
資源簡介:輸入數(shù)據(jù),產(chǎn)生的sin信號,其中含有噪聲數(shù)據(jù),可用于S/N的計算
上傳時間: 2013-12-20
上傳用戶:xg262122
資源簡介:產(chǎn)生編碼解碼時使用的clk_1以及頻率為它31倍的clk_31信號。 //產(chǎn)生M序列的發(fā)送信號indata(隨機),并且將接收到的解碼信號(decode)進行比較。 //發(fā)送的頭10個信號為1,第11個為0,在解碼的開始時期進行同步判斷時用到。
上傳時間: 2014-01-10
上傳用戶:gonuiln
資源簡介:介紹基于VHDL的微型打印機控制器的設計。論述了微型打印機的基本原理,以及實現(xiàn)控制器的VHDL語言設計。打印機的數(shù)據(jù)來自系統(tǒng)中的存儲模塊,根據(jù)需要控制打印。該微型打印機控制器可取代傳統(tǒng)的微型打印機,且抗干擾性好,可靠性高,具有較強的移植性,稍加改動就...
上傳時間: 2013-11-03
上傳用戶:dudu1210004
資源簡介:1 本程序為DSK板的初始化過程。 2.當DSP的主時鐘頻率為50MHz時,計算鎖定時間定時器PLLCOUNT的值,并修改相關程序。 3.將主時鐘的頻率分別設置為50MHz、20MHz、10MHz、5MHz,通過觀察LED指示燈的閃動頻率來驗證程序運行是否正確。
上傳時間: 2015-06-02
上傳用戶:epson850
資源簡介:一個基于VHDL的有效位為8位的頻率計,可以精確測量輸入信號的頻率
上傳時間: 2014-01-25
上傳用戶:yuzsu
資源簡介: 基于VHDL的FPGA和Nios II 實例精煉【作者:劉福奇;出版社:北京航空航天大學出版社】(本書優(yōu)酷視頻地址:http://www.youku.com/playlist_show/id_5882081.html) 內(nèi)容簡介:本書分為4個部分:Quartus Ⅱ軟件的基本操作、VHDL語法介紹、FPGA設計實...
上傳時間: 2014-07-10
上傳用戶:米米陽123
資源簡介:基于VHDL的串行異步通信電路的設計 包括串行發(fā)送器,異步接收器,以及控制器 VHDL
上傳時間: 2013-12-10
上傳用戶:牛布牛
資源簡介:圖書館管理系統(tǒng) 1、程序的輸入:只需按系統(tǒng)提示輸入整型數(shù)字或英文字母即可。每次數(shù)據(jù)的輸入均以回車 符作為結束標志。 2、程序的輸出:每一項數(shù)據(jù)輸出均有漢字的提示,輸出格式均為整型或字符串。 3、程序的系統(tǒng)功能: (1)、圖書庫系統(tǒng)管理; (2)、借...
上傳時間: 2015-11-18
上傳用戶:頂?shù)弥?/p>
資源簡介:1、程序的輸入:只需按系統(tǒng)提示輸入整型數(shù)字或英文字母即可。每次數(shù)據(jù)的輸入均以回車 符作為結束標志。 2、程序的輸出:每一項數(shù)據(jù)輸出均有漢字的提示,輸出格式均為整型或字符串。 3、程序的系統(tǒng)功能: (1)、圖書庫系統(tǒng)管理; (2)、借閱者信息的管理; ...
上傳時間: 2015-11-18
上傳用戶:busterman
資源簡介:基于VHDL的FSK信號的調(diào)制與解調(diào)算法實現(xiàn)
上傳時間: 2016-01-06
上傳用戶:zukfu
資源簡介:基于VHDL的8位十進制頻率計的詳細設計。
上傳時間: 2016-03-19
上傳用戶:jjj0202