一.基礎(chǔ)理論
鎖相環(huán)路（Phase Locked Loop）是一個(gè)閉環(huán)的相位控制系統(tǒng)，它的輸出信號(hào)的相位能自動(dòng)跟蹤輸入信號(hào)相位。系統(tǒng)框圖如下：
當(dāng)0，（1）與0：（1）相等時(shí)，兩矢量以相同的角速度旋轉(zhuǎn)，相對(duì)位置，即夾角維持不變，通常數(shù)值又較小，這就是環(huán)路的鎖定狀態(tài)。
從輸入信號(hào)加到鎖相環(huán)路的輸入端開(kāi)始，一直到環(huán)路達(dá)到鎖定的全過(guò)程，稱(chēng)為捕獲過(guò)程。設(shè)系統(tǒng)最初進(jìn)入同步狀態(tài)[2nrtto，e，.]的時(shí)間為1。。那么從1=1，的起始狀態(tài)到達(dá)進(jìn)入同步狀態(tài)的全部過(guò)程就稱(chēng)為鎖相環(huán)路的捕獲過(guò)程。捕獲過(guò)程所需的時(shí)間T，=1，-1，稱(chēng)為捕獲時(shí)間。顯然，捕獲時(shí)間T，的大小不但與環(huán)路的參數(shù)有關(guān)，而且與起始狀態(tài)有關(guān)。
對(duì)一定的環(huán)路來(lái)說(shuō)，是否能通過(guò)捕獲而進(jìn)入同步完全取決于起始頻差8.（4）-Ao。。若Ao，超過(guò)某一范圍，環(huán)路就不能捕獲了。這個(gè)范圍的大小是鎖相環(huán)路的一個(gè)重要性能指標(biāo)，稱(chēng)為環(huán)路的捕獲帶Ao，。
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上傳時(shí)間： 2022-06-21
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資源簡(jiǎn)介：介紹了一種基于鎖頻鎖相環(huán)(FPLL)的載波跟蹤算法。頻率跟蹤模塊可以適應(yīng)較大動(dòng)態(tài)范圍的頻率變化，基于軟件的數(shù)控振蕩器(NCO)模塊可以達(dá)到極高的頻率跟蹤精度。由于有鎖頻環(huán)的頻率牽引，鎖相環(huán)路濾波器可以設(shè)計(jì)得很窄，具有很好的抑噪性能，滿(mǎn)足精確跟蹤載波相...
上傳時(shí)間： 2014-01-23
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資源簡(jiǎn)介：pll 的64倍頻 鎖相環(huán)技術(shù)用 實(shí)現(xiàn)倍頻 從而達(dá)到對(duì)頻率的分頻
上傳時(shí)間： 2017-01-03
上傳用戶(hù)：yd19890720
資源簡(jiǎn)介：AT89C2051+MC44817鎖相環(huán)電路CATV射頻調(diào)制器匯編源代碼。
上傳時(shí)間： 2013-12-28
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資源簡(jiǎn)介：ad9361射頻和基帶鎖相環(huán)用戶(hù)手冊(cè)? ? ? ? ? ??
上傳時(shí)間： 2022-04-05
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資源簡(jiǎn)介：關(guān)于在FPGA或CPLD鎖相環(huán)PLL原理與應(yīng)用,介紹用FPGA的分頻技術(shù).
上傳時(shí)間： 2016-05-12
上傳用戶(hù)：edisonfather
資源簡(jiǎn)介：分頻器是FPGA設(shè)計(jì)中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計(jì)中還廣泛使用集成鎖相環(huán)(如altera的PLL，Xilinx的DLL)來(lái)進(jìn)行時(shí)鐘的分頻、倍頻以及相移設(shè)計(jì)，但是，對(duì)于時(shí)鐘要求不太嚴(yán)格的設(shè)計(jì)，通過(guò)自主設(shè)計(jì)進(jìn)行時(shí)鐘分頻的實(shí)現(xiàn)方法仍然非常流行。首先...
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資源簡(jiǎn)介：MB1504鎖相環(huán)芯片的51單片機(jī)驅(qū)動(dòng)程序,可以根據(jù)需要修改合適的分頻值來(lái)完成頻率合成配置.
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資源簡(jiǎn)介：小數(shù)分頻技術(shù)解決了鎖相環(huán)頻率合成器中的頻率分辨率和轉(zhuǎn)換時(shí)間的矛盾, 但是卻引入了嚴(yán)重的相位噪聲, 傳統(tǒng)的相位補(bǔ)償方法由于對(duì)Aö D 等數(shù)字器件的要求很高并具有滯后性實(shí)現(xiàn)難度較大。$2 調(diào)制器對(duì)噪聲具有整形的功 能, 因而將多階的$2 調(diào)制器用于小數(shù)分頻...
上傳時(shí)間： 2017-01-04
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資源簡(jiǎn)介：在VHDL下實(shí)現(xiàn)鎖相環(huán)的源碼和說(shuō)明文檔.通常用于分頻或倍頻時(shí)進(jìn)行相位鎖定.
上傳時(shí)間： 2013-12-07
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資源簡(jiǎn)介：書(shū)籍頻綜和鎖相環(huán)的Matlab源代碼，對(duì)頻綜和鎖相環(huán)的設(shè)計(jì)很有幫助；
上傳時(shí)間： 2013-12-17
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資源簡(jiǎn)介：現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的發(fā)展已經(jīng)有二十多年，從最初的1200門(mén)發(fā)展到了目前數(shù)百萬(wàn)門(mén)至上千萬(wàn)門(mén)的單片F(xiàn)PGA芯片。現(xiàn)在，F(xiàn)PGA已廣泛地應(yīng)用于通信、消費(fèi)類(lèi)電子和車(chē)用電子類(lèi)等領(lǐng)域，但國(guó)內(nèi)市場(chǎng)基本上是國(guó)外品牌的天下。 在高密度FPGA中，芯片上時(shí)鐘分布質(zhì)量變的越...
上傳時(shí)間： 2013-06-10
上傳用戶(hù)：yd19890720
資源簡(jiǎn)介：在過(guò)去的十幾年間，F(xiàn)PGA取得了驚人的發(fā)展：集成度已達(dá)到1000萬(wàn)等效門(mén)、速度可達(dá)到400～500MHz。隨著FPGA的集成度不斷增大，在高密度FPGA中，芯片上時(shí)鐘的分布質(zhì)量就變得越來(lái)越重要。時(shí)鐘延時(shí)和時(shí)鐘相位偏移已成為影響系統(tǒng)性能的重要因素。現(xiàn)在，解決時(shí)鐘延時(shí)...
上傳時(shí)間： 2013-07-06
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資源簡(jiǎn)介：用ad9850激勵(lì)的鎖相環(huán)頻率合成器山東省濟(jì)南市M0P44 部隊(duì)Q04::00R 司朝良摘要! 提出了一種ad9850和ad9850相結(jié)合的頻率合成方案! 介紹了ad9850芯片ad9850的基本工作原理" 性能特點(diǎn)及引腳功能! 給出了以1!2345 作為參考信號(hào)源的鎖相環(huán)頻率合成器實(shí)例! 并對(duì)該頻率...
上傳時(shí)間： 2013-10-18
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資源簡(jiǎn)介：二階鎖相環(huán)Matlab仿真代碼，如入兩路信號(hào)和信噪比，輸出鎖相以后的信號(hào)。可以仿真初始頻差，和頻率斜升的情況
上傳時(shí)間： 2015-05-14
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上傳時(shí)間： 2014-01-04
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上傳用戶(hù)：杜瑩12345
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上傳用戶(hù)：維子哥哥
資源簡(jiǎn)介：本資源為2015全國(guó)電設(shè)E題報(bào)告——基于鎖相環(huán)的簡(jiǎn)易頻譜儀內(nèi)含原理分析方案對(duì)比及原理圖，下面是本資源的部分內(nèi)容：本系統(tǒng)采用MSP430F5529為主控器件，采用鎖相環(huán)頻率合成芯片ADF4110、三階RC低通濾波器和壓控振蕩芯片MAX2606實(shí)現(xiàn)穩(wěn)定的本振源，產(chǎn)生本征頻率在...
上傳時(shí)間： 2022-07-05
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上傳時(shí)間： 2013-07-10
上傳用戶(hù)：eeworm
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資源簡(jiǎn)介：鎖相環(huán)捕捉過(guò)程的定性分析 ppt
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