verilog testbench設(shè)計(jì)技巧和策略
資源簡(jiǎn)介：verilog testbench設(shè)計(jì)技巧和策略
上傳時(shí)間： 2013-11-01
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上傳時(shí)間： 2013-12-24
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資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)：復(fù)雜數(shù)字邏輯系統(tǒng)的verilog HDL設(shè)計(jì)技術(shù)和方法，結(jié)合DSP算法介紹verilog HdL 設(shè)計(jì)。
上傳時(shí)間： 2016-12-16
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資源簡(jiǎn)介：介紹一些非常流行的java安全設(shè)計(jì)模式和安全策略，并且含有源代碼，對(duì)java開(kāi)發(fā)者來(lái)說(shuō)，是有非常好的借鑒作用
上傳時(shí)間： 2014-01-16
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資源簡(jiǎn)介：推薦下載,verilog處理器設(shè)計(jì)實(shí)例.體現(xiàn)了結(jié)構(gòu)描述和寄存器傳輸描述的應(yīng)用
上傳時(shí)間： 2015-05-14
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資源簡(jiǎn)介：第一章 數(shù)字信號(hào)處理、計(jì)算、程序、 算法和硬線邏輯的基本概念 第二章 verilog HDL設(shè)計(jì)方法概述 第三章 verilog HDL的基本語(yǔ)法 第四章 不同抽象級(jí)別的verilog HDL模型 第五章 基本運(yùn)算邏輯和它們的verilog HDL模型 第六章 運(yùn)算和數(shù)據(jù)流動(dòng)控制邏輯
上傳時(shí)間： 2014-01-27
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資源簡(jiǎn)介：《VC程序設(shè)計(jì)技巧與實(shí)例》中的vc++源代碼 包括MSDEN集成環(huán)境、對(duì)話框和控件及進(jìn)程和線程三章內(nèi)容的源碼
上傳時(shí)間： 2013-12-17
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資源簡(jiǎn)介：VC程序設(shè)計(jì)技巧與實(shí)例（2）關(guān)于窗口和桌面系統(tǒng)、文件和系統(tǒng)操作、消息影射的原代碼
上傳時(shí)間： 2013-12-17
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資源簡(jiǎn)介：Visual.C++程序設(shè)計(jì)技巧與實(shí)例--配套光盤 第1章 C_C++基礎(chǔ) 共有四個(gè)實(shí)例 1. ex1_7用C語(yǔ)言實(shí)現(xiàn)參數(shù)個(gè)數(shù)可變的函數(shù) 2. ex1_8創(chuàng)建和訪問(wèn)環(huán)境變量 3. SortDemo各種排序算法示例 4. BinaryTree二叉排序樹(shù)相關(guān)操作示例
上傳時(shí)間： 2014-11-26
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資源簡(jiǎn)介：Visual.C++程序設(shè)計(jì)技巧與實(shí)例--配套光盤 第2章 MSDEV集成環(huán)境與VC編譯器 共1個(gè)實(shí)例 1. MyAppwizard：定制一個(gè)AppWizard 第3章 對(duì)話框和控件 本章共有15個(gè)實(shí)例： 1. RedBK 改變對(duì)話框背景顏色 2. BitmapBK為對(duì)話框設(shè)置一幅背景圖 3. DlgDemo創(chuàng)建和使...
上傳時(shí)間： 2014-05-27
上傳用戶：yzy6007
資源簡(jiǎn)介：Visual.C++程序設(shè)計(jì)技巧與實(shí)例--配套光盤 第4章 進(jìn)程和線程 本章共有8個(gè)實(shí)例： 1. Process創(chuàng)建和終止進(jìn)程 2. WorkerThread創(chuàng)建工作者線程 3. UIThread用戶界面線程示例 4. Event使用事件對(duì)象來(lái)實(shí)現(xiàn)線程的同步 5. Thread使用臨界區(qū)對(duì)象來(lái)實(shí)現(xiàn)線程的同步...
上傳時(shí)間： 2014-11-17
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資源簡(jiǎn)介：Visual.C++程序設(shè)計(jì)技巧與實(shí)例--配套光盤 第6章 文件和系統(tǒng)操作 本章共11個(gè)實(shí)例： 1. FolderCopy文件夾的選擇和拷貝 2. DeleteCertainFile刪除指定路徑下的某種類型的文件 3. FileModiNotify當(dāng)文檔(文件)被修改時(shí)在標(biāo)題上給出提醒 4. OpenHtm打開(kāi)Html網(wǎng)...
上傳時(shí)間： 2013-12-04
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資源簡(jiǎn)介：Visual.C++程序設(shè)計(jì)技巧與實(shí)例--配套光盤 第7章 窗口和桌面系統(tǒng) 本章共14個(gè)實(shí)例： 1. NotMoveResize創(chuàng)建不能改變大小也不能移動(dòng)的窗體 2. DockToolbar將兩個(gè)工具條擺在一排 3. RemoveUntitle去除MFC APPWIZARD生成工程標(biāo)題中的"Untitled-MyApp" 4. Rest...
上傳時(shí)間： 2015-10-20
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資源簡(jiǎn)介：Visual.C++程序設(shè)計(jì)技巧與實(shí)例--配套光盤 第13章 網(wǎng)絡(luò)編程 本章共有8個(gè)實(shí)例： 1. PowerNetConfig在Win2000系統(tǒng)下修改主機(jī)名、IP、網(wǎng)關(guān)、子網(wǎng)掩碼和代理服務(wù)器 2. GetAllIP得到多穴主機(jī)的多個(gè)IP地址 3. EnumHosts枚舉局域網(wǎng)內(nèi)的計(jì)算機(jī) 4. GetMac讀取網(wǎng)卡...
上傳時(shí)間： 2014-12-07
上傳用戶：jhksyghr
資源簡(jiǎn)介：本書(shū)是一本verilog語(yǔ)言設(shè)計(jì)和綜合手冊(cè),對(duì)學(xué)習(xí)verilog語(yǔ)言有很大作用,值得閱讀.
上傳時(shí)間： 2015-11-21
上傳用戶：hustfanenze
資源簡(jiǎn)介：電容在EMC設(shè)計(jì)中應(yīng)用技巧, 和一些注意的問(wèn)題,可以
上傳時(shí)間： 2014-01-17
上傳用戶：牛布牛
資源簡(jiǎn)介：技術(shù)性需求分析 3 一致的邏輯數(shù)據(jù) 3 優(yōu)秀的網(wǎng)絡(luò)環(huán)境適應(yīng)性 3 系統(tǒng)的兼容性 3 開(kāi)放的界面和接口 3 完備的數(shù)據(jù)存儲(chǔ)、備份管理策略 3 高度的安全性 3 技術(shù)性設(shè)計(jì)思想和原則 3 安全性 4 易操作性 4 適應(yīng)性及靈活性 4 基于組件的軟件開(kāi)發(fā) 4 數(shù)據(jù)共享 4...
上傳時(shí)間： 2014-01-21
上傳用戶：王小奇
資源簡(jiǎn)介：第一章 數(shù)字信號(hào)處理、計(jì)算、程序、算法和硬線邏輯的基本概念 第二章 verilog HDL設(shè)計(jì)方法概述 第三章 verilog HDL的基本語(yǔ)法 第四章 不同抽象級(jí)別的verilog HDL模型 第五章 基本運(yùn)算邏輯和它們的verilog HDL模型 第六章 運(yùn)算和數(shù)據(jù)流動(dòng)控制邏輯 第七章...
上傳時(shí)間： 2016-02-08
上傳用戶：ardager
資源簡(jiǎn)介：介紹了DSP設(shè)計(jì)中的一般方法和設(shè)計(jì)技巧,同時(shí)對(duì)DSP開(kāi)發(fā)過(guò)程中的一些問(wèn)題,提出了簡(jiǎn)單的解決方法.
上傳時(shí)間： 2016-06-03
上傳用戶：TF2015
資源簡(jiǎn)介：D.E.Knuth的《計(jì)算機(jī)程序設(shè)計(jì)技巧》的第三卷——《排序和查找》，分“排序”和“查找”兩章。這時(shí)無(wú)論在系統(tǒng)軟件中還是在應(yīng)用軟件中都要遇到的兩個(gè)極其重要的問(wèn)題。本卷詳細(xì)評(píng)價(jià)了在這兩方面現(xiàn)有的重要技術(shù)或算法，指出了使用各種技術(shù)的條件，理論與實(shí)踐并重...
上傳時(shí)間： 2013-12-16
上傳用戶：15736969615
資源簡(jiǎn)介：c++程序設(shè)計(jì)教材主要介紹c++程序設(shè)計(jì)的方法技巧和注意方面
上傳時(shí)間： 2016-09-20
上傳用戶：xlcky
資源簡(jiǎn)介：數(shù)據(jù)庫(kù)設(shè)計(jì)方法、規(guī)范、技巧,以及設(shè)計(jì)規(guī)范和流程的思想，值得一看
上傳時(shí)間： 2017-01-22
上傳用戶：362279997
資源簡(jiǎn)介：資料介紹Delphi中線程應(yīng)用技術(shù)和線程類的設(shè)計(jì)技巧,區(qū)分其他語(yǔ)言實(shí)現(xiàn)的線程應(yīng)用技術(shù)
上傳時(shí)間： 2017-01-28
上傳用戶：zhangjinzj
資源簡(jiǎn)介：c程序設(shè)計(jì)技巧, c入門和簡(jiǎn)單算法設(shè)計(jì)。
上傳時(shí)間： 2017-03-19
上傳用戶：zycidjl
資源簡(jiǎn)介：。整個(gè)系統(tǒng)涉及車模機(jī)械結(jié)構(gòu)調(diào)整、傳感器電路設(shè)計(jì)及信號(hào)處理、控制算法和策略優(yōu)化等多個(gè)方面。為了提高智能賽車的行駛速度和可靠性，對(duì)比了不同方 案的優(yōu)缺點(diǎn)，并結(jié)合Labview 仿真平臺(tái)進(jìn)行了大量底層和上層測(cè)試，最終確定 了現(xiàn)有的系統(tǒng)結(jié)構(gòu)和各項(xiàng)控制參數(shù)。
上傳時(shí)間： 2017-07-19
上傳用戶：zhangyigenius
資源簡(jiǎn)介：FPGA verilog HDL設(shè)計(jì)溫度傳感器ds18b20溫度讀取并通過(guò)lcd1620和8位LED數(shù)碼管顯示的QUARTUS II 12.0工程文件，包括完整的設(shè)計(jì)文件.V源碼，可以做為你的學(xué)習(xí)及設(shè)計(jì)參考。module ds18b20lcd1602display ( Clk, Rst,? ? ? DQ,? ?//18B20數(shù)據(jù)端口 Txd,? ...
上傳時(shí)間： 2022-01-30
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資源簡(jiǎn)介：日常生活的電子產(chǎn)品和子系統(tǒng)變得越來(lái)越智能，這就需要其“大腦”（硅芯片）在面對(duì)現(xiàn)實(shí)環(huán)境中多種多樣情況時(shí)，能夠?qū)Ω鞣N可能最終影響系統(tǒng)行為和性能做出可預(yù)測(cè)和期望的反應(yīng)。這時(shí)，基準(zhǔn)電壓源就出現(xiàn)在我們面前了。基準(zhǔn)電壓源是一種精密的器件，專門設(shè)計(jì)用來(lái)維...
上傳時(shí)間： 2022-07-11
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資源簡(jiǎn)介： 成功的 RF 設(shè)計(jì)必須仔細(xì)注意整個(gè)設(shè)計(jì)過(guò)程中每個(gè)步驟及每個(gè)細(xì)節(jié) 這意味著必須在設(shè)計(jì)開(kāi)始階段就要進(jìn)行徹底的 仔細(xì)的規(guī)劃 并對(duì)每個(gè)設(shè)計(jì)步驟的進(jìn)展進(jìn)行全面持續(xù)的評(píng)估 而這種細(xì)致的設(shè)計(jì)技巧正是國(guó)內(nèi)大多數(shù)電子企業(yè)文化所欠缺的 近幾年來(lái)，由于藍(lán)芽設(shè)備...
上傳時(shí)間： 2013-11-13
上傳用戶：liuwei6419
資源簡(jiǎn)介：???? 基于高速FPGA 的PCB 設(shè)計(jì)技巧 ??? 如果高速PCB 設(shè)計(jì)能夠像連接原理圖節(jié)點(diǎn)那樣簡(jiǎn)單，以及像在計(jì)算機(jī)顯示器上所看到的那樣優(yōu)美的話，那將是一件多么美好的事情。然而，除非設(shè)計(jì)師初入PCB 設(shè)計(jì)，或者是極度的幸運(yùn)，實(shí)際的PCB 設(shè)計(jì)通常不像他們所從...
上傳時(shí)間： 2013-11-02
上傳用戶：cainaifa
資源簡(jiǎn)介：PCB布線設(shè)計(jì)－模擬和數(shù)字布線的異同工程領(lǐng)域中的數(shù)字設(shè)計(jì)人員和數(shù)字電路板設(shè)計(jì)專家在不斷增加，這反映了行業(yè)的發(fā)展趨勢(shì)。盡管對(duì)數(shù)字設(shè)計(jì)的重視帶來(lái)了電子產(chǎn)品的重大發(fā)展，但仍然存在，而且還會(huì)一直存在一部分與 模擬 或現(xiàn)實(shí)環(huán)境接口的電路設(shè)計(jì)。模擬和數(shù)字領(lǐng)...
上傳時(shí)間： 2013-11-03
上傳用戶：shaojie2080
