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基于FPGA的時(shí)鐘跟蹤環(huán)路的設(shè)計(jì)

  • 資源大小:223 K
  • 上傳時(shí)間: 2015-01-02
  • 上傳用戶:toper810
  • 資源積分:2 下載積分
  • 標(biāo)      簽: FPGA 時(shí)鐘 跟蹤環(huán)路

資 源 簡(jiǎn) 介

提出了一種基于FPGA的時(shí)鐘跟蹤環(huán)路的設(shè)計(jì)方案,該方案簡(jiǎn)化了時(shí)鐘跟蹤環(huán)路的結(jié)構(gòu),降低了時(shí)鐘調(diào)整電路的復(fù)雜度。實(shí)際電路測(cè)試結(jié)果表明,該方案能夠使接收機(jī)時(shí)鐘快速準(zhǔn)確地跟蹤發(fā)射機(jī)時(shí)鐘的變化,且時(shí)鐘抖動(dòng)小、穩(wěn)準(zhǔn)度高、工作穩(wěn)定可靠。

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