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位同步

位同步是指在數(shù)據(jù)通信系統(tǒng)中,數(shù)據(jù)信號是以碼元形式逐個地發(fā)送和接收的,這要求發(fā)、收雙方的時鐘要有一個穩(wěn)定而可靠的同步關系。另外,無論是基帶傳輸還是頻帶傳輸,接收端收到的信號都可能存在一定程度的畸變和干擾。為此,接收端就必須有一個與發(fā)送端碼元定時脈沖頻率相同、相位與最佳取樣時刻一致的碼元定時脈沖序列的過程,也稱為碼元同步。對位同步的基本要求以及它的實現(xiàn)方法,與載波同步相類似。為了獲取碼元定時信號,必須先確定接收到的基帶信號中是否存在位定時的頻率分量。如果存在此頻率分量,就可用濾波器直接從中把位定時信息提取出來。而對某些本身不包含位定時信息的基帶信號(如隨機的二進制不歸零碼),則有必要在基帶信號中插入位同步的導頻信號,或者對該基帶信號進行某種碼型變換,以達到獲取位定時信息的目的。[1]
  • 基于FPGA的海事衛(wèi)星突發(fā)信號位同步檢測研究及實現(xiàn).rar

    碼元定時恢復(位同步)技術是數(shù)字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發(fā)傳輸系統(tǒng),快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數(shù)據(jù)接收系統(tǒng)為背景,研究了突發(fā)通信傳輸模式下的全數(shù)字接收機中位同步方法,并予以實現(xiàn)。 本文系統(tǒng)地論述了位同步原理,在此基礎上著重研究了位同步的系統(tǒng)結構、碼元定時恢復算法以及衡量系統(tǒng)性能的各項指標,為后續(xù)工作奠定了基礎。 首先根據(jù)衛(wèi)星系統(tǒng)突發(fā)信道傳輸?shù)奶攸c分析了傳統(tǒng)位同步方法在突發(fā)系統(tǒng)中的不足,接下來對Inmarsat系統(tǒng)的短突發(fā)R信道和長突發(fā)T信道的調(diào)制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發(fā)形式下的位同步,并在FPGA上予以實現(xiàn),效果良好。 在長突發(fā)形式下的報頭時鐘捕獲后還需要對后續(xù)數(shù)據(jù)進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現(xiàn)了插值環(huán)路的位同步算法,進行了Matlab仿真和FPGA實現(xiàn)。并在插值環(huán)路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現(xiàn)。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發(fā)信道位同步跟蹤。 論文對兩個突發(fā)信道的位同步系統(tǒng)進行了理論研究、算法設計以及硬件實現(xiàn)的全過程,滿足系統(tǒng)要求。

    標簽: FPGA 海事衛(wèi)星 信號

    上傳時間: 2013-04-24

    上傳用戶:yare

  • 海事衛(wèi)星突發(fā)信號位同步檢測

    碼元定時恢復(位同步)技術是數(shù)字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發(fā)傳輸系統(tǒng),快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數(shù)據(jù)接收系統(tǒng)為背景,研究了突發(fā)通信傳輸模式下的全數(shù)字接收機中位同步方法,并予以實現(xiàn)。 本文系統(tǒng)地論述了位同步原理,在此基礎上著重研究了位同步的系統(tǒng)結構、碼元定時恢復算法以及衡量系統(tǒng)性能的各項指標,為后續(xù)工作奠定了基礎。 首先根據(jù)衛(wèi)星系統(tǒng)突發(fā)信道傳輸?shù)奶攸c分析了傳統(tǒng)位同步方法在突發(fā)系統(tǒng)中的不足,接下來對Inmarsat系統(tǒng)的短突發(fā)R信道和長突發(fā)T信道的調(diào)制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發(fā)形式下的位同步,并在FPGA上予以實現(xiàn),效果良好。 在長突發(fā)形式下的報頭時鐘捕獲后還需要對后續(xù)數(shù)據(jù)進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現(xiàn)了插值環(huán)路的位同步算法,進行了Matlab仿真和FPGA實現(xiàn)。并在插值環(huán)路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現(xiàn)。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發(fā)信道位同步跟蹤。 論文對兩個突發(fā)信道的位同步系統(tǒng)進行了理論研究、算法設計以及硬件實現(xiàn)的全過程,滿足系統(tǒng)要求。

    標簽: 海事衛(wèi)星 信號 位同步 檢測

    上傳時間: 2013-04-24

    上傳用戶:zukfu

  • 基于FPGA的新型數(shù)據(jù)位同步時鐘提取(CDR)實現(xiàn)方法

    基于FPGA的新型數(shù)據(jù)位同步時鐘提取(CDR)實現(xiàn)方法

    標簽: FPGA CDR 數(shù)據(jù) 位同步時鐘

    上傳時間: 2013-08-28

    上傳用戶:huyahui

  • 一種可變位速率的位同步器的設計與仿真

    大部分傳統(tǒng)的位同步器是針對固定位速率遙測系統(tǒng)來設計的,這不能滿足一些可變位速率遙測接收機的需求。因此,提出一種基于FPGA實現(xiàn)的位同步器的設計,它能適應不同位速率的遙測系統(tǒng)。同時,對這種位同步器的實現(xiàn)進行了仿真,驗證其正確性和可實現(xiàn)性。

    標簽: 速率 位同步 仿真

    上傳時間: 2013-11-01

    上傳用戶:qb1993225

  • 通信中位同步的gardner算法的matlab仿真

    通信中位同步的gardner算法的matlab仿真

    標簽: gardner matlab 通信 位同步

    上傳時間: 2015-11-03

    上傳用戶:zhichenglu

  • 位同步gardner 算法的simulink仿真

    位同步gardner 算法的simulink仿真

    標簽: simulink gardner 位同步 仿真

    上傳時間: 2014-01-25

    上傳用戶:咔樂塢

  • 基于FPGA的新型數(shù)據(jù)位同步時鐘提取(CDR)實現(xiàn)方法

    基于FPGA的新型數(shù)據(jù)位同步時鐘提取(CDR)實現(xiàn)方法

    標簽: FPGA CDR 數(shù)據(jù) 位同步時鐘

    上傳時間: 2013-12-22

    上傳用戶:天涯

  • I0口驅動74LS164,8位同步移位寄存器

    I0口驅動74LS164,8位同步移位寄存器,將data_buf的數(shù)據(jù)逐位輸出到simuseri_DATA

    標簽: 164 74 LS 驅動

    上傳時間: 2014-01-25

    上傳用戶:yuanyuan123

  • 針對位同步問題

    針對位同步問題,提出了一種基于基函數(shù)分解的開環(huán)位定時估計算法。該算法首先利用基函數(shù)分解的結果進行相關運算,將本地參考信號波形和接收信號波形的定時偏差縮小到T/4以內(nèi);再根據(jù)相關運算提供的角度信息進行精確的位同步估計。該算法不需要提取載波相位信息,復雜度較低。仿真結果表明該算法具有較好的估計精度

    標簽: 位同步

    上傳時間: 2013-12-13

    上傳用戶:yangbo69

  • 微分器:利用數(shù)字鎖相環(huán)進行位同步信號提取的關鍵模塊

    微分器:利用數(shù)字鎖相環(huán)進行位同步信號提取的關鍵模塊

    標簽: 微分器 位同步 信號 數(shù)字鎖相環(huán)

    上傳時間: 2014-09-10

    上傳用戶:ccclll

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