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利用IP

  • WP362-利用設計保存功能實現可重復的結果

        FPGA 設計不再像過去一樣只是作為“膠連邏輯 (Gluelogic)”了,由于其復雜度逐年增加,通常還會集成極富挑戰性的 IP 核,如 PCI Express® 核等。新型設計中的復雜模塊即便不作任何改變也會在滿足 QoR(qualityof-result) 要求方面遇到一些困難。保留這些模塊的時序非常耗時,既讓人感到頭疼,往往還徒勞無功。設計保存流程可以幫助客戶解決這一難題,既可以讓他們滿足設計中關鍵模塊的時序要求,又能在今后重用實現的結果,從而顯著減少時序收斂過程中的運行次數。

    標簽: 362 WP 重復

    上傳時間: 2013-11-20

    上傳用戶:invtnewer

  • 擴頻通信芯片STEL-2000A的FPGA實現

    針對傳統集成電路(ASIC)功能固定、升級困難等缺點,利用FPGA實現了擴頻通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核實現NCO模塊,在下變頻模塊調用了硬核乘法器并引入CIC濾波器進行低通濾波,給出了DQPSK解調的原理和實現方法,推導出一種簡便的引入?仔/4固定相移的實現方法。采用模塊化的設計方法使用VHDL語言編寫出源程序,在Virtex-II Pro 開發板上成功實現了整個系統。測試結果表明該系統正確實現了STEL-2000A的核心功能。 Abstract:  To overcome drawbacks of ASIC such as fixed functionality and upgrade difficulty, FPGA was used to realize the core functions of STEL-2000A. This paper used the DDS IP core provided by ISE to realize the NCO module, called hard core multiplier and implemented CIC filter in the down converter, described the principle and implementation detail of the demodulation of DQPSK, and derived a simple method to introduce a fixed phase shift of ?仔/4. The VHDL source code was designed by modularity method , and the complete system was successfully implemented on Virtex-II Pro development board. Test results indicate that this system successfully realize the core function of the STEL-2000A.

    標簽: STEL 2000 FPGA 擴頻通信

    上傳時間: 2013-11-19

    上傳用戶:neu_liyan

  • UG157 LogiCORE IP Initiator/Ta

    UG157 - LogiCORE™ IP Initiator/Target v3.1 for PCI™ 入門指南

    標簽: Initiator LogiCORE 157 UG

    上傳時間: 2013-10-13

    上傳用戶:heheh

  • 利用C API實現基于RTX實時仿真系統的在線調參

    介紹了基于Matlab/RTW(Real-time Workshop)和RTX(Real-time extension)構建實時仿真系統的方法;針對基于RTX的實時仿真系統不能直接進行在線調參的不足,提出了一種利用C API(C文件應用程序接口)實現在線調參的方法。經過實驗證明,此仿真系統不僅具有很強的實時性,并且擁有良好的人機交互能力;另外,在線調參功能的實現使仿真試驗的效率得到了大大的提高,而且還可以作為一種故障注入方法來考察模型的容錯能力,是基于RTX實時仿真系統的一大改良。

    標簽: API RTX 實時仿真系統

    上傳時間: 2014-03-20

    上傳用戶:lizhizheng88

  • 基于嵌入式機器視覺控制系統的研究

      論文以Altera公司的Cyclone II系列EP2CSQ208為核心芯片,構建基于FPGA的SOPC嵌入式硬件平臺,并以此平臺為基礎深入研究SOPC嵌入式系統的硬件設計和軟件開發方法,詳細測試和驗證系統存儲模塊和外圍模塊。同時以嵌入式處理器IP核NioslI為核心,設計出基于NioslI的視覺控制軟件。在應用中引入pc/os.II實時操作系統,介紹了實時操作系統I_tc/OS.II的相關概念和移植方法,設計了相關底層軟件及軌跡圖像識別算法,將具體應用程序劃分成多個任務,最終實現了視覺圖像的實時處理及小車的實時控制。   在本設計中,圖像采集部分利用SAA7111A視頻解碼芯片完成視頻信號的采集,利用FPGA完成復雜高速的邏輯控制及時序設計,將采集的數字視頻信號存儲在外擴存儲器SRAM中,以供后續圖像處理。   在構建NioslI CPU時,自定制了SRAM控制器、irda紅外接口、OC i2c接口、PWM接口和VGA顯示接口等相關外設組件,提供了必要的人機及控制接口,方便系統的控制及調試。

    標簽: 嵌入式機器視覺 控制系統

    上傳時間: 2013-11-13

    上傳用戶:chenhr

  • 基于相位編碼體制的電離層垂測儀系統設計

    該文介紹了一種電離層垂測儀的設計方法,分析了發射信號的選擇要求,給出了實際電路模塊。系統利用FPGA的 IP核DDS產生正弦載波信號,經巴克碼調相后,通過DAC和功放產生發射信號;接收機采用射頻開關和直接ADC采樣技術采集回波信號,避免了模擬正交解調時相位不平衡產生的問題。通過外場實驗驗證,表明該設計是切實可行,具有較好的實用價值。

    標簽: 相位編碼 電離層 垂測儀 系統設計

    上傳時間: 2013-10-26

    上傳用戶:tdyoung

  • 利用2400系列數字源表對二極管生產進行測試

      這個應用筆記說明如何利用可以作為電流/電壓源并測量電流和電壓的單一儀器來配置生產測試系統。2400系列數字源表就可以提供這種能力,它包括2400型數字源表、2410型高壓數字源表以及2420型大電流數字源表。本文還對二極管三個主要參數測試進行了說明,并對測試系統和IEEE-488總線操作進行了介紹。

    標簽: 2400 數字源表 二極管 測試

    上傳時間: 2013-11-24

    上傳用戶:eastimage

  • 如何仿真IP核(建立modelsim仿真庫完整解析)

      IP核生成文件:(Xilinx/Altera 同)   IP核生成器生成 ip 后有兩個文件對我們比較有用,假設生成了一個 asyn_fifo 的核,則asyn_fifo.veo 給出了例化該核方式(或者在 Edit-》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式)。asyn_fifo.v 是該核的行為模型,主要調用了 xilinx 行為模型庫的模塊,仿真時該文件也要加入工程。(在 ISE中點中該核,在對應的 processes 窗口中運行“ View Verilog Functional Model ”即可查看該 .v 文件)。如下圖所示。

    標簽: modelsim 仿真 IP核 仿真庫

    上傳時間: 2013-11-02

    上傳用戶:誰偷了我的麥兜

  • 訪問TCP/IP協議棧的vxd例子

    訪問TCP/IP協議棧的vxd例子

    標簽: TCP vxd IP 訪問

    上傳時間: 2015-01-03

    上傳用戶:chenjjer

  • 利用IE接口分析HTML文件

    利用IE接口分析HTML文件

    標簽: HTML 接口分析

    上傳時間: 2014-01-01

    上傳用戶:kr770906

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