本書是《單片機應用程序設計技術》（修訂版）一書的姐妹篇。《單片機應用程序設計技術》的內容以程序設計的經驗和技巧為主，而本書內容則以程序設計的基本算法為主，目的在于全面提高單片機程序設計者的軟件素質。基本內容包括：單片機常用的線性數據結構和相關算法、排序和查找算法、樹和圖在單片機中的實現、常用的數據處理算法及常用編碼方法等。從單片機系統的實際硬件環境出發，語言通俗易懂，使讀者輕松地將單片機程序設計基本算法學到手。為加強學習效果和增加實用價值，本書配套了上機學習光盤，在光盤中還提供了最新修訂的子程序庫和相關調試工具軟件，以及眾多單片機資料。 本書可作為電子技術人員自學單片機程序設計基本算法的教材，也可供高等院校電子技術類專業本科生和研究生參考。
上傳時間： 2013-07-17
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專輯類-國標類相關專輯-313冊-701M GB-T-12560-1990-半導體器件-分立器件分規范-可供認證用-.pdf
上傳時間： 2013-06-12
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本文對永磁無刷直流電機恒功率弱磁研究進行了較為全面的從仿真到實驗、從理論到實踐的深入研究,同時對傳統面貼式永磁無刷直流電機和復合轉子結構的永磁無刷直流電機進行了詳盡地理論分析,系統地提出了關于復合轉子結構永磁無刷直流電機一套較為完善的理論.本文首先從BLDCM的導通規律和繞組結構入手,真實模擬了傳統面貼式永磁無刷直流電機弱磁調速的物理過程,并獲得其在恒轉矩和恒功率模式下的解析表達式.從而直觀的反映了BLDCM的弱磁機理,獲得了影響其恒功率速度范圍的關鍵參數.借鑒復合轉子結構在永磁同步電機恒功率弱磁中的成功運用,將這種結構引入永磁無刷直流電機中,并完成了兩臺不同磁阻形式和功率、電壓等級的原型樣機的研制.針對原有d、q軸法的局限性,提出了真實模擬永磁無刷直流電機導電方式的場路結合法實現對永磁無刷直流電機的弱磁分析.在場路結合法分析的基礎上,提出了磁阻段提高恒功率速度范圍的真實原因,并進一步提出了采用永磁段、磁阻段雙d軸錯角以擴大轉速范圍的新思想,并在實踐中驗證了這種雙軸空間錯角技術的有效性.從而為復合轉子結構永磁電機運行性能優化提供了新的可供選擇的調節手段.
上傳時間： 2013-08-02
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TPMS是輪胎壓力監視系統“TirePressureMonitoringSystem”的英文縮寫形式，主要用于在汽車行駛時實時的對輪胎氣壓進行自動監測，對輪胎漏氣和低氣壓進行報警，以保障行車安全，是駕車者、乘車人的生命安全保障預警系統。 在汽車的高速行駛中，輪胎故障是所有駕駛者最為擔心和最難預防的，也是突發性交通事故發生的重要原因。據統計，在國內的高速公路上，由爆胎引發的交通事故占事故總數的70％。在美國，這一比例更高達80％[1]。爆胎造成的經濟損失巨大，怎樣防止爆胎已成為安全駕駛的一個重要課題，研究表明，保持標準的車胎氣壓行駛和及時發現車胎漏氣是防止爆胎的關鍵。于是汽車輪胎氣壓監視系統TPMS(TirePressureMonitoringSystem)應運而生。 TPMS系統主要有二個部分組成：安裝在汽車輪胎里的遠程輪胎壓力監測模塊(RemoteTirePressureMonitoring)和安裝在汽車駕駛臺上的中央監視器(LCD顯示器)。遠程輪胎壓力監測模塊直接安裝在每個輪胎里測量輪胎壓力和溫度模塊，將測量得到的信號調制后通過高頻無線電波(RF)發射出去。一個TPMS系統有4個或5個(包括備用胎)RTPM模塊。中央監視器接收RTPM模塊發射的信號，將各個輪胎的壓力和溫度數據顯示在屏幕上，供駕駛者參考。如果輪胎的壓力或溫度出現異常，中央監視器根據異常情況，發出不同的報警信號，提醒駕駛者采取必要的措施；同時駕駛員可以根據實際情況設定溫度和壓力報警上下限。 隨著中國經濟的持續發展，汽車越來越多地進入普通家庭，對汽車安全性能的要求越來越高，因此、研究高性能、高可靠性的汽車輪胎壓力檢測系統有著十分重要的現實意義。
上傳時間： 2013-06-06
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長期以來，小電流接地系統單相接地的故障選線和定位問題一直沒能很好的解決，由于系統故障信號微弱，易受到各種干擾的影響，同時故障條件、運行方式的可變性，使得信號特征也不一樣，因此已經提出并在實踐中取得應用的一些方法都存在著一定的缺陷，無法適應多變的故障情況。本文在了解國內外配電網故障選線研究工作的基礎上，對各種選線方法進行了歸納總結，并對存在的問題實質進行了深入分析。本文采用小波變換分析了單相接地故障時系統暫態電流分量的分布特征，討論了通過數據融合技術把多種選線方法融合，從而為小電流接地系統單相接地故障選線提供了一條新的路徑。
上傳時間： 2013-07-01
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現場可編程門陣列(FPGA，Field Programmable Gate Array)是可編程邏輯器件的一種，它的出現是隨著微電子技術的發展，設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC，Application Specific Integrated Circuit)．芯片，而且希望ASIC的設計周期盡可能短，最好是在實驗室里就能設計出合適的ASIC芯片，并且立即投入實際應用之中。現在，FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一，它的主要作用是提供封裝引腳到CLB之間的接口，將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路，并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能，在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言，可選的I/O資源的特性包括：IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現，該課題是成都華微電子系統有限公司FPGA大項目中的一子項，目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊；同時針對以前設計的I/O模塊不支持雙端標準的缺點，要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路，與單端標準比較，LVDS具有很多優點： (1)LVDS傳輸的信號擺幅小，從而功耗低，一般差分線上電流不超過4mA，負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小，從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化，單端信號擺幅為400mV，這樣允許輸入共模電壓從0.2V到2.2V范圍內變化，也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝，輔助Xilinx公司FPGA開發軟件ISE，設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構，它有靈活的可配置性和出色的適應能力，能支持大量的I/O標準，其中包括單端標準，也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征，這些特點可以改進和簡化系統級的設計，為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證，性能參數已達到預期標準。
上傳時間： 2013-05-15
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工業生產過程往往具有非線性、不確定性，難以建立精確的數學模型。應用常規的PID控制器難以達到理想的控制效果。作為的重要分支，人工神經網絡具有良好的非線性映射能力和高度的并行信息處理能力，已成為非線性系統建模、辨識和控制中常用的理論和方法。其中，神經元具有很強的信息綜合、學習記憶、自學習和自適應能力，可以處理那些難以用模型和規則描述的過程，將神經元與PID結合，應用到實際的控制中，可以在線調整PID的參數，使系統具有較強的抗干擾能力、自適應能力和較好的魯棒性。 目前，人工神經網絡的研究主要是神經網絡的理論研究、神經網絡的應用研究和神經網絡的實現技術研究，這三方面是相互依賴和相互促進的關系。本文主要側重的是神經網絡的實現技術研究方面，創新性地利用FPGA嵌入式系統開發技術實現單神經元PID智能控制器的研究與設計，并將其封裝成為一個專用的IP核供其他的控制系統使用。 首先，對單神經元PID智能控制器的設計原理和設計算法進行了深入的研究與分析；其次，利用MATLAB設計單神經元PID智能控制器，針對特定的被控對象，對其進行仿真實驗，獲得比較理想的系統輸出；然后，研究基于FPGA的單神經元智能控制算法的實現，對控制器進行VHDL語言分層設計，使用Altera公司的軟件QuartusⅡ6.1進行仿真實驗。兩個仿真實驗結果表明，基于FPGA的單神經元智能控制器比MATLAB設計的單神經元PID智能控制器性能優良。 本文的設計模塊主要包括權值修改模塊、誤差計算模塊、權值產生模塊和輸出模塊。在各個模塊的設計中進行了優化處理，使本文的設計不僅利用的硬件資源少，而且也有很快的運行速度，同時也改善了傳統控制器的控制性能。
上傳時間： 2013-04-24
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當前，在系統級互連設計中高速串行I/O技術迅速取代傳統的并行I/O技術正成為業界趨勢。人們已經意識到串行I/O“潮流”是不可避免的，因為在高于1Gbps的速度下，并行I/O方案已經達到了物理極限，不能再提供可靠和經濟的信號同步方法。基于串行I/O的設計帶來許多傳統并行方法所無法提供的優點，包括：更少的器件引腳、更低的電路板空間要求、減少印刷電路板（PCB）層數、PCB布局布線更容易、接頭更小、EMI更少，而且抵抗噪聲的能力也更好。高速串行I/O技術正被越來越廣泛地應用于各種系統設計中，包括PC、消費電子、海量存儲、服務器、通信網絡、工業計算和控制、測試設備等。迄今業界已經發展出了多種串行系統接口標準，如PCI Express、串行RapidIO、InfiniBand、千兆以太網、10G以太網XAUI、串行ATA等等。 Aurora協議是為私有上層協議或標準上層協議提供透明接口的串行互連協議，它允許任何數據分組通過Aurora協議封裝并在芯片間、電路板間甚至機箱間傳輸。Aurora鏈路層協議在物理層采用千兆位串行技術，每物理通道的傳輸波特率可從622Mbps擴展到3.125Gbps。Aurora還可將1至16個物理通道綁定在一起形成一個虛擬鏈路。16個通道綁定而成的虛擬鏈路可提供50Gbps的傳輸波特率和最大40Gbps的全雙工數據傳輸速率。Aurora可優化支持范圍廣泛的應用，如太位級路由器和交換機、遠程接入交換機、HDTV廣播系統、分布式服務器和存儲子系統等需要極高數據傳輸速率的應用。 傳統的標準背板如VME總線和CompactPCI總線都是采用并行總線方式。然而對帶寬需求的不斷增加使新興的高速串行總線背板正在逐漸取代傳統的并行總線背板。現在，高速串行背板速率普遍從622Mbps到3.125Gbps，甚至超過10Gbps。AdvancedTCA（先進電信計算架構）正是在這種背景下作為新一代的標準背板平臺被提出并得到快速的發展。它由PCI工業計算機制造商協會（PICMG）開發，其主要目的是定義一種開放的通信和計算架構，使它們能被方便而迅速地集成，滿足高性能系統業務的要求。ATCA作為標準串行總線結構，支持高速互聯、不同背板拓撲、高信號密度、標準機械與電氣特性、足夠步線長度等特性，滿足當前和未來高系統帶寬的要求。 采用FPGA設計高速串行接口將為設計帶來巨大的靈活性和可擴展能力。Xilinx Virtex-IIPro系列FPGA芯片內置了最多24個RocketIO收發器，提供從622Mbps到3.125Gbps的數據速率并支持所有新興的高速串行I/O接口標準。結合其強大的邏輯處理能力、豐富的IP核心支持和內置PowerPC處理器，為企業從并行連接向串行連接的過渡提供了一個理想的連接平臺。 本文論述了采用Xilinx Virtex-IIPro FPGA設計傳輸速率為2.5Gbps的高速串行背板接口，該背板接口完全符合PICMG3.0規范。本文對串行高速通道技術的發展背景、現狀及應用進行了簡要的介紹和分析，詳細分析了所涉及到的主要技術包括線路編解碼、控制字符、逗點檢測、擾碼、時鐘校正、通道綁定、預加重等。同時對AdvancedTCA規范以及Aurora鏈路層協議進行了分析， 并在此基礎上給出了FPGA的設計方法。最后介紹了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT設計工具，可在標準ATCA機框內完成單通道速率為2.5Gbps的全網格互聯。
上傳時間： 2013-05-29
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隨著嵌入式系統的發展、嵌入式應用的不斷增長以及嵌入式系統復雜性不斷提高，嵌入式軟件的規模和復雜性也不斷提高。在目前的嵌入式系統開發中間，軟件開發占80％以上的工作量，嵌入式軟件的質量和開發周期對產品的最終質量和上市時間起到決定性的影響。因此，為了保持產品競爭力，支持用戶對嵌入式設備進行快速、高效的軟件開發，嵌入式的開發人員迫切需要更加強大的調試技術和手段來為開發復雜的嵌入式應用提供幫助；同時，強有力的嵌入式軟件開發工具也是基本的必備條件。 本文結合ARM公司RVDS集成開發環境中調試模塊組成部分Event Viewer系統的開發，實現了對通過原始數據源采集到的CoreSight跟蹤數據的完整實時解析，并最終在顯示模塊中將其包含的信息以可視化的形式直觀地展現給用戶，以供后續的程序性能分析和嵌入式軟件系統調試。研究了與本課題相關的一些技術，包括CoreSight調試體系結構、嵌入式常見調試技術、Eclipse平臺體系架構及其插件擴展點技術。在研究嵌入式集成開發環境國內外現狀及其發展趨勢的基礎上，結合Event Viewer系統的整體需求，介紹了系統的總體設計及其功能模塊劃分，并給出了系統的第三方擴展設計。討論了系統解析模塊的設計與實現。在分析CoreSight跟蹤數據解析流程的基礎上，對系統中解析模塊進行了詳細設計，并完成了基于ITM數據流的解析實現。結合系統的功能需求和解析模塊的設計，本文利用Eclipse插件擴展點機制，劃分解析模塊提供對外擴展，實現了系統向第三方產品提供商提供擴展接口的功能，第三方可以在此基礎上提供自己的解析處理。利用Eclipse View擴展點和SWT/JFace技術，實現了對跟蹤數據的前臺展示，包括Text、Event、Analog三種類型；本文著重討論了Analog展示部分的詳細設計和實現，將解析后得到的Analog數據信息以實時曲線圖的形式展現給客戶，提供對Analog數據變化趨勢的直觀描述。
標簽： ARMCoreSight 調試技術
上傳時間： 2013-04-24
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●抗線路接反功能可在線路跨接出錯時為技術員節省查找故障所消耗的大量時間； ●采用與 RS-485 相同的外引腳，無需重新設計電路板； ●總線引腳能承受 –35V 至 +40V 之間的故障，可為典型 24 Vac HVAC 電源最大限度地降低直接短路所造成的損害； ●多達 32 個節點的高輸入阻抗可在統一網絡上支持多節點，無需中繼器，從而可降低系統成本
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上傳時間： 2013-06-22
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