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如何設計

  • 基于無線射頻識別技術的智能停車場管理系統設計

    無線射頻識別技術，簡稱RFID，是一種非接觸式的自動識別技術，它通過射頻信號自動識別目標對象并獲取相關數據，識別工作無須人工干預，操作快捷方便。無線射頻識別技術是一種新技術，在智能停車場上應用極為廣泛。通過射頻識別技術，可以實現一種自動的車輛辨識系統，使得車輛的停入和駛出能在一個快速的方式下處理，實現無人、安全、自動化。本文針對無線射頻識別技術在智能停車場上的應用進行了詳細的說明，先就智能停車場的設計思想進行系統的闡述，然后重點討論了智能停車場的設計與實現過程中用到的相關模塊：管理員的登錄和注冊模塊、車輛具體信息查詢模塊、車輛的自動管理模塊和其他信息模塊等等。整個論文圍繞基于無線射頻識別技術的智能停車場如何對車輛進行管理做了大量論述。在對上述內容充分認識的基礎上，本文詳細介紹了如何設計這樣一個系統，使得在無人情形下可以對車輛進行動態的管理，尤其是對停車場注冊的車輛的停入和駛出動作的電子不停車管理。關鍵詞：無線射頻識別技術，智能停車場，車輛管理

    標簽： 無線射頻識別 智能停車場

    上傳時間： 2022-06-21

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  • 51單片機數碼管動態顯示程序.rar

    　數碼管顯示一般分靜態顯示及動態顯示兩種驅動方式，靜態顯示占用口線比較多，本文介紹的是如何實現數碼管動態顯示，應該說數碼管動態顯示是單片機外部指令輸出的重要途徑，因此如何設計數碼管以及數碼管的工作原理、數碼管顯示的方法、數碼管顯示的抗干擾設計等在單片機系統設計中占有重要地位。這個例子在系統硬件的基礎上設計了軟件查詢程序、軟件延時程序（防止干擾），大致講述了一種數碼管動態顯示的工作原理與讀取方式。

    標簽： 51單片機 數碼管 動態顯示

    上傳時間： 2013-06-05

    上傳用戶：元宵漢堡包

  • 高級PCBEMC培訓教材

    PCB如何設計往往是EMC通過的關鍵，EMC試驗的費用又極其的高，這里一份好東西供大家分享

    標簽： PCBEMC 培訓教材

    上傳時間： 2013-07-27

    上傳用戶：ISRING001

  • FPGA局部動態可重配置的研究

    FPGA作為近年來集成電路發展中最快的分支之一，有關它的研究和應用得到了迅速的發展。傳統的FPGA采用靜態配置的方法，所以在它的應用生命周期中，它的功能就不能夠再改變，除非重新配置。動態重配置系統在系統工作的過程中改變FPGA的結構，包括全局重配置和局部重配置。其中的局部動態重配置系統有著ASIC以及靜態配置FPGA無法比擬的優勢。而隨著支持局部位流配置以及動態配置的商用FPGA的推出，使對局部動態重配置系統和應用的研究有了最基本的硬件支撐條件。而Internet作為無比強大的網絡已經滲入到各種應用領域之中。 本文首先提出了一個完整的基于Internet的FPGA局部動態可重配置系統的方案。然后針對方案的各個組成部分，分別進行了描述。首先是介紹了FPGA的基本概況，包括它的發展歷史、結構、應用領域、發展趨勢等。然后介紹了對一個包含局部動態重配置模塊的FPGA系統的設計過程，包括重配置模塊的定義、設計的流程、局部位流的產生等。接下來對．FPGA的配置方法以及配置解決方案進行描述，包括幾種可選擇的配置模式，其中有一些適用于靜態配置，另外一些可以用于動態局部配置，．以及作為一個系統的配置解決方案。最后系統要求從Internet服務器上下載重配置模塊的位流并且完成對FPGA的配置，根據這個要求，我們設計了相應的嵌入式解決方案，包括如何設計一個基于VxWorks的嵌入式應用軟件實現FTP功能，并說明如何通過JTAGG或者ICAP接口由嵌入式CPU完成對FPGA的局部配置。

    標簽： FPGA 局部 動態可重配置

    上傳時間： 2013-04-24

    上傳用戶：william345

  • 用FPGA實現帶硬件浮點運算器的8051

    8051系列是至今為止最成功的單片機之一，在FPGA平臺上研究帶硬件浮點運算器的8051是對其在SoC及專用化的方向上的一次邁進。文章首先介紹了8051的基本架構，包括硬件模塊、指令系統、內存分配以及基本外設。然后講解了在設計8051時如何劃分模塊，每個模塊的功能與設計，同時也介紹了如何設計流水線來加速8051的處理速度。對于浮點運算器，文章介紹了IEEE浮點數的表示方法，包括各種特殊值的表示方法以及作用。在探討浮點運算器設計的時候首先是給出了模塊的劃分及其實現的功能，然后以生動的實例介紹了加減乘除四種浮點運算的算法。在介紹完8051與浮點運算器設計以后，文章介紹了如何將浮點運算器集成到8051上，包括硬件上的數據線接口和控制線接口，以及軟件中如何運用硬件浮點運算器。最后文章給出了此設計在ModelSim上的仿真結果以及在CyclonelIFPGA芯片上的驗證過程，可以清楚地看到，與KeilC51軟件庫的浮點運算相比，加法運算從186個時鐘周期減少到4個時鐘周期，減法運算從200個時鐘周期減少到4個時鐘周期，乘法運算從241個時鐘周期減少到4個時鐘周期，而除法則由原來的¨lO個時鐘周期減少到4個時鐘周期，可見硬件浮點運算器使8051在運算能力上有了質的提高。 筆者也在“Google”和“百度”搜索引擎上，以及“維普數據論文網’’上搜索過，都沒有發現有類似的設計，帶硬件浮點運算器的8051可謂是一次創新，希望在實際應用中能有用武之地。

    標簽： FPGA 8051 硬件 浮點運算器

    上傳時間： 2013-04-24

    上傳用戶：13081287919

  • FPGA裝箱和劃分算法研究

    隨著集成電路的設計規模越來越大，FPGA為了滿足這種設計需求，其規模也越做越大，傳統平面結構的FPGA無法滿足實際設計需求。首先是硬件設計上的很難控制，其次就是計算機軟件面臨很大挑戰，所有復雜問題全部集中到布局布線(P&R)這一步，而實際軟件處理過程中，P&R所占的時間比例是相當大的。為了緩解這種軟件和硬件的設計壓力，多層次化結構的FPGA得以采用。所謂層次化就是可配置邏輯單元內部包含多個邏輯單元(相對于傳統的單一邏輯單元)，并且內部的邏輯單元之間共享連線資源，這種結構有利于減少芯片面積和提高布通率。與此同時，FPGA的EDA設計流程也多了一步，那就是在工藝映射和布局之間增加了基本邏輯單元的裝箱步驟，該步驟既可以認為是工藝映射的后處理，也可認為是布局和布線模塊的預處理，這一步不僅需要考慮打包，還要考慮布線資源的問題。裝箱作為連接軟件前端和后端之間的橋梁，該步驟對FPGA的性能影響是相當大的。 本文通過研究和分析影響芯片步通率的各種因素，提出新的FPGA裝箱算法，可以同時減少裝箱后可配置邏輯單元(CLB)外部的線網數和外部使用的引腳數，從而達到減少布線所需的通道數。該算法和以前的算法相比較，無論從面積，還是通道數方面都有一定的改進。算法的時間復雜度仍然是線性的。與此同時本文還對FPGA的可配置邏輯單元內部連線資源做了分析，如何設計可配置邏輯單元內部的連線資源來達到即減少面積又保證芯片的步通率，同時還可以提高運行速度。 另外，本文還提出將電路分解成為多塊，分別下載到各個芯片的解決方案。以解決FPGA由于容量限制，而無法實現某些特定電路原型驗證。該算法綜合考慮影響多塊芯片性能的各個因數，采用較好的目標函數來達到較優結果。

    標簽： FPGA 劃分算法

    上傳時間： 2013-04-24

    上傳用戶：zhaoq123

  • FIFO FPGA

    異步FIFO是一種先進先出的電路，使用在需要產時數據接口的部分，用來存儲、緩沖在兩個異步時鐘之間的數據傳輸。在異步電路中，由于時鐘之間周期和相位完全獨立，因而數據的丟失概率不為零。如何設計一個高可靠性、高速的異步FIFO電路便成為一個難點。本設計介紹解決這一問題的一種方法。本設計采用VHDL語言的形式，在QuartusII的開發平臺下完成，繼而下載到FPGA中實現。

    標簽： FIFO FPGA

    上傳時間： 2013-07-30

    上傳用戶：muyehuli

  • FPGA模塊需要對GPS

    本文設計的FPGA模塊需要對GPS、便攜打印機和串口數據進行處理，將詳細介紹如何設計FPGA和不同外設之間的數據傳輸。同時，在RTL編碼中，編寫使綜合與布局布線效果更佳的代碼。

    標簽： FPGA GPS 模塊

    上傳時間： 2013-08-16

    上傳用戶：bruce5996

  • Writing Efficient Testbenches

    本文討論了如何設計有效的testbench，適合剛接觸testbench不久的用戶閱讀提高 （xilinx公司編寫）

    標簽： Testbenches Efficient Writing

    上傳時間： 2013-10-18

    上傳用戶：xiaodu1124

  • 如何設計升壓轉換器MAX17597峰值電流模式控制器

    Abstract: This application note describes how to design boost converters using the MAX17597 peakcurrent-mode controller. Boost converters can be operated in discontinuous conduction mode (DCM) orcontinuous conduction mode (CCM). This operating mode can affect the component choices, stress levelin power devices, and controller design. Formulas for calculating component values and ratingsare alsopresented.

    標簽： 17597 MAX 如何設計 升壓轉換器

    上傳時間： 2013-11-16

    上傳用戶：zcs023047

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