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時(shí)鐘產(chǎn)生電路

  • 自己現在用的CPLD下載線原理圖用74HC244芯片\r\n

    自己現在用的CPLD下載線,用74HC244芯片\r\n要注意設置下載模式

    標簽: CPLD 244 74 HC

    上傳時間: 2013-08-31

    上傳用戶:dancnc

  • <快學易用Protel99se>\r\n

    \r\n經典的Protel99se入門教程,孫輝著北京郵電大學出版社出版

    標簽: Protel 99 se

    上傳時間: 2013-09-11

    上傳用戶:Yukiseop

  • 工業監控和便攜式儀器的6通道SAR型ADC

    14 位 LTC®2351-14 是一款 1.5Msps、低功率 SAR 型 ADC,具有 6 個同時采樣差分輸入通道。它采用單 3V 工作電源,並具有 6 個獨立的采樣及保持放大器 (S/HA) 和一個 ADC。

    標簽: SAR ADC 工業監控 便攜式

    上傳時間: 2013-11-16

    上傳用戶:dbs012280

  • MT-003 了解SINAD、ENOB、SNR、THD、THD + N、SFDR,不在噪底中迷失

    用于定量表示ADC動態性能的常用指標有六個,分別是:SINAD(信納比)、ENOB(有效位 數)、SNR(信噪比)、THD(總諧波失真)、THD + N(總諧波失真加噪聲)和SFDR(無雜散動態 范圍)

    標簽: THD SINAD ENOB SFDR

    上傳時間: 2014-01-22

    上傳用戶:魚哥哥你好

  • 基于N溝道MOS管H橋驅動電路設計與制作

    基于N溝道MOS管H橋驅動電路設計與制作

    標簽: MOS N溝道 H橋驅動 電路設計

    上傳時間: 2014-08-01

    上傳用戶:1109003457

  • 采用歸零法的N進制計數器原理

    計數器是一種重要的時序邏輯電路,廣泛應用于各類數字系統中。介紹以集成計數器74LS161和74LS160為基礎,用歸零法設計N進制計數器的原理與步驟。用此方法設計了3種36進制計數器,并用Multisim10軟件進行仿真。計算機仿真結果表明設計的計數器實現了36進制計數的功能。基于集成計數器的N進制計數器設計方法簡單、可行,運用Multisim 10進行電子電路設計和仿真具有省時、低成本、高效率的優越性。

    標簽: 歸零法 N進制計數器原

    上傳時間: 2013-10-11

    上傳用戶:gtzj

  • p-n結的隧道擊穿模型研究

    在理論模型的基礎上探討了電子勢壘的形狀以及勢壘形狀隨外加電壓的變化, 并進行定量計算, 得出隧穿電壓隨雜質摻雜濃度的變化規律。所得結論與硅、鍺p-n 結實驗數據相吻合, 證明了所建立的理論模型在定量 研究p-n 結的隧道擊穿中的合理性與實用性。該理論模型對研究一般材料或器件的隧道擊穿具有重要的借鑒意義。

    標簽: p-n 隧道 擊穿 模型研究

    上傳時間: 2013-10-31

    上傳用戶:summery

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 華碩內部的PCB基本規范

    PCB LAYOUT 基本規範項次 項目 備註1 一般PCB 過板方向定義:􀀹 PCB 在SMT 生產方向為短邊過迴焊爐(Reflow), PCB 長邊為SMT 輸送帶夾持邊.􀀹 PCB 在DIP 生產方向為I/O Port 朝前過波焊爐(Wave Solder), PCB 與I/O 垂直的兩邊為DIP 輸送帶夾持邊.1.1 金手指過板方向定義:􀀹 SMT: 金手指邊與SMT 輸送帶夾持邊垂直.􀀹 DIP: 金手指邊與DIP 輸送帶夾持邊一致.2 􀀹 SMD 零件文字框外緣距SMT 輸送帶夾持邊L1 需≧150 mil.􀀹 SMD 及DIP 零件文字框外緣距板邊L2 需≧100 mil.3 PCB I/O port 板邊的螺絲孔(精靈孔)PAD 至PCB 板邊, 不得有SMD 或DIP 零件(如右圖黃色區).PAD

    標簽: PCB 華碩

    上傳時間: 2014-12-24

    上傳用戶:jokey075

  • 具集成反激式控制器的高功率PoE PD接口

    時至今日,以太網供電 (PoE) 技術仍在當今的網絡世界中不斷地普及。由供電設備 (PSE) 提供並傳輸至受電設備 (PD) 輸入端的 12.95W 功率是一種通用電源

    標簽: PoE 集成 反激式控制器 PD接口

    上傳時間: 2013-11-06

    上傳用戶:xmsmh

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