本原碼是基于Verilog HDL語言編寫的，實現(xiàn)了SPI接口設計，可以應用于FPGA,實現(xiàn)SPI協(xié)議的接口設計.在MAXII編譯成功,用Modelsim SE 6仿真成功.
標簽： Verilog HDL 語言 編寫
上傳時間： 2015-08-04
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本文件提供了用verilog HDL語言實現(xiàn)的8位超前進位加法器,充分說明了超前進位加法器和普通加法器之間的區(qū)別.
標簽： verilog 加法器 HDL 進位
上傳時間： 2013-12-17
上傳用戶：ynwbosss
verilog HDL原碼 一種簡單的同步FIFO原碼，可以被綜合
標簽： verilog FIFO HDL
上傳時間： 2013-12-28
上傳用戶：qwe1234
HDL Synthesizer and Optimizer Modeling Style Guide
標簽： Synthesizer Optimizer Modeling Guide
上傳時間： 2013-12-30
上傳用戶：ippler8
用veilog HDL編的七段譯碼顯示電路。自己做的第一個此類程序，編譯仿真通過，感覺不錯
標簽： veilog HDL 譯碼 顯示電路
上傳時間： 2014-01-25
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advanced digital design with the verilog hdl
標簽： advanced digital verilog design
上傳時間： 2013-12-15
上傳用戶：爺?shù)臍赓|
verilog HDL實現(xiàn)先進先出棧，不含測試文件
標簽： verilog HDL 棧
上傳時間： 2015-08-20
上傳用戶：rocwangdp
不錯的VHDL講義?淮淼腣HDL講義
標簽： VHDL HDL 講義
上傳時間： 2014-11-24
上傳用戶：開懷常笑
Verilog HDL是一種硬件描述語言，用于從算法級、門級到開關級的多種抽象設計層次的數(shù)字系統(tǒng)建模，想學習的這個資料對你有用。
標簽： Verilog HDL 硬件描述語言
上傳時間： 2015-09-02
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Verilog HDL硬件描述語言，徐振林編著。pdf格式。
上傳時間： 2014-12-04
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