臺灣verilog hdl硬件描述性語言，適合有基礎的人
標簽： verilog hdl 硬件 語言
上傳時間： 2014-01-09
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采用Verilog HDL硬件語言設計,實現基本的公用電話計費功能,設計完整.
標簽： Verilog HDL 硬件語言設計 電話
上傳時間： 2014-01-11
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Study of Active Queue Management Using OPNET
標簽： Management Active Study Queue
上傳時間： 2015-12-16
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A Comparison of Load-based and Queue-based Active Queue Management Algorithms
標簽： Queue-based Comparison Algorithms Load-based
上傳用戶：ruixue198909
PURPLE: Predictive Active Queue Management Utilizing Congestion Information
標簽： Information Management Congestion Predictive
上傳用戶：chens000
adder4 hdl ok in Quartus II 5.1
標簽： Quartus adder4 5.1 hdl
上傳時間： 2015-12-20
上傳用戶：caiiicc
PWM Verilog HDL原碼和底層C驅動，即測試程序，可直接使用
標簽： Verilog PWM HDL 底層
上傳時間： 2013-12-19
上傳用戶：ggwz258
Verilog HDL數字設計與綜合 夏宇聞譯（第二版）
標簽： Verilog HDL 數字設計
上傳時間： 2014-01-08
上傳用戶：凌云御清風
從算法設計到硬線邏輯的實現 Verilog HDL牛人編寫的有關經典書籍，其中包含很多例子
標簽： Verilog HDL 算法設計 書籍
上傳時間： 2013-12-03
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Verilog HDL Guide,是學習Verilog不錯的教程,是CHM格式的
標簽： Verilog Guide HDL CHM
上傳時間： 2013-12-24
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