實現簡單的UART功能,在QUARTUS4.0下編譯通過,采用VERILOG HDL編寫.
標簽： QUARTUS VERILOG UART 4.0
上傳時間： 2013-12-18
上傳用戶：hfmm633
用verilog hdl編寫的一些例程，包括加法器/減法器等等，例子較多就不一一列舉了
標簽： verilog hdl 編寫
上傳時間： 2013-12-20
上傳用戶：fhzm5658
Generic FIFO, writen in verilog hdl
標簽： Generic verilog writen FIFO
上傳時間： 2016-02-18
上傳用戶：zwei41
Design and Test_Verilog HDL——EDA先鋒工作室《設計與驗證—Verilog HDL》配書源代碼，很多使用的實例，并有說明，是學習Verilog 不可多得的好資料。
標簽： Test_Verilog HDL Verilog Design
上傳用戶：youlongjian0
active shape model的matlab代碼實現，用于圖像處理，模式識別等方面
標簽： active matlab shape model
上傳時間： 2016-02-29
上傳用戶：Divine
TestAD is an example for active directory
標簽： directory example TestAD active
上傳時間： 2013-12-24
上傳用戶：zhuyibin
數字時鐘顯示模塊,用VERILOG HDL 實現
標簽： VERILOG HDL 數字時鐘 顯示模塊
上傳時間： 2016-03-03
上傳用戶：yiwen213
基于Verilog HDL設計的多功能數字鐘，有興趣的
標簽： Verilog HDL 多功能 數字
上傳時間： 2013-11-26
上傳用戶：宋桃子
UART轉I2C的Verilog HDL代碼，由北京郵電大學《VerilogHDL設計與EDA技術基礎》教師編寫
標簽： Verilog UART I2C HDL
上傳時間： 2014-08-03
上傳用戶：zhuoying119
24C01A的Verilog HDL仿真代碼，用于I2C接口模塊的測試，由北京郵電大學《VerilogHDL設計與EDA技術基礎》教師編寫
標簽： Verilog 24C01A HDL 仿真
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