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CYCLONE

  • Altera 28nm FPGA芯片精彩剖析

    電子發(fā)燒友網(wǎng)訊： Altera公司 28nm FPGA系列芯片共包括三大系列：Stratix V、Arria V與CYCLONE V系列芯片。近日，Altera公司也正式宣布該三大系列芯片已全部開(kāi)始量產(chǎn)出貨。Altera公司憑借著其28nm FPGA芯片在性能和成本上的優(yōu)勢(shì)，未來(lái)的前景勢(shì)必?zé)o法估量。通過(guò)本文對(duì)Altera公司 28nm FPGA系列芯片的基本性能、市場(chǎng)優(yōu)勢(shì)、型號(hào)差異以及典型應(yīng)用等介紹，電子發(fā)燒友網(wǎng)小編將帶領(lǐng)大家一起來(lái)感受Altera公司28nm FPGA系列芯片的“雄韜偉略”，深入闡述如何更好地為你未來(lái)的設(shè)計(jì)選擇相應(yīng)的Altera 28nm FPGA 芯片。  

    標(biāo)簽： Altera FPGA 28 nm

    上傳時(shí)間： 2013-10-31

    上傳用戶：半熟1994

  • ALTERA公司器件介紹匯總

    　　本資料是關(guān)于Altera公司基本器件的主要介紹（主要特性、優(yōu)勢(shì)、適用配置器件、型號(hào)、引腳、下載電纜、軟件等） 　　目 錄 　　1、 MAX7000系列器件 　　2、 MAX3000A系列器件 　　3、 MAX II 系列器件 　　4、 CYCLONE系列器件 　　5、 CYCLONE II系列器件 　　6、 Stratix系列器件 　　7、 Stratix GX系列器件 　　8、 Stratix II系列器件 　　9、 HardCopy II結(jié)構(gòu)化ASIC 　　10、其它系列器件 　　11、配置器件 　　12、下載電纜 　　13、開(kāi)發(fā)軟件 　　14、IP CORE 　　15、Nios II嵌入式處理器 　　16、ALTERA開(kāi)發(fā)板 　　17、ALTERA電源選擇

    標(biāo)簽： ALTERA 器件

    上傳時(shí)間： 2013-11-04

    上傳用戶：stst

  • AN522: Implementing Bus LVDS

    This application note describes how to implement the Bus LVDS (BLVDS) interface in the supported Altera ® device families for high-performance multipoint applications. This application note also shows the performance analysis of a multipoint application with the CYCLONE III BLVDS example.

    標(biāo)簽： Implementing LVDS 522 Bus

    上傳時(shí)間： 2013-10-26

    上傳用戶：蘇蘇蘇蘇

  • fpga開(kāi)發(fā)板電路圖

    fpga開(kāi)發(fā)板電路圖有10多種fpga開(kāi)發(fā)板電路圖，供下載。 CYCLONE II EP2C20 原理圖.pdf

    標(biāo)簽： fpga 開(kāi)發(fā)板 電路圖

    上傳時(shí)間： 2013-11-04

    上傳用戶：summery

  • 基于CYCLONEIII構(gòu)成的RS編碼系統(tǒng)

    本文采用Altera公司的FPGA器件CYCLONE III系列EP3C10作為核心器件構(gòu)成了R-S（255，223）編碼系統(tǒng)；利用Quartus II 9.0作為硬件仿真平臺(tái)，用硬件描述語(yǔ)言Verilog_HDL實(shí)現(xiàn)編程，并且通過(guò)JTAG接口與EP3C10連接。R-S（Reed-Solomon）碼是一類糾錯(cuò)能力很強(qiáng)的特殊的非二進(jìn)制BCH碼，能應(yīng)對(duì)隨機(jī)性和突發(fā)性錯(cuò)誤，廣泛應(yīng)用于各種通信系統(tǒng)中和保密系統(tǒng)中。R-S（255，223）碼能夠檢測(cè)32字節(jié)長(zhǎng)度和糾錯(cuò)16字節(jié)長(zhǎng)度的連續(xù)數(shù)據(jù)錯(cuò)誤信息。

    標(biāo)簽： CYCLONEIII RS編碼

    上傳時(shí)間： 2013-10-08

    上傳用戶：yuchunhai1990

  • 基于FPGA 的低成本長(zhǎng)距離高速傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    為解決目前高速信號(hào)處理中的數(shù)據(jù)傳輸速度瓶頸以及傳輸距離的問(wèn)題，設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA 的高速數(shù)據(jù)傳輸系統(tǒng)，本系統(tǒng)借助Altera CYCLONE III FPGA 的LVDS I/O 通道產(chǎn)生LVDS 信號(hào)，穩(wěn)定地完成了數(shù)據(jù)的高速、遠(yuǎn)距離傳輸。系統(tǒng)所需的8B/10B 編解碼、數(shù)據(jù)時(shí)鐘恢復(fù)(CDR)、串/并行轉(zhuǎn)換電路、誤碼率計(jì)算模塊均在FPGA 內(nèi)利用VHDL 語(yǔ)言設(shè)計(jì)實(shí)現(xiàn)，大大降低了系統(tǒng)互聯(lián)的復(fù)雜度和成本，提高了系統(tǒng)集成度和穩(wěn)定性。

    標(biāo)簽： FPGA 高速傳輸

    上傳時(shí)間： 2013-11-25

    上傳用戶：爺?shù)臍赓|(zhì)

  • 一種混沌偽隨機(jī)序列發(fā)生器的FPGA實(shí)現(xiàn)

    隨著混沌理論應(yīng)用于產(chǎn)生偽隨機(jī)序列的發(fā)展，用現(xiàn)場(chǎng)可編程邏輯門陣列實(shí)現(xiàn)了基于TD—ERCS混沌的偽隨機(jī)序列發(fā)生器．為了便于硬件實(shí)現(xiàn)并減少硬件占用資源．對(duì)原算法(即基于TD—ERCS構(gòu)造偽隨機(jī)序列發(fā)生器的算法)進(jìn)行了適當(dāng)改進(jìn)，密鑰空間縮減到2⋯．設(shè)計(jì)采用雙精度浮點(diǎn)運(yùn)算，選用CYCLONE系列的EPIC20F400芯片。完成了CPRSG的系統(tǒng)仿真實(shí)驗(yàn)．系統(tǒng)的硬件電路占用17716個(gè)邏輯單元，占芯片資源88％，工作頻率50 MHz，EPRS產(chǎn)生速率10 Mbps．

    標(biāo)簽： FPGA 混沌 偽隨機(jī)序列 發(fā)生器

    上傳時(shí)間： 2013-11-21

    上傳用戶：許小華

  • 基于 FPGA 的 SDTV-HDTV 轉(zhuǎn)換的研究與設(shè)計(jì)

    一種采用Altera CYCLONE Ⅲ FPGA將標(biāo)準(zhǔn)清晰度電視(SDTV)轉(zhuǎn)換成高清晰度電視(HDTV)的方法.用圖像插值技術(shù),充分利用了原始圖像,實(shí)現(xiàn)視頻格式水平方向上行內(nèi)像素點(diǎn)的增加及垂直方向上行數(shù)的提升,滿足高清晰度電視格式的標(biāo)準(zhǔn)輸出.整個(gè)上變換模塊的復(fù)雜度低,易于硬件實(shí)現(xiàn),完成了專用格式轉(zhuǎn)換芯片的功能,在工程應(yīng)用中有利于提高系統(tǒng)的集成度和靈活性.

    標(biāo)簽： SDTV-HDTV FPGA 轉(zhuǎn)換

    上傳時(shí)間： 2013-11-19

    上傳用戶：jokey075

  • 基于嵌入式機(jī)器視覺(jué)控制系統(tǒng)的研究

    　　論文以Altera公司的CYCLONE II系列EP2CSQ208為核心芯片，構(gòu)建基于FPGA的SOPC嵌入式硬件平臺(tái)，并以此平臺(tái)為基礎(chǔ)深入研究SOPC嵌入式系統(tǒng)的硬件設(shè)計(jì)和軟件開(kāi)發(fā)方法，詳細(xì)測(cè)試和驗(yàn)證系統(tǒng)存儲(chǔ)模塊和外圍模塊。同時(shí)以嵌入式處理器IP核NioslI為核心，設(shè)計(jì)出基于NioslI的視覺(jué)控制軟件。在應(yīng)用中引入pc／os．II實(shí)時(shí)操作系統(tǒng)，介紹了實(shí)時(shí)操作系統(tǒng)I_tc／OS．II的相關(guān)概念和移植方法，設(shè)計(jì)了相關(guān)底層軟件及軌跡圖像識(shí)別算法，將具體應(yīng)用程序劃分成多個(gè)任務(wù)，最終實(shí)現(xiàn)了視覺(jué)圖像的實(shí)時(shí)處理及小車的實(shí)時(shí)控制。 　　在本設(shè)計(jì)中，圖像采集部分利用SAA7111A視頻解碼芯片完成視頻信號(hào)的采集，利用FPGA完成復(fù)雜高速的邏輯控制及時(shí)序設(shè)計(jì)，將采集的數(shù)字視頻信號(hào)存儲(chǔ)在外擴(kuò)存儲(chǔ)器SRAM中，以供后續(xù)圖像處理。 　　在構(gòu)建NioslI CPU時(shí)，自定制了SRAM控制器、irda紅外接口、OC i2c接口、PWM接口和VGA顯示接口等相關(guān)外設(shè)組件，提供了必要的人機(jī)及控制接口，方便系統(tǒng)的控制及調(diào)試。

    標(biāo)簽： 嵌入式機(jī)器視覺(jué) 控制系統(tǒng)

    上傳時(shí)間： 2013-11-13

    上傳用戶：chenhr

  • 利用帶有I2C總線接口的日歷時(shí)鐘芯片DS1337

    利用帶有I2C總線接口的日歷時(shí)鐘芯片DS1337，在NIOS II嵌入式系統(tǒng)平臺(tái)上實(shí)現(xiàn)一個(gè)實(shí)時(shí)時(shí)鐘，并可在顯示器上顯示出預(yù)置的時(shí)分秒。硬件平臺(tái)為Altera的CYCLONE II版Nios II開(kāi)發(fā)環(huán)境

    標(biāo)簽： 1337 I2C DS 總線接口

    上傳時(shí)間： 2013-12-19

    上傳用戶：獨(dú)孤求源

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