11,13,16位超前進位加法器的Verilog Hdl源代碼。
標(biāo)簽： Verilog Hdl 11 13
上傳時間： 2013-12-28
上傳用戶：ouyangtongze
verilog Hdl 快速入門,里面包含很多有用的硬件描述語言的程序
標(biāo)簽： verilog Hdl 快速入門 硬件描述語言
上傳時間： 2014-01-03
上傳用戶：愛死愛死
以verilog Hdl 語言編寫的一首歌曲，可供初學(xué)者借鑒
標(biāo)簽： verilog Hdl 語言 編寫
上傳時間： 2013-12-26
上傳用戶：ma1301115706
Hdl 編碼風(fēng)格與編碼指導(dǎo),介紹了詳細的vHdl和verilog Hdl語言的編程風(fēng)格
標(biāo)簽： verilog vHdl Hdl Hdl
上傳時間： 2014-01-05
上傳用戶：古谷仁美
用verlog Hdl寫的電子日歷,可以顯示年,月,日和時間,具有鬧鈴的功能
標(biāo)簽： verlog Hdl 電子日歷
上傳時間： 2015-05-12
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用Hdl語言編寫的通用fifo源碼，通過對fifo的寬度和深度進行配置，可以產(chǎn)生我們所需要的fifo，還包括fifo的測試程序和仿真Makefile腳本
標(biāo)簽： fifo Hdl 語言 編寫
上傳用戶：miaochun888
arm verilog Hdl ip core
標(biāo)簽： verilog core arm Hdl
上傳時間： 2014-01-14
上傳用戶：wang0123456789
中文版Verilog Hdl簡明教程 第1章 簡介 第2章 Hdl指南 第3章 Verilog語言要素 第4章 表 達 式 第5章 門電平模型化
標(biāo)簽： Verilog Hdl 簡明教程 電平
上傳時間： 2015-05-22
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用Verilog Hdl 語言編寫的播放梁祝的程序
標(biāo)簽： Verilog Hdl 語言 編寫
上傳時間： 2015-05-24
上傳用戶：zuozuo1215
基于地址總線接口的四倍頻編碼器信號接口的 FPGA實現(xiàn) Verilog Hdl的
標(biāo)簽： Verilog FPGA Hdl 接口
上傳時間： 2014-08-12
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