本文將電路接口技術(shù)與硬件可編程技術(shù)相結(jié)合，提出了用可編程芯片來控制IDE硬盤進(jìn)行高速數(shù)據(jù)記錄，能夠滿足機(jī)載數(shù)據(jù)記錄設(shè)備重量輕、容量大、速度快的要求。 論文對硬盤ATA接口標(biāo)準(zhǔn)進(jìn)行了研究，對VHDL語言、現(xiàn)場可編程門陣列器件(FPGA)實(shí)現(xiàn)硬件電路的原理和方法進(jìn)行了深入分析，在此基礎(chǔ)上完成了基于FPGA的數(shù)據(jù)記錄控制器的設(shè)計(jì)。文中選擇了具有低功耗、低成本、高性能的FPGA芯片(型號為CycloneEP1C3T144C8)，將各功能模塊級聯(lián)成系統(tǒng)在該芯片上完成了控制器系統(tǒng)級的設(shè)計(jì)與仿真驗(yàn)證，驗(yàn)證結(jié)果表明了用FPGA實(shí)現(xiàn)高速數(shù)據(jù)記錄控制器的可行性。所設(shè)計(jì)的VHDL代碼經(jīng)QuartusⅡ綜合、布局布線、管腳分配后，在FPGA內(nèi)部可以達(dá)到104.46Mhz的電路工作速度，F(xiàn)PGA與硬盤之間采用ATA接口的UltraDMA模式2傳輸方式，可以達(dá)到33.3MByte/s的突發(fā)數(shù)據(jù)傳輸率。文中對所用到的FPGA設(shè)計(jì)技術(shù)給予了詳細(xì)說明，對各功能模塊的設(shè)計(jì)給予了詳細(xì)闡述，對關(guān)鍵設(shè)計(jì)給出了VHDL源代碼，還討論了FPGA設(shè)計(jì)中時序約束的作用，給出了本文所做時序約束的方法。 本文中所論述的工作對以后機(jī)載數(shù)據(jù)記錄系統(tǒng)的設(shè)計(jì)具有重要的鋪墊作用。文中在總結(jié)所做工作的同時，還對下一步工作提出了有益的建議。
標(biāo)簽： FPGA 機(jī)載 高速數(shù)據(jù) 記錄系統(tǒng)
上傳時間： 2013-08-05
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當(dāng)前，在系統(tǒng)級互連設(shè)計(jì)中高速串行I/O技術(shù)迅速取代傳統(tǒng)的并行I/O技術(shù)正成為業(yè)界趨勢。人們已經(jīng)意識到串行I/O“潮流”是不可避免的，因?yàn)樵诟哂?Gbps的速度下，并行I/O方案已經(jīng)達(dá)到了物理極限，不能再提供可靠和經(jīng)濟(jì)的信號同步方法?；诖蠭/O的設(shè)計(jì)帶來許多傳統(tǒng)并行方法所無法提供的優(yōu)點(diǎn)，包括：更少的器件引腳、更低的電路板空間要求、減少印刷電路板（PCB）層數(shù)、PCB布局布線更容易、接頭更小、EMI更少，而且抵抗噪聲的能力也更好。高速串行I/O技術(shù)正被越來越廣泛地應(yīng)用于各種系統(tǒng)設(shè)計(jì)中，包括PC、消費(fèi)電子、海量存儲、服務(wù)器、通信網(wǎng)絡(luò)、工業(yè)計(jì)算和控制、測試設(shè)備等。迄今業(yè)界已經(jīng)發(fā)展出了多種串行系統(tǒng)接口標(biāo)準(zhǔn)，如PCI Express、串行RapidIO、InfiniBand、千兆以太網(wǎng)、10G以太網(wǎng)XAUI、串行ATA等等。 Aurora協(xié)議是為私有上層協(xié)議或標(biāo)準(zhǔn)上層協(xié)議提供透明接口的串行互連協(xié)議，它允許任何數(shù)據(jù)分組通過Aurora協(xié)議封裝并在芯片間、電路板間甚至機(jī)箱間傳輸。Aurora鏈路層協(xié)議在物理層采用千兆位串行技術(shù)，每物理通道的傳輸波特率可從622Mbps擴(kuò)展到3.125Gbps。Aurora還可將1至16個物理通道綁定在一起形成一個虛擬鏈路。16個通道綁定而成的虛擬鏈路可提供50Gbps的傳輸波特率和最大40Gbps的全雙工數(shù)據(jù)傳輸速率。Aurora可優(yōu)化支持范圍廣泛的應(yīng)用，如太位級路由器和交換機(jī)、遠(yuǎn)程接入交換機(jī)、HDTV廣播系統(tǒng)、分布式服務(wù)器和存儲子系統(tǒng)等需要極高數(shù)據(jù)傳輸速率的應(yīng)用。 傳統(tǒng)的標(biāo)準(zhǔn)背板如VME總線和CompactPCI總線都是采用并行總線方式。然而對帶寬需求的不斷增加使新興的高速串行總線背板正在逐漸取代傳統(tǒng)的并行總線背板?，F(xiàn)在，高速串行背板速率普遍從622Mbps到3.125Gbps，甚至超過10Gbps。AdvancedTCA（先進(jìn)電信計(jì)算架構(gòu)）正是在這種背景下作為新一代的標(biāo)準(zhǔn)背板平臺被提出并得到快速的發(fā)展。它由PCI工業(yè)計(jì)算機(jī)制造商協(xié)會（PICMG）開發(fā)，其主要目的是定義一種開放的通信和計(jì)算架構(gòu)，使它們能被方便而迅速地集成，滿足高性能系統(tǒng)業(yè)務(wù)的要求。ATCA作為標(biāo)準(zhǔn)串行總線結(jié)構(gòu)，支持高速互聯(lián)、不同背板拓?fù)?、高信號密度、?biāo)準(zhǔn)機(jī)械與電氣特性、足夠步線長度等特性，滿足當(dāng)前和未來高系統(tǒng)帶寬的要求。 采用FPGA設(shè)計(jì)高速串行接口將為設(shè)計(jì)帶來巨大的靈活性和可擴(kuò)展能力。Xilinx Virtex-IIPro系列FPGA芯片內(nèi)置了最多24個RocketIO收發(fā)器，提供從622Mbps到3.125Gbps的數(shù)據(jù)速率并支持所有新興的高速串行I/O接口標(biāo)準(zhǔn)。結(jié)合其強(qiáng)大的邏輯處理能力、豐富的IP核心支持和內(nèi)置PowerPC處理器，為企業(yè)從并行連接向串行連接的過渡提供了一個理想的連接平臺。 本文論述了采用Xilinx Virtex-IIPro FPGA設(shè)計(jì)傳輸速率為2.5Gbps的高速串行背板接口，該背板接口完全符合PICMG3.0規(guī)范。本文對串行高速通道技術(shù)的發(fā)展背景、現(xiàn)狀及應(yīng)用進(jìn)行了簡要的介紹和分析，詳細(xì)分析了所涉及到的主要技術(shù)包括線路編解碼、控制字符、逗點(diǎn)檢測、擾碼、時鐘校正、通道綁定、預(yù)加重等。同時對AdvancedTCA規(guī)范以及Aurora鏈路層協(xié)議進(jìn)行了分析， 并在此基礎(chǔ)上給出了FPGA的設(shè)計(jì)方法。最后介紹了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT設(shè)計(jì)工具，可在標(biāo)準(zhǔn)ATCA機(jī)框內(nèi)完成單通道速率為2.5Gbps的全網(wǎng)格互聯(lián)。
上傳時間： 2013-05-29
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論文根據(jù)系統(tǒng)具體控制對象將多電機(jī)獨(dú)立驅(qū)動電動車的操穩(wěn)性控制劃分為間接穩(wěn)定性控制與直接穩(wěn)定性控制兩大類，前者以優(yōu)化車輪和路面的相對運(yùn)動為目標(biāo);而后者直接以整車運(yùn)動狀態(tài)參量為調(diào)節(jié)對象.針對雙電機(jī)前輪驅(qū)動EV，提出了基于自由輪轉(zhuǎn)速信息的驅(qū)動防滑控制.分析了汽車轉(zhuǎn)向過程的差速動力學(xué)原理，在Ackermann-Jeantand轉(zhuǎn)向側(cè)幾何模型下討論了理想差速過程中車輪驅(qū)/制動轉(zhuǎn)矩變化應(yīng)滿足的條件.根據(jù)上述分析提出了一種雙模式轉(zhuǎn)矩分配電子差速器設(shè)計(jì)思路.分析了直接橫擺力偶矩的產(chǎn)生與簡化的轉(zhuǎn)矩分配方法.基于零側(cè)偏理想模型設(shè)計(jì)了雙電機(jī)EV的前饋直接橫擺力偶矩控制器并進(jìn)行數(shù)值仿真，結(jié)果顯示該方法能一定程度改善操穩(wěn)性，但控制效果受系統(tǒng)非線性影響較大.提出應(yīng)用隱模型跟蹤最優(yōu)控制理論的DYC控制策略，設(shè)計(jì)了控制器并進(jìn)行仿真計(jì)算，證明此控制方法能在降低質(zhì)心側(cè)偏的同時保證橫擺角速度響應(yīng)的穩(wěn)定、平滑、快速，并能適應(yīng)不同路面情況.通過仿真討論前驅(qū)動或后驅(qū)動布局與DYC控制效果的關(guān)系以及系統(tǒng)對汽車質(zhì)心參數(shù)變化的適應(yīng)性.設(shè)計(jì)并改裝了雙電機(jī)前輪獨(dú)立驅(qū)動試驗(yàn)車.初步試車中該車轉(zhuǎn)向與加速皆運(yùn)行良好，以此為基礎(chǔ)未來可進(jìn)行控制策略實(shí)車測試.
標(biāo)簽： 電機(jī) 獨(dú)立 控制研究 電動車
上傳時間： 2013-04-24
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美國國家半導(dǎo)體公司（National Semiconductor Corporation）宣布推出一款全新的線性均方根（RMS）射頻功率（RF）檢波器，它不但具有業(yè)界最高的精確度，而且動態(tài)范圍可高達(dá)40dB。這款型號為 PowerWise? LMH2120 的芯片擴(kuò)大了無線網(wǎng)絡(luò)的覆蓋范圍，并延長了第三代(3G)及第四代(4G)移動電話的電池壽命。
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上傳時間： 2013-05-20
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SystemView的庫資源十分豐富，包括含若干圖標(biāo)的基本庫（Main Library）及專業(yè)庫(Optional Library)，基本庫中包括多種信號源、接收器、加法器、乘法器，各種函數(shù)運(yùn)算器等；專業(yè)庫有通訊（Communication）、邏輯（Logic）、數(shù)字信號處理（DSP）、射頻/模擬（RF/Analog）等；它們特別適合于現(xiàn)代通信系統(tǒng)的設(shè)計(jì)、仿真和方案論證，尤其適合于無線電話、無繩電話、尋呼機(jī)、調(diào)制解調(diào)器、衛(wèi)星通訊等通信系統(tǒng)；并可進(jìn)行各種系統(tǒng)時域和頻域分析、譜分析，及對各種邏輯電路、射頻/模擬電路（混合器、放大器、RLC電路、運(yùn)放電路等）進(jìn)行理論分析和失真分析。 System View能自動執(zhí)行系統(tǒng)連接檢查，給出連接錯誤信息或尚懸空的待連接端信息，通知用戶連接出錯并通過顯示指出出錯的圖標(biāo)。這個特點(diǎn)對用戶系統(tǒng)的診斷是十分有效的。 System View的另一重要特點(diǎn)是它可以從各種不同角度、以不同方式，按要求設(shè)計(jì)多種濾波器，并可自動完成濾波器各指標(biāo)—如幅頻特性（伯特圖）、傳遞函數(shù)、根軌跡圖等之間的轉(zhuǎn)換。 在系統(tǒng)設(shè)計(jì)和仿真分析方面，System View還提供了一個真實(shí)而靈活的窗口用以檢查、分析系統(tǒng)波形。在窗口內(nèi)，可以通過鼠標(biāo)方便地控制內(nèi)部數(shù)據(jù)的圖形放大、縮小、滾動等。另外，分析窗中還帶有一個功能強(qiáng)大的“接收計(jì)算器”，可以完成對仿真運(yùn)行結(jié)果的各種運(yùn)算、譜分析、濾波。 System View還具有與外部文件的接口，可直接獲得并處理輸入/輸出數(shù)據(jù)。提供了與編程語言VC++或仿真工具M(jìn)atlab的接口，可以很方便的調(diào)用其函數(shù)。還具備與硬件設(shè)計(jì)的接口：與Xilinx公司的軟件Core Generator配套，可以將System View系統(tǒng)中的部分器件生成下載FPGA芯片所需的數(shù)據(jù)文件；另外，System View還有與DSP芯片設(shè)計(jì)的接口，可以將其DSP庫中的部分器件生成DSP芯片編程的C語言源代碼。
標(biāo)簽： SYSTEMVIEW 教材
上傳時間： 2013-04-24
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提出了一種基于微加速度計(jì)的無線慣性鼠標(biāo)的設(shè)計(jì)方案。該方案以微加速度計(jì)ADXL213 作為信號檢測元件,并采用低功耗處理器MSP430F135 和RF 芯片nRF401 進(jìn)行信號處
標(biāo)簽： micro-accelerometer inertial wireless Design
上傳時間： 2013-04-24
上傳用戶：AbuGe
本論文采用TOP-DOWN設(shè)計(jì)方法對PCI總線接口控制器的設(shè)計(jì)與實(shí)現(xiàn)進(jìn)行了研究,對PCI總線協(xié)議做了比較深刻的理解和分析.本論文以PCI總線接口控制器的設(shè)計(jì)和實(shí)現(xiàn)為線索,闡述了PCI總線接口控制器設(shè)計(jì)、仿真及綜合、驗(yàn)證的各個步驟,以及PCI板卡驅(qū)動程序的編寫和調(diào)試.作為PCI接口控制器下一步發(fā)展的前瞻性研究,還介紹PCI接口控制器DMA傳輸方式的實(shí)現(xiàn)思路及功能模塊劃分.在本論文的研究中,重點(diǎn)分析了PCI總線接口控制器的設(shè)計(jì)、對PCI總線協(xié)議的分析理解是進(jìn)行PCI總線接口控制器設(shè)計(jì)的前提,而對PCI總線接口控制器的功能分析和結(jié)構(gòu)劃分是設(shè)計(jì)的關(guān)鍵.本論文在對PCI總線接口控制器的功能分析和結(jié)構(gòu)分析的基礎(chǔ)上,對PCI總線接口控制器的整體設(shè)計(jì)和子模塊的劃分和實(shí)現(xiàn)進(jìn)行了詳細(xì)的分析闡述.通過本論文的研究,完成了PCI總線接口控制器的設(shè)計(jì),并且通過編寫測試激勵程序完成了功能仿真,以及布局布線后的時序仿真,并設(shè)計(jì)了PCB實(shí)驗(yàn)板進(jìn)行了測試,證明所實(shí)現(xiàn)的PCI接口控制器完成了要求的功能.
上傳時間： 2013-04-24
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隨著計(jì)算機(jī)技術(shù)和互聯(lián)網(wǎng)技術(shù)的發(fā)展，嵌入式系統(tǒng)已成為近年來新興的研究熱點(diǎn)。嵌入式系統(tǒng)的硬件核心是嵌入式微處理器，ARM處理器以其高性能、低功耗、低成本等優(yōu)點(diǎn)占領(lǐng)了嵌入式系統(tǒng)處理器的大部分市場，基于ARM的嵌入式系統(tǒng)的應(yīng)用已深入到工業(yè)控制、網(wǎng)絡(luò)通訊設(shè)備等領(lǐng)域。Linux作為功能強(qiáng)大、源碼公開的操作系統(tǒng)，在嵌入式領(lǐng)域中被廣泛應(yīng)用。 本文針對自動售貨機(jī)控制系統(tǒng)在校園一卡通系統(tǒng)中的應(yīng)用要求，以開發(fā)具有射頻卡結(jié)帳功能的新型自動售貨機(jī)控制系統(tǒng)，并與校園一卡通信息管理系統(tǒng)相連為目標(biāo)，提出了基于ARM-Linux的自動售貨機(jī)控制器總體設(shè)計(jì)方案。根據(jù)方案對自動售貨機(jī)控制系統(tǒng)進(jìn)行總體設(shè)計(jì)，在分析嵌入式軟硬件可實(shí)現(xiàn)模塊化設(shè)計(jì)的基礎(chǔ)上，采用數(shù)據(jù)處理能力強(qiáng)和能夠?qū)崿F(xiàn)數(shù)據(jù)網(wǎng)絡(luò)傳輸?shù)腍MS30C7202微處理器，對ARM處理器最小系統(tǒng)和關(guān)鍵的接口電路進(jìn)行了硬件結(jié)構(gòu)設(shè)計(jì)，系統(tǒng)擴(kuò)展有FLASH、EPROM、以太網(wǎng)接口、RS232接口、GPIO接口、USB接口等外圍電路。利用Protel軟件完成了開發(fā)板的原理圖設(shè)計(jì)、繪制以及印刷電路板布局布線工作，PCB設(shè)計(jì)以高速電路設(shè)計(jì)為準(zhǔn)則，集成了多種接口電路，完成了硬件系統(tǒng)的設(shè)計(jì)。研究了嵌入式Linux操作系統(tǒng)下的自動售貨機(jī)控制系統(tǒng)軟件環(huán)境建立方法，論述了移植Linux到ARM控制板的過程，分析了嵌入式軟件的應(yīng)用程序架構(gòu)與各部分設(shè)備驅(qū)動程序的設(shè)計(jì)方法，設(shè)計(jì)了硬件驅(qū)動程序。在嵌入式軟、硬件開發(fā)的基礎(chǔ)上，對基于ARM的嵌入式自動售貨機(jī)控制系統(tǒng)進(jìn)行實(shí)例研究和系統(tǒng)功能調(diào)試，完成了自動售貨機(jī)控制系統(tǒng)的基本功能，并使系統(tǒng)能夠基于以太網(wǎng)進(jìn)行數(shù)據(jù)通信，為進(jìn)一步的開發(fā)和應(yīng)用提供了良好的基礎(chǔ)。
上傳時間： 2013-07-05
上傳用戶：Ruzzcoy
隨著現(xiàn)代計(jì)算機(jī)技術(shù)和互聯(lián)網(wǎng)技術(shù)的飛速發(fā)展，嵌入式系統(tǒng)成為了當(dāng)前信息行業(yè)最熱門的焦點(diǎn)之一。而ARM以其高性能低功耗的特點(diǎn)成為目前應(yīng)用最廣泛的32位嵌入式處理器。在嵌入式操作系統(tǒng)方面，Linux憑借其性能優(yōu)異、結(jié)構(gòu)清晰、平臺支持廣泛、網(wǎng)絡(luò)支持強(qiáng)勁及開放源代碼等多方面的優(yōu)勢，被嵌入式系統(tǒng)開發(fā)者廣泛地采用。Linux 2.6包含許多新的特性，為其在嵌入式領(lǐng)域的應(yīng)用提供了強(qiáng)有力的支持，新的內(nèi)核越來越多地應(yīng)用于嵌入式Linux系統(tǒng)中。 本文的工作基于艾科公司研發(fā)的硬件平臺Ark1600開展。該平臺上集成了多個功能模塊，例如LCD、12S、GPIO、12C等，同時支持XD、CF、MMC、SD等多種硬件存儲設(shè)備，在設(shè)備通信方面提供了USB、串行通信等傳輸方式。本文的主要工作是研究Linux在ARM芯片上的移植，并在此基礎(chǔ)上闡述Linux設(shè)備驅(qū)動的開發(fā)。 首先構(gòu)建了交叉編譯環(huán)境，然后在分析Ark1600硬件體系結(jié)構(gòu)的基礎(chǔ)上詳細(xì)闡述了BootLoader程序設(shè)計(jì)與實(shí)現(xiàn)、Linux2.6內(nèi)核移植、Ramdisk文件系統(tǒng)移植的全過程，為后續(xù)項(xiàng)目的實(shí)施搭建了一個良好的開發(fā)平臺。論文最后闡述了Linux 2.6內(nèi)核中開發(fā)塊設(shè)備驅(qū)動程序的實(shí)現(xiàn)方法，并以XD塊設(shè)備驅(qū)動程序?yàn)槔?，詳?xì)闡述了Linux驅(qū)動程序的開發(fā)流程。 主要工作量在于BootLoader程序的設(shè)計(jì)與實(shí)現(xiàn)、Linux系統(tǒng)移植和XD塊設(shè)備驅(qū)動程序的開發(fā)。因?yàn)轫?xiàng)目平臺獨(dú)特的硬件環(huán)境，一些程序代碼要嚴(yán)格依賴硬件設(shè)備設(shè)計(jì)。在Linux移植中的主要工作包括串口控制臺的驅(qū)動、設(shè)置系統(tǒng)的存儲布局、初始化系統(tǒng)定時器、初始化系統(tǒng)中斷、在Linux系統(tǒng)中建立標(biāo)識本硬件平臺的結(jié)構(gòu)體變量、配置并編譯Linux內(nèi)核等。
標(biāo)簽： ARM 存儲卡 系統(tǒng)設(shè)計(jì)
上傳時間： 2013-05-18
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作為嵌入式系統(tǒng)核心的微處理器，是SOC不可或缺的“心臟”，微處理器的性能直接影響著整個SOC的性能。 與國際先進(jìn)技術(shù)相比，我國在這一領(lǐng)域的研究和開發(fā)工作還相當(dāng)落后，這直接影響到我國信息產(chǎn)業(yè)的發(fā)展。本著趕超國外先進(jìn)技術(shù)，填補(bǔ)我國在該領(lǐng)域的空白以擺脫受制于國外的目的，我國很多科研單位和公司進(jìn)行了自己的努力和嘗試。經(jīng)過幾年的探索，已經(jīng)有多種自主知識產(chǎn)權(quán)的處理器芯片完成了設(shè)計(jì)驗(yàn)證并逐漸進(jìn)入市場化階段。我國已結(jié)束無“芯”的歷史，并向設(shè)計(jì)出更高性能處理器的目標(biāo)邁進(jìn)。 艾科創(chuàng)新微電子公司的VEGA處理器，是公司憑借自己的技術(shù)力量和科研水平設(shè)計(jì)出的一款64位高性能RSIC微處理器。該處理器基于MIPSISA構(gòu)架，采用五級流水線的設(shè)計(jì)，并且使用了高性能處理器所廣泛采用的虛擬內(nèi)存管理技術(shù)。設(shè)計(jì)過程中采用自上而下的方法，根據(jù)其功能將其劃分為取指、譯碼、算術(shù)邏輯運(yùn)算、內(nèi)存管理、流水線控制和cache控制等幾個功能塊，使得我們在設(shè)計(jì)中能夠按照其功能和時序要求進(jìn)行?！ ”疚牡氖紫冉榻B了MIPS微處理器的特點(diǎn)，通過對MIPS指令集和其五級流水線結(jié)構(gòu)的介紹使得對VEGA的設(shè)計(jì)有了一個直觀的認(rèn)識。在此基礎(chǔ)上提出了VEGA的結(jié)構(gòu)劃分以及主要模塊的功能。作為采用虛擬內(nèi)存管理技術(shù)的處理器，文章的主要部分介紹了VEGA的虛擬內(nèi)存管理技術(shù)，將VEGA的內(nèi)存管理單元(MMU)尤其是內(nèi)部兩個翻譯后援緩沖(TLB)的設(shè)計(jì)作為重點(diǎn)給出了流水線處理器設(shè)計(jì)的方法。結(jié)束總體設(shè)計(jì)并完成仿真后，并不能代表設(shè)計(jì)的正確性，它還需要我們在實(shí)際的硬件平臺上進(jìn)行驗(yàn)證。作為論文的又一重點(diǎn)內(nèi)容，介紹了我們在VEGA驗(yàn)證過程中使用到的FPGA的主要配置單元，F(xiàn)PGA的設(shè)計(jì)流程。VEGA的FPGA平臺是一完整的計(jì)算機(jī)系統(tǒng)，我們利用在線調(diào)試軟件XilinxChipscope對其進(jìn)行了在線調(diào)試，修正其錯誤。 經(jīng)過模塊設(shè)計(jì)到最后的FPGA驗(yàn)證，VEGA完成了其邏輯設(shè)計(jì)，經(jīng)過綜合和布局布線等后端流程，VEGA采用0.18工藝流片后達(dá)到120MHz的工作頻率，可在其平臺上運(yùn)行Windows-CE和Linux嵌入式操作系統(tǒng)，達(dá)到了預(yù)計(jì)的設(shè)計(jì)要求?！ ?/p>
標(biāo)簽： MIPS FPGA 微處理器 模塊設(shè)計(jì)
上傳時間： 2013-07-07
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