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RS觸發(fā)器

RS RS-232 至RS RS-485 RS RS-422 智能轉換器

RS RS-232 至RS RS-485 RS RS-422 智能轉換器

標簽： RS 232 485 422

上傳時間： 2013-12-25

上傳用戶：maizezhen
基于PLD的RS碼編譯碼器設計

基于PLD的RS碼編譯碼器設計，用VHDL語言編寫，編譯通過，測試結果正確。

標簽： PLD RS碼編譯碼器

上傳時間： 2016-01-17

上傳用戶：13188549192
HART協議轉RS-232智能轉換器說明書

HART協議轉RS-232智能轉換器說明書

標簽： HART 232 RS 協議

上傳時間： 2016-01-28

上傳用戶：gyq
<Verilog HDL 語言編程》 RS(204,188)譯碼器的設計

<Verilog HDL 語言編程》 RS(204,188)譯碼器的設計

標簽： Verilog HDL 204 188

上傳時間： 2013-11-30

上傳用戶：lizhen9880
用java寫的RS算法的交織器

用java寫的RS算法的交織器，主要是在進行rs編碼之前，對源數據進行交織。交織參數207，48

標簽： java 算法交織器

上傳時間： 2016-09-19

上傳用戶：dongqiangqiang
cpld/fpga RS(204,188)譯碼器的verilog程序

cpld/fpga RS(204,188)譯碼器的verilog程序

標簽： verilog cpld fpga 204

上傳時間： 2016-11-05

上傳用戶：tyler
精通verilog HDL語言編程源碼9——RS(204,188)譯碼器的設計

精通verilog HDL語言編程源碼9——RS(204,188)譯碼器的設計

標簽： verilog HDL 204 188

上傳時間： 2013-12-20

上傳用戶：獨孤求源
RS(204,188)譯碼器的設計異步FIFO設計偽隨即序列應用設計 CORDIC數字計算機的設計 CIC的設計除法器的設計加羅華域的乘法器設計

RS(204,188)譯碼器的設計異步FIFO設計偽隨即序列應用設計 CORDIC數字計算機的設計 CIC的設計除法器的設計加羅華域的乘法器設計

標簽： CORDIC FIFO 204 188

上傳時間： 2017-01-24

上傳用戶：縹緲
RS（255，223）譯碼器的FPGA實現及其性能測試

　　本課題首先研究了常規的RS譯碼器的算法，確定在關鍵方程的計算中采用一種新改進的BM算法，然后提出了基于復數基的有限域快速并行乘法器和利用冪指數相減進行除法計算的有限域除法器，通過這些優化方法提高了RS譯碼器的速度，減少了譯碼延時和硬件資源使用，最后利用VHDL硬件描述語言在FPGA上實現了流水線處理的RS(255,223)譯碼器。　　本課題實現的RS(255,223)硬件譯碼器的性能在國內具有領先水平，對我國以后航天項目高速數據傳輸系統的設計有著很大的意義。　

標簽： FPGA 255 223 譯碼器

上傳時間： 2013-06-29

上傳用戶：gokk
基于FPGA的RS碼編譯碼器的設計與實現

研制發射微小衛星，是我國利用空間技術服務經濟建設、造福人類的重要途徑。現代微小衛星在短短20年里能取得長足的發展，主要取決于微小衛星自身的一系列特點：重量輕，體積小，成本低，性能高，安全可靠，發射方便、快捷靈活等。在衛星通信系統中，由于傳輸信道的多徑和各種噪聲的影響，信號在接收端會引起差錯，通過信道編碼環節，可對這些不可避免的差錯進行檢測和糾正。在微小衛星通信鏈路中，信道編碼器的任務是差錯控制。本文采用符合空間數據系統咨詢委員會CCSDS標準的鏈接碼進行信道編碼，即內碼為（2，1，6）的卷積碼，外碼為（255，223）的RS碼，中間進行交織操作。其中，里德-索羅蒙碼(簡稱RS碼)是一種重要的非二進制BCH碼，是分組碼中糾錯能力最強的糾錯碼，一次可以糾正多個突發錯誤，廣泛地用于空間通信中。本文針對南京航空航天大學自行研制的微小衛星通信分系統的技術要求，在用SystemView和C語言仿真的基礎上，用硬件描述語言Verilog設計了RS（255，223）編碼器和譯碼器，使用Modelsim軟件進行了功能仿真，并通過Xilinx公司的軟件ISE對設計進行綜合、布局布線，最后生成可下載的比特流文件下載到Xilinx公司的型號為XC3S2000的FPGA芯片中，完成了電路的設計并實現了編碼譯碼的功能，表明本文設計的信道編解碼器的正確性和實用性，滿足了微小衛星通信分系統的技術要求。

標簽： FPGA RS碼編譯碼器

上傳時間： 2013-08-01

上傳用戶：lili123