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qUARTus

qUARTusIIdesign是最高級和復雜的，用于system-on-a-programmable-chip(SOPC)的設計環境。qUARTusIIdesign提供完善的timingclosure和LogicLock?基于塊的設計流程。qUARTusIIdesign是唯一一個包括以timingclosure和基于塊的設計流為基本特征的programmablelogicdevice(PLD)的軟件。qUARTusII設計軟件改進了性能、提升了功能性、解決了潛在的設計延遲等，在工業領域率先提供FPGA與mask-programmeddevices開發的統一工作流程。

  • 清華大學Altera FPGA工程師成長手冊（光盤視頻）

     　　《Altera FPGA工程師成長手冊》以altera公司的fpga為例，由淺入深，全面、系統地詳細講述了基于可編程邏輯技術的設計方法。《Altera FPGA工程師成長手冊》講解時穿插了大量典型實例，便于讀者理解和演練。另外，為了幫助讀者更好地學習，《Altera FPGA工程師成長手冊》提供了配套語音教學視頻，這些視頻和《Altera FPGA工程師成長手冊》源代碼一起收錄于《Altera FPGA工程師成長手冊》配書光盤中。 　　《Altera FPGA工程師成長手冊》涉及面廣，從基本的軟件使用到一般電路設計，再到nios ⅱ軟核處理器的設計，幾乎涉及fpga開發設計的所有知識。具體內容包括：eda開發概述、altera qUARTus ii開發流程、altera qUARTus ii開發向導、vhdl語言、基本邏輯電路設計、宏模塊、lpm函數應用、基于fpga的dsp開發設計、sopc系統構架、soc系統硬件開發、sopc系統軟件開發、nios ii常用外設、logiclock優化技術等。

    標簽： Altera FPGA 清華大學 工程師

    上傳時間： 2013-10-29

    上傳用戶：思索的小白

  • 詳細講解FPGA設計實例

    qUARTus使用和設計實例

    標簽： FPGA 設計實例

    上傳時間： 2014-12-28

    上傳用戶：boyaboy

  • FPGA設計及qUARTus II教程

    FPGA學習資料

    標簽： qUARTus FPGA 教程

    上傳時間： 2013-11-17

    上傳用戶：旭521

  • qUARTus ii使用教程,中文教程

    eda必下。。

    標簽： qUARTus 使用教程 教程

    上傳時間： 2013-11-03

    上傳用戶：crazyer

  • qUARTus教程

    蠻詳細的

    標簽： qUARTus 教程

    上傳時間： 2013-11-03

    上傳用戶：攏共湖塘

  • Xmodem協議中CRC算法的FPAG實現

    基于解決Xmodem協議中CRC校驗的目的，以經典的LFSR硬件電路為基礎，采用了按字節并行運算CRC校驗碼，以及多字節CRC算法的方法。在qUARTus II環境下，通過以VHDL語言仿真試驗，得出Xmodem協議中CRC校驗，以多字節循環并行CRC算法能夠滿足高速實時性要求的結論。

    標簽： Xmodem FPAG CRC 協議

    上傳時間： 2013-11-18

    上傳用戶：lty6899826

  • 基于FPGA的運動估計設計

    本文采用了技術比較成熟的VHDL語言進行設計，并使用qUARTus II軟件進行時序仿真。由仿真結果可知，無論是在功能的實現上還是在搜索的準確性、高效性以及FPGA片上資源的利用率上，本設計方案都具有明顯的優越性。

    標簽： FPGA 運動估計

    上傳時間： 2013-11-22

    上傳用戶：hfmm633

  • 基于FPGA的DDS IP核設計方案

    以Altera公司的qUARTus Ⅱ 7.2作為開發工具，研究了基于FPGA的DDS IP核設計，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件，結合32位嵌入式CPU軟核Nios II，構成可編程片上系統（SOPC），利用極少的硬件資源實現了可重構信號源。該系統基本功能都在FPGA芯片內完成，利用 SOPC技術，在一片 FPGA 芯片上實現了整個信號源的硬件開發平臺，達到既簡化電路設計、又提高系統穩定性和可靠性的目的。

    標簽： FPGA DDS IP核 設計方案

    上傳時間： 2013-11-06

    上傳用戶：songkun

  • 基于CycloneIII構成的RS編碼系統

    本文采用Altera公司的FPGA器件Cyclone III系列EP3C10作為核心器件構成了R-S（255，223）編碼系統；利用qUARTus II 9.0作為硬件仿真平臺，用硬件描述語言Verilog_HDL實現編程，并且通過JTAG接口與EP3C10連接。R-S（Reed-Solomon）碼是一類糾錯能力很強的特殊的非二進制BCH碼，能應對隨機性和突發性錯誤，廣泛應用于各種通信系統中和保密系統中。R-S（255，223）碼能夠檢測32字節長度和糾錯16字節長度的連續數據錯誤信息。

    標簽： CycloneIII RS編碼

    上傳時間： 2013-11-07

    上傳用戶：exxxds

  • MagicSOPC例程編譯異常及解決方法

    1.1 問題產生的環境1.1.1 軟件環境1. PC機的系統為Microsoft Window XP Professional版本2002 Service Pack 2；2. qUARTus II V7.0軟件，并安裝了MegaCore IP V7.0；3. NiosII IDE 7.0軟件。1.1.2 硬件環境核心板的芯片是EP2C35F672C8N的MagicSOPC實驗箱的硬件系統。硬件的工作環境是在普通的環境下。1.2 問題的現象在使用MagicSOPC實驗箱的光盤例程時，使用qUARTus II編譯工程時出現編譯錯誤，錯誤提示信息如圖1.1、圖1.2所示。

    標簽： MagicSOPC 編譯

    上傳時間： 2013-11-18

    上傳用戶：zhyiroy

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