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qUARTus

qUARTusIIdesign是最高級(jí)和復(fù)雜的，用于system-on-a-programmable-chip(SOPC)的設(shè)計(jì)環(huán)境。qUARTusIIdesign提供完善的timingclosure和LogicLock?基于塊的設(shè)計(jì)流程。qUARTusIIdesign是唯一一個(gè)包括以timingclosure和基于塊的設(shè)計(jì)流為基本特征的programmablelogicdevice(PLD)的軟件。qUARTusII設(shè)計(jì)軟件改進(jìn)了性能、提升了功能性、解決了潛在的設(shè)計(jì)延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmeddevices開(kāi)發(fā)的統(tǒng)一工作流程。

  • 清華大學(xué)Altera FPGA工程師成長(zhǎng)手冊(cè)（光盤(pán)視頻）

     　　《Altera FPGA工程師成長(zhǎng)手冊(cè)》以altera公司的fpga為例，由淺入深，全面、系統(tǒng)地詳細(xì)講述了基于可編程邏輯技術(shù)的設(shè)計(jì)方法。《Altera FPGA工程師成長(zhǎng)手冊(cè)》講解時(shí)穿插了大量典型實(shí)例，便于讀者理解和演練。另外，為了幫助讀者更好地學(xué)習(xí)，《Altera FPGA工程師成長(zhǎng)手冊(cè)》提供了配套語(yǔ)音教學(xué)視頻，這些視頻和《Altera FPGA工程師成長(zhǎng)手冊(cè)》源代碼一起收錄于《Altera FPGA工程師成長(zhǎng)手冊(cè)》配書(shū)光盤(pán)中。 　　《Altera FPGA工程師成長(zhǎng)手冊(cè)》涉及面廣，從基本的軟件使用到一般電路設(shè)計(jì)，再到nios ⅱ軟核處理器的設(shè)計(jì)，幾乎涉及fpga開(kāi)發(fā)設(shè)計(jì)的所有知識(shí)。具體內(nèi)容包括：eda開(kāi)發(fā)概述、altera qUARTus ii開(kāi)發(fā)流程、altera qUARTus ii開(kāi)發(fā)向?qū)Аhdl語(yǔ)言、基本邏輯電路設(shè)計(jì)、宏模塊、lpm函數(shù)應(yīng)用、基于fpga的dsp開(kāi)發(fā)設(shè)計(jì)、sopc系統(tǒng)構(gòu)架、soc系統(tǒng)硬件開(kāi)發(fā)、sopc系統(tǒng)軟件開(kāi)發(fā)、nios ii常用外設(shè)、logiclock優(yōu)化技術(shù)等。

    標(biāo)簽： Altera FPGA 清華大學(xué) 工程師

    上傳時(shí)間： 2013-10-29

    上傳用戶(hù)：思索的小白

  • 詳細(xì)講解FPGA設(shè)計(jì)實(shí)例

    qUARTus使用和設(shè)計(jì)實(shí)例

    標(biāo)簽： FPGA 設(shè)計(jì)實(shí)例

    上傳時(shí)間： 2014-12-28

    上傳用戶(hù)：boyaboy

  • FPGA設(shè)計(jì)及qUARTus II教程

    FPGA學(xué)習(xí)資料

    標(biāo)簽： qUARTus FPGA 教程

    上傳時(shí)間： 2013-11-17

    上傳用戶(hù)：旭521

  • qUARTus ii使用教程,中文教程

    eda必下。。

    標(biāo)簽： qUARTus 使用教程 教程

    上傳時(shí)間： 2013-11-03

    上傳用戶(hù)：crazyer

  • qUARTus教程

    蠻詳細(xì)的

    標(biāo)簽： qUARTus 教程

    上傳時(shí)間： 2013-11-03

    上傳用戶(hù)：攏共湖塘

  • Xmodem協(xié)議中CRC算法的FPAG實(shí)現(xiàn)

    基于解決Xmodem協(xié)議中CRC校驗(yàn)的目的，以經(jīng)典的LFSR硬件電路為基礎(chǔ)，采用了按字節(jié)并行運(yùn)算CRC校驗(yàn)碼，以及多字節(jié)CRC算法的方法。在qUARTus II環(huán)境下，通過(guò)以VHDL語(yǔ)言仿真試驗(yàn)，得出Xmodem協(xié)議中CRC校驗(yàn)，以多字節(jié)循環(huán)并行CRC算法能夠滿(mǎn)足高速實(shí)時(shí)性要求的結(jié)論。

    標(biāo)簽： Xmodem FPAG CRC 協(xié)議

    上傳時(shí)間： 2013-11-18

    上傳用戶(hù)：lty6899826

  • 基于FPGA的運(yùn)動(dòng)估計(jì)設(shè)計(jì)

    本文采用了技術(shù)比較成熟的VHDL語(yǔ)言進(jìn)行設(shè)計(jì)，并使用qUARTus II軟件進(jìn)行時(shí)序仿真。由仿真結(jié)果可知，無(wú)論是在功能的實(shí)現(xiàn)上還是在搜索的準(zhǔn)確性、高效性以及FPGA片上資源的利用率上，本設(shè)計(jì)方案都具有明顯的優(yōu)越性。

    標(biāo)簽： FPGA 運(yùn)動(dòng)估計(jì)

    上傳時(shí)間： 2013-11-22

    上傳用戶(hù)：hfmm633

  • 基于FPGA的DDS IP核設(shè)計(jì)方案

    以Altera公司的qUARTus Ⅱ 7.2作為開(kāi)發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核Nios II，構(gòu)成可編程片上系統(tǒng)（SOPC），利用極少的硬件資源實(shí)現(xiàn)了可重構(gòu)信號(hào)源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成，利用 SOPC技術(shù)，在一片 FPGA 芯片上實(shí)現(xiàn)了整個(gè)信號(hào)源的硬件開(kāi)發(fā)平臺(tái)，達(dá)到既簡(jiǎn)化電路設(shè)計(jì)、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。

    標(biāo)簽： FPGA DDS IP核 設(shè)計(jì)方案

    上傳時(shí)間： 2013-11-06

    上傳用戶(hù)：songkun

  • 基于CycloneIII構(gòu)成的RS編碼系統(tǒng)

    本文采用Altera公司的FPGA器件Cyclone III系列EP3C10作為核心器件構(gòu)成了R-S（255，223）編碼系統(tǒng)；利用qUARTus II 9.0作為硬件仿真平臺(tái)，用硬件描述語(yǔ)言Verilog_HDL實(shí)現(xiàn)編程，并且通過(guò)JTAG接口與EP3C10連接。R-S（Reed-Solomon）碼是一類(lèi)糾錯(cuò)能力很強(qiáng)的特殊的非二進(jìn)制BCH碼，能應(yīng)對(duì)隨機(jī)性和突發(fā)性錯(cuò)誤，廣泛應(yīng)用于各種通信系統(tǒng)中和保密系統(tǒng)中。R-S（255，223）碼能夠檢測(cè)32字節(jié)長(zhǎng)度和糾錯(cuò)16字節(jié)長(zhǎng)度的連續(xù)數(shù)據(jù)錯(cuò)誤信息。

    標(biāo)簽： CycloneIII RS編碼

    上傳時(shí)間： 2013-11-07

    上傳用戶(hù)：exxxds

  • MagicSOPC例程編譯異常及解決方法

    1.1 問(wèn)題產(chǎn)生的環(huán)境1.1.1 軟件環(huán)境1. PC機(jī)的系統(tǒng)為Microsoft Window XP Professional版本2002 Service Pack 2；2. qUARTus II V7.0軟件，并安裝了MegaCore IP V7.0；3. NiosII IDE 7.0軟件。1.1.2 硬件環(huán)境核心板的芯片是EP2C35F672C8N的MagicSOPC實(shí)驗(yàn)箱的硬件系統(tǒng)。硬件的工作環(huán)境是在普通的環(huán)境下。1.2 問(wèn)題的現(xiàn)象在使用MagicSOPC實(shí)驗(yàn)箱的光盤(pán)例程時(shí)，使用qUARTus II編譯工程時(shí)出現(xiàn)編譯錯(cuò)誤，錯(cuò)誤提示信息如圖1.1、圖1.2所示。

    標(biāo)簽： MagicSOPC 編譯

    上傳時(shí)間： 2013-11-18

    上傳用戶(hù)：zhyiroy

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