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  資源簡介：verilog編寫的alu模塊

  標簽： verilog alu 編寫 模塊

  上傳時間： 2015-03-09

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• verilog編寫的流水線模塊免費下載

  資源簡介：verilog編寫的流水線模塊

  標簽： verilog 編寫 流水線 模塊

  上傳時間： 2015-03-09

  上傳用戶：杜瑩12345

• 用verilog編寫的4位alu免費下載

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  標簽： verilog alu 編寫

  上傳時間： 2014-01-04

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• verilog編寫的計算百分比模塊免費下載

  資源簡介：verilog編寫的計算百分比模塊

  標簽： verilog 編寫 分 模塊

  上傳時間： 2013-12-17

  上傳用戶：wang0123456789

• verilog編寫的狀態機檢測00100序列. 實現 input:...011000010010000... output:...000000000100100... 并且 用測試模塊來驗證狀免費下載

  資源簡介：verilog編寫的狀態機檢測00100序列. 實現 input:...011000010010000... output:...000000000100100... 并且 用測試模塊來驗證狀態是否正確工作

  標簽： 000000000100100 011000010010000 verilog output

  上傳時間： 2015-07-14

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• verilog 編寫的pic16c5x時鐘模塊免費下載

  資源簡介：verilog 編寫的pic16c5x時鐘模塊

  標簽： verilog pic 16c 16

  上傳時間： 2015-10-25

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• 用verilog編寫的32位alu部件免費下載

  資源簡介：用verilog編寫的32位alu部件，用于cpu制作

  標簽： verilog alu 編寫 部件

  上傳時間： 2013-11-30

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• 用verilog編寫的高速8路并行dds模塊免費下載

  資源簡介：用verilog編寫的高速8路并行dds模塊，用于與高速da(1ghz或以上)接口產生任意頻率正弦波，模塊已經經過工程驗證，用于產品中。

  標簽： verilog dds 8路 編寫

  上傳時間： 2014-01-04

  上傳用戶：ruan2570406

• 由verilog編寫的乘法器免費下載

  資源簡介：由verilog編寫的乘法器，通過兩個文件的調用實現。由于子模塊的調用使得程序簡化了許多。

  標簽： verilog 編寫 乘法器

  上傳時間： 2014-08-29

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• 使用verilog編寫的同步FIFO免費下載

  資源簡介：使用verilog編寫的同步FIFO，可通過設置程序中的DEPTH設置FIFO的深度，FIFO_WRITE_CLOCK上升沿向FIFO中寫入數據，\r\nFIFO_READ_CLOCK上升沿讀取數據。本程序對FIFO上層操作簡單實用。

  標簽： verilog FIFO 編寫

  上傳時間： 2013-08-12

  上傳用戶：ljt101007

• verilog 編寫的I2c協議程序免費下載

  資源簡介：verilog 編寫的I2c協議程序，用于cpld讀寫EEPROM

  標簽： verilog I2c 編寫 協議

  上傳時間： 2013-08-31

  上傳用戶：csgcd001

• 用verilog編寫的多功能數字鐘免費下載

  資源簡介：用verilog編寫的多功能數字鐘

  標簽： verilog 編寫 多功能 數字

  上傳時間： 2015-02-25

  上傳用戶：王者A

• 這是一個很好的verilog 編寫的8位RISC CPU源碼（可做為MCU）免費下載

  資源簡介：這是一個很好的verilog 編寫的8位RISC CPU源碼（可做為MCU），并且包括完整的C 語言的測試代碼。

  標簽： verilog RISC CPU MCU

  上傳時間： 2014-01-05

  上傳用戶：李夢晗

• verilog編寫的32位浮點加法器免費下載

  資源簡介：verilog編寫的32位浮點加法器

  標簽： verilog 編寫 浮點 加法器

  上傳時間： 2015-03-09

  上傳用戶：372825274

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  資源簡介：verilog編寫的全功能串口

  標簽： verilog 編寫 串口

  上傳時間： 2014-02-11

  上傳用戶：Breathe0125

• 加法器（使用verilog編寫的）,雖然簡單免費下載

  資源簡介：加法器（使用verilog編寫的）,雖然簡單，但是這也是學習verilog最基礎的東西！希望大家一起學習！

  標簽： verilog 加法器 編寫

  上傳時間： 2013-12-10

  上傳用戶：410805624

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  資源簡介：用verilog編寫的網卡芯片rtl級。前仿后仿都通過了，可以在modelsim上運行察看

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  上傳時間： 2015-03-31

  上傳用戶：lxm

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  資源簡介：采用verilog編寫的串口通信程序，采用了狀態機設計！程序簡單，消耗資源少

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  上傳時間： 2014-12-08

  上傳用戶：yd19890720

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  資源簡介：verilog編寫的M序列發生器，希望能對大家帶來幫助。

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  上傳時間： 2014-01-11

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  上傳時間： 2015-06-03

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  上傳時間： 2015-06-06

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  上傳時間： 2014-01-21

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  上傳時間： 2015-06-22

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  上傳時間： 2013-12-25

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  上傳時間： 2014-01-13

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  上傳時間： 2015-08-08

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  上傳時間： 2015-08-21

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  上傳時間： 2014-01-27

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  上傳時間： 2013-12-24

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