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• 利用verlilog hdl語(yǔ)言編程免費(fèi)下載

  資源簡(jiǎn)介：利用verlilog hdl語(yǔ)言編程，完成了8051內(nèi)核，非常值得學(xué)習(xí)硬件描述語(yǔ)言的人看看！

  標(biāo)簽： verlilog hdl 語(yǔ)言編程

  上傳時(shí)間： 2015-12-10

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• 《Verilog hdl 語(yǔ)言編程》 異步FIFO設(shè)計(jì)（基于Verilog)免費(fèi)下載

  資源簡(jiǎn)介：《Verilog hdl 語(yǔ)言編程》 異步FIFO設(shè)計(jì)（基于Verilog)

  標(biāo)簽： Verilog FIFO hdl 語(yǔ)言編程

  上傳時(shí)間： 2016-08-30

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• <Verilog hdl 語(yǔ)言編程》 RS(204,188)譯碼器的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：<Verilog hdl 語(yǔ)言編程》 RS(204,188)譯碼器的設(shè)計(jì)

  標(biāo)簽： Verilog hdl 204 188

  上傳時(shí)間： 2013-11-30

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• 《Verilog hdl語(yǔ)言編程》 常有加法器（基于Verilog）免費(fèi)下載

  資源簡(jiǎn)介：《Verilog hdl語(yǔ)言編程》 常有加法器（基于Verilog）

  標(biāo)簽： Verilog hdl 語(yǔ)言編程 加法器

  上傳時(shí)間： 2013-12-18

  上傳用戶：cjf0304

• 精通verilog hdl語(yǔ)言編程源碼之1--常用加法器設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之1--常用加法器設(shè)計(jì)

  標(biāo)簽： verilog hdl 語(yǔ)言編程 源碼

  上傳時(shí)間： 2014-12-03

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• 精通verilog hdl語(yǔ)言編程源碼之2--常用乘法器設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之2--常用乘法器設(shè)計(jì)

  標(biāo)簽： verilog hdl 語(yǔ)言編程 源碼

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  上傳用戶：趙云興

• 精通verilog hdl語(yǔ)言編程源碼之3--伽羅華域乘法器設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之3--伽羅華域乘法器設(shè)計(jì)

  標(biāo)簽： verilog hdl 語(yǔ)言編程 源碼

  上傳時(shí)間： 2013-12-18

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• 精通verilog hdl語(yǔ)言編程源碼之4--常用除法器設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之4--常用除法器設(shè)計(jì)

  標(biāo)簽： verilog hdl 語(yǔ)言編程 源碼

  上傳時(shí)間： 2013-12-24

  上傳用戶：hanli8870

• 精通verilog hdl語(yǔ)言編程源碼之5--CIC積分梳狀濾波器設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之5--CIC積分梳狀濾波器設(shè)計(jì)

  標(biāo)簽： verilog hdl CIC 語(yǔ)言編程

  上傳時(shí)間： 2016-11-22

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• 精通verilog hdl語(yǔ)言編程源碼之6--CORDIC數(shù)字計(jì)算機(jī)的設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： verilog CORDIC hdl 語(yǔ)言編程

  上傳時(shí)間： 2016-11-22

  上傳用戶：稀世之寶039

• 精通verilog hdl語(yǔ)言編程源碼之7——偽隨機(jī)序列應(yīng)用設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之7——偽隨機(jī)序列應(yīng)用設(shè)計(jì)

  標(biāo)簽： verilog hdl 語(yǔ)言編程 源碼

  上傳時(shí)間： 2016-11-22

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• 精通verilog hdl語(yǔ)言編程源碼之8——異步FIFO設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼之8——異步FIFO設(shè)計(jì)

  標(biāo)簽： verilog FIFO hdl 語(yǔ)言編程

  上傳時(shí)間： 2013-12-16

  上傳用戶：龍飛艇

• 精通verilog hdl語(yǔ)言編程源碼9——RS(204,188)譯碼器的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程源碼9——RS(204,188)譯碼器的設(shè)計(jì)

  標(biāo)簽： verilog hdl 204 188

  上傳時(shí)間： 2013-12-20

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• 精通verilog hdl語(yǔ)言編程的一個(gè)不錯(cuò)的cpu 代碼免費(fèi)下載

  資源簡(jiǎn)介：精通verilog hdl語(yǔ)言編程的一個(gè)不錯(cuò)的cpu 代碼

  標(biāo)簽： verilog hdl cpu 語(yǔ)言編程

  上傳時(shí)間： 2013-12-02

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• 基于FPGA的體視攝像顯示技術(shù)的研究免費(fèi)下載

  資源簡(jiǎn)介：體視攝像顯示技術(shù)的研究以應(yīng)用于微創(chuàng)傷外科的光電醫(yī)療儀器——三維電視內(nèi)窺鏡的開(kāi)發(fā)與研制為背景，設(shè)計(jì)研究一種基于FPGA技術(shù)的立體顯示系統(tǒng)，以滿足三維立體內(nèi)窺鏡、戰(zhàn)場(chǎng)立體觀察系統(tǒng)和立體電影等設(shè)備的技術(shù)要求。 主要研究?jī)?nèi)容是對(duì)體視攝像顯示系統(tǒng)的進(jìn)行硬...

  標(biāo)簽： FPGA 顯示技術(shù)

  上傳時(shí)間： 2013-05-30

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• 這是介紹利用C6000DSP開(kāi)發(fā)時(shí),利用C語(yǔ)言編程需要注意的內(nèi)容以及如何進(jìn)行調(diào)試的書(shū)免費(fèi)下載

  資源簡(jiǎn)介：這是介紹利用C6000DSP開(kāi)發(fā)時(shí),利用C語(yǔ)言編程需要注意的內(nèi)容以及如何進(jìn)行調(diào)試的書(shū)

  標(biāo)簽： C6000 6000 DSP C語(yǔ)言編程

  上傳時(shí)間： 2015-03-30

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• hdl 編碼風(fēng)格與編碼指導(dǎo),介紹了詳細(xì)的vhdl和verilog hdl語(yǔ)言的編程風(fēng)格免費(fèi)下載

  資源簡(jiǎn)介：hdl 編碼風(fēng)格與編碼指導(dǎo),介紹了詳細(xì)的vhdl和verilog hdl語(yǔ)言的編程風(fēng)格

  標(biāo)簽： verilog vhdl hdl hdl

  上傳時(shí)間： 2014-01-05

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• 本文介紹了兩種分頻系數(shù)為整數(shù)或半整數(shù)的可控分頻器的設(shè)計(jì)方法。其中之一可以實(shí)現(xiàn)50％的奇數(shù)分頻。利用Vhdl語(yǔ)言編程免費(fèi)下載

  資源簡(jiǎn)介：本文介紹了兩種分頻系數(shù)為整數(shù)或半整數(shù)的可控分頻器的設(shè)計(jì)方法。其中之一可以實(shí)現(xiàn)50％的奇數(shù)分頻。利用Vhdl語(yǔ)言編程，并用QUARTERS||4.0進(jìn)行仿真，用 FPGA 芯片實(shí)現(xiàn)。 關(guān)鍵詞：半整數(shù)，可控分頻器，Vhdl, FPGA

  標(biāo)簽： Vhdl 分頻 整數(shù) 系數(shù)

  上傳時(shí)間： 2015-11-27

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• 計(jì)算機(jī)控制算法仿真實(shí)驗(yàn),利用C語(yǔ)言編程,適合學(xué)習(xí)計(jì)算機(jī)控制原理的學(xué)生進(jìn)行控制算法驗(yàn)證免費(fèi)下載

  資源簡(jiǎn)介：計(jì)算機(jī)控制算法仿真實(shí)驗(yàn),利用C語(yǔ)言編程,適合學(xué)習(xí)計(jì)算機(jī)控制原理的學(xué)生進(jìn)行控制算法驗(yàn)證

  標(biāo)簽： 計(jì)算機(jī) 控制算法 仿真實(shí)驗(yàn) C語(yǔ)言編程

  上傳時(shí)間： 2016-03-01

  上傳用戶：sunjet

• 指針為C語(yǔ)言編程提供了強(qiáng)大的支持——如果你能正確而靈活地利用指針免費(fèi)下載

  資源簡(jiǎn)介：指針為C語(yǔ)言編程提供了強(qiáng)大的支持——如果你能正確而靈活地利用指針，你就可以直接切入問(wèn)題 的核心，或者將程序分割成一個(gè)個(gè)片斷。一個(gè)很好地利用了指針的程序會(huì)非常高效、簡(jiǎn)潔和精致。

  標(biāo)簽： 指針 C語(yǔ)言編程 正

  上傳時(shí)間： 2016-03-11

  上傳用戶：13215175592

• 這篇文章具體講解了利用投影法和差影法進(jìn)行圖像處理的方法 并附有c語(yǔ)言編程實(shí)例免費(fèi)下載

  資源簡(jiǎn)介：這篇文章具體講解了利用投影法和差影法進(jìn)行圖像處理的方法 并附有c語(yǔ)言編程實(shí)例

  標(biāo)簽： 投影 圖像處理 c語(yǔ)言 編程實(shí)例

  上傳時(shí)間： 2016-06-01

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• 簡(jiǎn)述了V hdl 語(yǔ)言的功能及其特點(diǎn),并以 8 位串行數(shù)字鎖設(shè)計(jì)為例,介紹了在Max + plus Ⅱ10. 2 開(kāi)發(fā)軟件下,利用V hdl 硬件描述語(yǔ)言設(shè) 計(jì)數(shù)字邏輯電路的過(guò)程和方法。并設(shè)計(jì)了密免費(fèi)下載

  資源簡(jiǎn)介：簡(jiǎn)述了V hdl 語(yǔ)言的功能及其特點(diǎn),并以 8 位串行數(shù)字鎖設(shè)計(jì)為例,介紹了在Max + plus Ⅱ10. 2 開(kāi)發(fā)軟件下,利用V hdl 硬件描述語(yǔ)言設(shè) 計(jì)數(shù)字邏輯電路的過(guò)程和方法。并設(shè)計(jì)了密碼鎖

  標(biāo)簽： hdl plus Max 10

  上傳時(shí)間： 2013-12-23

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• 利用vhdl語(yǔ)言編程實(shí)現(xiàn)的pn碼產(chǎn)生.在quartus ii中通過(guò)免費(fèi)下載

  資源簡(jiǎn)介：利用vhdl語(yǔ)言編程實(shí)現(xiàn)的pn碼產(chǎn)生.在quartus ii中通過(guò)

  標(biāo)簽： quartus vhdl 語(yǔ)言 編程實(shí)現(xiàn)

  上傳時(shí)間： 2013-12-12

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• 利用點(diǎn)陣LDE顯示一個(gè)漢字8 *8。使用C語(yǔ)言編程免費(fèi)下載

  資源簡(jiǎn)介：利用點(diǎn)陣LDE顯示一個(gè)漢字8 *8。使用C語(yǔ)言編程，利用循環(huán)嵌套，其中P0口復(fù)用，先送列數(shù)據(jù)，在送行數(shù)據(jù)LED1為顯示，2位上下滾動(dòng)，3為左右滾動(dòng)

  標(biāo)簽： LDE 點(diǎn)陣 C語(yǔ)言編程 漢字

  上傳時(shí)間： 2016-07-13

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• 有實(shí)驗(yàn)結(jié)果,用MOSIN6編寫(xiě)的,是Verilog hdl語(yǔ)言實(shí)現(xiàn)的. 練習(xí)三 利用條件語(yǔ)句實(shí)現(xiàn)計(jì)數(shù)分頻時(shí)序電路 實(shí)驗(yàn)?zāi)康模? 1. 掌握條件語(yǔ)句在簡(jiǎn)單時(shí)序模塊設(shè)計(jì)中的使用； 2. 學(xué)習(xí)在Ver免費(fèi)下載

  資源簡(jiǎn)介：有實(shí)驗(yàn)結(jié)果,用MOSIN6編寫(xiě)的,是Verilog hdl語(yǔ)言實(shí)現(xiàn)的. 練習(xí)三 利用條件語(yǔ)句實(shí)現(xiàn)計(jì)數(shù)分頻時(shí)序電路 實(shí)驗(yàn)?zāi)康模? 1. 掌握條件語(yǔ)句在簡(jiǎn)單時(shí)序模塊設(shè)計(jì)中的使用； 2. 學(xué)習(xí)在Verilog模塊中應(yīng)用計(jì)數(shù)器； 3. 學(xué)習(xí)測(cè)試模塊的編寫(xiě)、綜合和不同層次的仿真。 練習(xí)四 ...

  標(biāo)簽： Verilog MOSIN6 hdl Ver

  上傳時(shí)間： 2016-11-19

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• 本程序是在傳輸流傳輸過(guò)程中對(duì)節(jié)目時(shí)鐘字段進(jìn)行檢測(cè)與修改,采用Verilog hdl 語(yǔ)言進(jìn)行編程。免費(fèi)下載

  資源簡(jiǎn)介：本程序是在傳輸流傳輸過(guò)程中對(duì)節(jié)目時(shí)鐘字段進(jìn)行檢測(cè)與修改,采用Verilog hdl 語(yǔ)言進(jìn)行編程。

  標(biāo)簽： Verilog hdl 程序 傳輸流

  上傳時(shí)間： 2013-12-27

  上傳用戶：s363994250

• java語(yǔ)言編程實(shí)現(xiàn)：利用命令行參數(shù)解一元三次方程。 包含相關(guān)代碼和運(yùn)行結(jié)果免費(fèi)下載

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  標(biāo)簽： java 語(yǔ)言 編程實(shí)現(xiàn) 命令行

  上傳時(shí)間： 2017-01-30

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• 討論如何利用軟件控制 !"#$## &$ ’# 液晶顯示模塊時(shí)序(采用 )*+ 語(yǔ)言編程(驅(qū)動(dòng) 液晶模塊實(shí)現(xiàn)并行傳輸方式的字符#漢字以及圖形顯示$具體闡述了 !"#$## !$ ’# 液晶顯示 模免費(fèi)下載

  資源簡(jiǎn)介：討論如何利用軟件控制 !"#$## &$ ’# 液晶顯示模塊時(shí)序(采用 )*+ 語(yǔ)言編程(驅(qū)動(dòng) 液晶模塊實(shí)現(xiàn)并行傳輸方式的字符#漢字以及圖形顯示$具體闡述了 !"#$## !$ ’# 液晶顯示 模塊與單片機(jī) ,-./0*1 的并行接口電路和軟件編程方法$ 關(guān)鍵詞"!"#$## &$ ’# 液晶顯示...

  標(biāo)簽： 如何利用 圖形顯示 軟件控制 液晶顯示模塊

  上傳時(shí)間： 2013-12-17

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• 利用c語(yǔ)言編程實(shí)現(xiàn)在屏幕指定位置畫(huà)出任何圓。免費(fèi)下載

  資源簡(jiǎn)介：利用c語(yǔ)言編程實(shí)現(xiàn)在屏幕指定位置畫(huà)出任何圓。

  標(biāo)簽： c語(yǔ)言 編程實(shí)現(xiàn) 屏幕 定位

  上傳時(shí)間： 2013-12-09

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• 利用C語(yǔ)言編程來(lái)實(shí)現(xiàn)電腦的開(kāi)機(jī)密碼的問(wèn)題解決方法免費(fèi)下載

  資源簡(jiǎn)介：利用C語(yǔ)言編程來(lái)實(shí)現(xiàn)電腦的開(kāi)機(jī)密碼的問(wèn)題解決方法

  標(biāo)簽： C語(yǔ)言編程 電腦 開(kāi)機(jī)密碼

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