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  上傳時間： 2013-12-12

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  上傳時間： 2013-11-26

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  上傳時間： 2014-11-28

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  上傳時間： 2014-01-23

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  上傳時間： 2016-09-19

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  上傳時間： 2013-12-25

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  上傳時間： 2017-03-18

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  上傳時間： 2014-11-02

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  標簽： VERILOG fpga 分頻器

  上傳時間： 2016-07-11

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  上傳時間： 2015-05-02

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  上傳時間： 2013-12-21

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• 從算法設計到硬線邏輯的實現——實驗練習與VERILOG語法手冊免費下載

  資源簡介：從算法設計到硬線邏輯的實現——實驗練習與VERILOG語法手冊，與先前傳的《VERILOGHDL教程》配合使用，Pdg格式，請用超星閱覽器打開。

  標簽： VERILOG 算法設計 實驗

  上傳時間： 2014-10-28

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  標簽： VHDL CPLD 00.0 99.9

  上傳時間： 2013-12-01

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• 用VHDL語言編寫的LDPC碼硬件實現語言免費下載

  資源簡介：用VHDL語言編寫的LDPC碼硬件實現語言，相對于VERILOG的，比較簡單

  標簽： VHDL LDPC 語言 編寫

  上傳時間： 2016-11-05

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  資源簡介：VERILOG語言實現的數字下變頻設計。 在ALTERA的QUARTUS ii下實現。實用，好用。

  標簽： VERILOG QUARTUS ALTERA 語言

  上傳時間： 2017-05-07

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• DVB系統信道編碼的研究與FPGA實現.rar免費下載

  資源簡介：數字圖像通信的最廣泛的應用就是數字電視廣播系統，與以往的模擬電視業務相比，數字電視在節省頻譜資源、提高節目質量方面帶來了一場新的革命，而與此對應的DVB（Digital Video Broadcasting）標準的建立更是加速了數字電視廣播系統的大規模應用。DVB標準選定...

  標簽： FPGA DVB

  上傳時間： 2013-06-26

  上傳用戶：allen-zhao123

• 基于FPGA的嵌入式TCPIP協議棧的實現.rar免費下載

  資源簡介：本文論述了嵌入式TCP/IP協議棧的實現，介紹了TCP/IP協議棧的原理，以及硬線實現TCP/IP協議棧的意義和應用。 第一章為緒論，介紹論文研究的目的、內容、意義和國內外研究發展的現狀。 第二章介紹FPGA設計的流程和VERILOG HDL設計語言。著重介紹了FPGA的代碼輸...

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  上傳時間： 2013-07-04

  上傳用戶：leesuper

• 基于FPGA的QDPSK調制解調技術的研究及實現.rar免費下載

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  標簽： QDPSK FPGA 調制

  上傳時間： 2013-04-24

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• 傳輸流復用器的FPGA建模與實現免費下載

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  標簽： FPGA 傳輸流 復用器 建模

  上傳時間： 2013-06-02

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• 基于ARM的地鐵用安全型智能IO的設計與實現免費下載

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  上傳時間： 2013-06-12

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• JPEG2000中小波變換的研究與FPGA實現免費下載

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  標簽： JPEG 2000 FPGA 小波變換

  上傳時間： 2013-04-24

  上傳用戶：h886166

• PCI從設備控制器的FPGA設計與實現免費下載

  資源簡介：隨著星載電子系統復雜度、小型化需求的提高，SoC已經成為應對未來星載電子系統設計需求的解決途徑。為了簡化設計流程并且提高部件的可重用性，在目前的SoC設計中引入了稱之為平臺的體系結構模板，用它來描述采用已有的標準核來開發SoC的方法。在星載電子系統...

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  上傳時間： 2013-06-07

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• 橢圓曲線密碼體制中標量乘法運算的優化和FPGA實現免費下載

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  標簽： FPGA 橢圓曲線 密碼體制 乘法運算

  上傳時間： 2013-05-24

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• 基于FPGA的嵌入式TCPIP協議棧的實現免費下載

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  標簽： TCPIP FPGA 嵌入式 協議棧

  上傳時間： 2013-04-24

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• 基于FPGA的串行通信實現與CRC校驗免費下載

  資源簡介：本文應用EDA技術，基于FPGA器件設計與實現UART，并采用CRC校驗。主要工作如下： 1、在異步串行通信電路部分完全用FPGA來實現。選用Xilinx公司的SpartanⅢ系列的XC3S1000來實現異步串行通信的接收、發送和接口控制功能，利用FPGA集成度比較高，具有在線可編程...

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  上傳時間： 2013-04-24

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• 異步FIFO是用來適配不同異步FIFO采用了格雷（GRAY）變換技術和雙端口RAM實現了不同時鐘域之間的數據無損傳輸免費下載

  資源簡介：異步FIFO是用來適配不同時鐘域之間的相位差和頻率飄移的重要模塊。本文設計的異步FIFO采用了格雷（GRAY）變換技術和雙端口RAM實現了不同時鐘域之間的數據無損傳輸。該結構利用了GRAY變換的特點，使得整個系統可靠性高和抗干擾能力強，系統可以工作在讀寫時鐘...

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  上傳時間： 2013-08-08

  上傳用戶：13817753084

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  資源簡介：實現USB接口功能的VHDL和VERILOG完整源代碼

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  上傳時間： 2013-08-11

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  上傳時間： 2013-08-18

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