數(shù)字秒表的設(shè)計，reset為歸零設(shè)置，start為重新計時設(shè)置
資源簡介：用verilog實現(xiàn)了一個數(shù)字秒表的設(shè)計
上傳時間： 2015-11-15
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資源簡介：VHD設(shè)計實例8位加法器的設(shè)計分頻電路數(shù)字秒表的設(shè)計
上傳時間： 2014-08-10
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資源簡介：數(shù)字秒表的設(shè)計，reset為歸零設(shè)置，start為重新計時設(shè)置
上傳時間： 2013-12-12
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資源簡介：1 8位加法器的設(shè)計 2 分頻電路 3 數(shù)字秒表的設(shè)計
上傳時間： 2014-01-02
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資源簡介：數(shù)字秒表的設(shè)計，設(shè)計并調(diào)試一個計時范圍為0.01秒~1小時的數(shù)字秒表，并用實驗開發(fā)系統(tǒng)進行硬件驗證。有詳細步驟和源碼。
上傳時間： 2013-12-12
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資源簡介：本設(shè)計要實現(xiàn)一個具有預置數(shù)的數(shù)字鐘的設(shè)計,具體要求如下: 1. 正確顯示年、月、日 2. 正確顯示時、分、秒 3. 具有校時,整點報時和秒表功能 4. 進行系統(tǒng)模擬仿真和下載編程實驗,驗證系統(tǒng)的正確性
上傳時間： 2013-12-18
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資源簡介：數(shù)字秒表的整個設(shè)計以及程序．波形仿真都在里面的了
上傳時間： 2016-02-23
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資源簡介：數(shù)字秒表的VHDL設(shè)計,能精確到百分秒,在6位數(shù)碼管上顯示,分別有秒,分,小時,通過目標芯片EPF10KLC84-4驗證
上傳時間： 2016-09-23
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資源簡介：提供一個數(shù)字秒表的EDA設(shè)計實例，內(nèi)故有VHDL源代碼，并有運行仿真圖。
上傳時間： 2014-01-25
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資源簡介：一個用FPGA語言設(shè)計數(shù)字秒表的程序，有相關(guān)的源程序和說明
上傳時間： 2013-12-22
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資源簡介：基于單片機的數(shù)字電子秒表的設(shè)計與實現(xiàn)這是一份非常不錯的資料，歡迎下載，希望對您有幫助！
上傳時間： 2021-12-05
上傳用戶：jiabin
資源簡介：多功能秒表的設(shè)計，VHDL實現(xiàn)，對學習數(shù)字邏輯的同學有幫助。
上傳時間： 2017-03-04
上傳用戶：1101055045
資源簡介：·基于MATLAB的FIR帶阻數(shù)字濾波器的設(shè)計
上傳時間： 2013-04-24
上傳用戶：huyanju
資源簡介：在數(shù)字電路的設(shè)計中，時序設(shè)計是一個系統(tǒng)性能的主要標志，在高層次設(shè)計方法中，對時序控制的抽象度也相應提高，因此在設(shè)計中較難把握，但在理解RTL電路時序模型的基礎(chǔ)上，采用合理的設(shè)計方法在設(shè)計復雜數(shù)字系統(tǒng)是行之有效的，通過許多設(shè)計實例證明采用這種方...
上傳時間： 2013-08-18
上傳用戶：nairui21
資源簡介：基于FPGA的多功能數(shù)字鐘的設(shè)計與實現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時間設(shè)置，時間顯示，跑表，分頻，日期設(shè)置，日期顯示等
上傳時間： 2013-08-18
上傳用戶：問題問題
資源簡介：基于FPGA的直接數(shù)字合成器的設(shè)計與分析的代碼程序,代碼格式為VHDL
上傳時間： 2013-09-02
上傳用戶：ifree2016
資源簡介：ＦＰＧＡ數(shù)字鐘的設(shè)計，用VHDL語言編程，max+plus仿真，可在實際電路中驗證
上傳時間： 2013-09-02
上傳用戶：packlj
資源簡介：該文檔詳細介紹數(shù)字鐘的設(shè)計
上傳時間： 2013-11-05
上傳用戶：wqq123456
資源簡介：數(shù)字鬧鐘的設(shè)計
上傳時間： 2013-11-01
上傳用戶：huyanju
資源簡介：講述高速數(shù)字電路的設(shè)計和布線原理，有很多具體的技巧和經(jīng)驗
上傳時間： 2015-03-15
上傳用戶：aeiouetla
資源簡介：65位FIR數(shù)字濾波器的設(shè)計~~其中有通過仿真得出得數(shù)據(jù) ~可以通過數(shù)據(jù)輸入完成濾波實驗~對數(shù)字濾波器得整個算法進行了分析包括輸入分組相加 然后相乘得過程
上傳時間： 2014-11-27
上傳用戶：hgy9473
資源簡介：指令譯碼電路的設(shè)計。 主要用在數(shù)字電路的設(shè)計中。 所用語言為Verilog HDL.
上傳時間： 2015-05-02
上傳用戶：h886166
資源簡介：數(shù)字濾波的設(shè)計:FIR濾波器,設(shè)計濾波器采樣頻率為600hz，截止頻率200hz的高通濾波器
上傳時間： 2013-11-29
上傳用戶：watch100
資源簡介：基于FPGA的直接數(shù)字合成器的設(shè)計與分析的代碼程序,代碼格式為VHDL
上傳時間： 2015-06-09
上傳用戶：huql11633
資源簡介：ＦＰＧＡ數(shù)字鐘的設(shè)計，用VHDL語言編程，max+plus仿真，可在實際電路中驗證
上傳時間： 2015-07-25
上傳用戶：924484786
資源簡介：無限沖激響應數(shù)字濾波器的設(shè)計中的各個例子的程序，希望對大家有用
上傳時間： 2015-08-15
上傳用戶：stvnash
資源簡介：數(shù)字電子鐘的設(shè)計報告！對“模擬電子技術(shù)”，“數(shù)字電子技術(shù)”課程的理論知識進行總結(jié)
上傳時間： 2015-08-21
上傳用戶：CSUSheep
資源簡介：介紹8位加法器、分頻電路、數(shù)字秒表的PPT，帶源碼，解釋詳細，一步一步學習，是學習VHDL的好
上傳時間： 2013-12-23
上傳用戶：Divine
資源簡介：無限脈沖數(shù)字濾波器的設(shè)計系列。本程序為低通濾波器。歡迎切磋。
上傳時間： 2014-01-17
上傳用戶：日光微瀾
資源簡介：無限脈沖數(shù)字濾波器的設(shè)計系列。本程序為帶通濾波器。歡迎切磋。
上傳時間： 2015-09-16
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