相 關(guān) 資 源

• 基于eda中vhdl語言的一位全加器的設(shè)計免費(fèi)下載

  資源簡介：基于eda中vhdl語言的一位全加器的設(shè)計，詳細(xì)的設(shè)計過程和實驗現(xiàn)象，相互學(xué)習(xí)

  標(biāo)簽： vhdl eda 語言 全加器

  上傳時間： 2014-01-15

  上傳用戶：baiom

• 本程序是在一位全加器的基礎(chǔ)上設(shè)計一個16位的加法器,用Verilog HDL語言描述.免費(fèi)下載

  資源簡介：本程序是在一位全加器的基礎(chǔ)上設(shè)計一個16位的加法器,用Verilog HDL語言描述.

  標(biāo)簽： Verilog HDL 程序 全加器

  上傳時間： 2013-12-03

  上傳用戶：moerwang

• 2級流水線實現(xiàn)的8位全加器的vhdl代碼免費(fèi)下載

  資源簡介：2級流水線實現(xiàn)的8位全加器的vhdl代碼，適用于altera系列的FPGA/CPLD

  標(biāo)簽： vhdl 流水線 8位 全加器

  上傳時間： 2014-06-15

  上傳用戶：zhanditian

• 這是一個利用MAX PULL 制作的vhdl的四位全加器的程序 如果有需要仿真圖的 請叫站長聯(lián)系我免費(fèi)下載

  資源簡介：這是一個利用MAX PULL 制作的vhdl的四位全加器的程序 如果有需要仿真圖的 請叫站長聯(lián)系我

  標(biāo)簽： PULL vhdl MAX 全加器

  上傳時間： 2014-05-31

  上傳用戶：lht618

• 這是我在ISP編程實驗中獨(dú)立編寫的采用結(jié)構(gòu)化描述的四位全加器免費(fèi)下載

  資源簡介：這是我在ISP編程實驗中獨(dú)立編寫的采用結(jié)構(gòu)化描述的四位全加器，通過四次映射一位全加器的方式實現(xiàn)了四位全加器的功能，并附有數(shù)碼顯示模塊，將全加器的運(yùn)算結(jié)果輸出到數(shù)碼管顯示。

  標(biāo)簽： ISP 編程實驗 獨(dú)立 全加器

  上傳時間： 2017-01-19

  上傳用戶：1583060504

• 用一位全加器組成四位全加器. 所用語言是Verilog HDL. 主要用在加法器的設(shè)計中。免費(fèi)下載

  資源簡介：用一位全加器組成四位全加器. 所用語言是Verilog HDL. 主要用在加法器的設(shè)計中。

  標(biāo)簽： Verilog HDL 全加器 語言

  上傳時間： 2015-05-02

  上傳用戶：zukfu

• 此程序是用vhdl硬件描述語言編寫的,實現(xiàn)四位全加器的功能免費(fèi)下載

  資源簡介：此程序是用vhdl硬件描述語言編寫的,實現(xiàn)四位全加器的功能

  標(biāo)簽： vhdl 程序 硬件描述語言 全加器

  上傳時間： 2017-01-07

  上傳用戶：天誠24

• 8位全加器的vhdl語言描述免費(fèi)下載

  資源簡介：8位全加器的vhdl語言描述，有需要的頂一下。

  標(biāo)簽： vhdl 8位 全加器 語言

  上傳時間： 2017-05-30

  上傳用戶：aysyzxzm

• 用vhdl編寫的8位全加器,數(shù)字分頻器等程序免費(fèi)下載

  資源簡介：用vhdl編寫的8位全加器,數(shù)字分頻器等程序

  標(biāo)簽： vhdl 8位 編寫 全加器

  上傳時間： 2013-12-16

  上傳用戶：ztj182002

• 一位全減器的ＶＨＤＬ的設(shè)計報告免費(fèi)下載

  資源簡介：一位全減器的ＶＨＤＬ的設(shè)計報告，里面包含完整的程序

  標(biāo)簽： 減 報告

  上傳時間： 2015-07-23

  上傳用戶：黃華強(qiáng)

• 1位全加器的vhdl設(shè)計 通過兩個半加起實現(xiàn)免費(fèi)下載

  資源簡介：1位全加器的vhdl設(shè)計 通過兩個半加起實現(xiàn)

  標(biāo)簽： vhdl 全加器

  上傳時間： 2017-01-12

  上傳用戶：徐孺

• 用vhdl寫的一個8位全加器的實驗程序,供新手參考免費(fèi)下載

  資源簡介：用vhdl寫的一個8位全加器的實驗程序,供新手參考

  標(biāo)簽： vhdl 8位 全加器 實驗

  上傳時間： 2017-03-03

  上傳用戶：lx9076

• 8位全加器的vhdl描述免費(fèi)下載

  資源簡介：8位全加器的vhdl描述，可用MAX+plusⅡ運(yùn)行測試

  標(biāo)簽： vhdl 8位 全加器

  上傳時間： 2014-01-16

  上傳用戶：erkuizhang

• 一位全加器源碼實現(xiàn)了MAX及其一系列器件實現(xiàn)全加的功能免費(fèi)下載

  資源簡介：一位全加器源碼實現(xiàn)了MAX及其一系列器件實現(xiàn)全加的功能

  標(biāo)簽： MAX 全加器 源碼 器件

  上傳時間： 2013-12-25

  上傳用戶：xcy122677

• 本設(shè)計是設(shè)計了一個4位全加器的內(nèi)容免費(fèi)下載

  資源簡介：本設(shè)計是設(shè)計了一個4位全加器的內(nèi)容，是由4個一位全加器串聯(lián)而成的

  標(biāo)簽： 全加器

  上傳時間： 2017-08-15

  上傳用戶：水口鴻勝電器

• fulladder.vhd 一位全加器 adder.vhd 四位全加器 multi4.vhd 四位并行乘法器免費(fèi)下載

  資源簡介：fulladder.vhd 一位全加器 adder.vhd 四位全加器 multi4.vhd 四位并行乘法器

  標(biāo)簽： vhd fulladder adder multi

  上傳時間： 2015-09-03

  上傳用戶：上善若水

• 三位全加器的源代碼免費(fèi)下載

  資源簡介：三位全加器的源代碼，和測試代碼，用Verilog HDL實現(xiàn)的！

  標(biāo)簽： 全加器 源代碼

  上傳時間： 2013-12-22

  上傳用戶：erkuizhang

• 使用vhdl語言實現(xiàn)數(shù)字電路全加器功能免費(fèi)下載

  資源簡介：使用vhdl語言實現(xiàn)數(shù)字電路全加器功能，算法比較簡單，供初學(xué)者參考。

  標(biāo)簽： vhdl 語言 數(shù)字電路 全加器

  上傳時間： 2013-12-10

  上傳用戶：lhw888

• 一位全加器免費(fèi)下載

  資源簡介：一位全加器，VERILOG實現(xiàn)，包括測試文件，測試可用，歡迎下載，共同學(xué)習(xí)

  標(biāo)簽： 全加器

  上傳時間： 2013-12-24

  上傳用戶：410805624

• 4 級流水方式的8 位全加器。。。。。。免費(fèi)下載

  資源簡介：4 級流水方式的8 位全加器。。。。。。

  標(biāo)簽： 方式 全加器

  上傳時間： 2017-07-20

  上傳用戶：362279997

• 這是一個4位全加器免費(fèi)下載

  資源簡介：這是一個4位全加器，用一個1位半價做的一位全加，然后做成的四位半加。

  標(biāo)簽： 全加器

  上傳時間： 2016-04-30

  上傳用戶：上善若水

• 這是用vhdl語言寫的32位分頻器的程序免費(fèi)下載

  資源簡介：這是用vhdl語言寫的32位分頻器的程序，可直接運(yùn)行，看結(jié)果，歡迎使用。多指正，交流。

  標(biāo)簽： vhdl 語言 分頻器 程序

  上傳時間： 2015-05-11

  上傳用戶：chenlong

• 通過vhdl語言實現(xiàn)四位無符號數(shù)的加法免費(fèi)下載

  資源簡介：通過vhdl語言實現(xiàn)四位無符號數(shù)的加法，四位撥位置數(shù)，用數(shù)碼管輸出結(jié)果

  標(biāo)簽： vhdl 語言 符號 加法

  上傳時間： 2013-12-21

  上傳用戶：wfeel

• 全加器的詳細(xì)設(shè)計思路和用vhdl語言編寫的詳細(xì)源代碼免費(fèi)下載

  資源簡介：全加器的詳細(xì)設(shè)計思路和用vhdl語言編寫的詳細(xì)源代碼

  標(biāo)簽： vhdl 全加器 詳細(xì)設(shè)計 編寫

  上傳時間： 2014-01-12

  上傳用戶：zhaiyanzhong

• 基于PC104的24位數(shù)據(jù)采集器的完整源碼免費(fèi)下載

  資源簡介：基于PC104的24位數(shù)據(jù)采集器的完整源碼，從初始數(shù)據(jù)采集輸入到編碼，GPS微妙級對時，輸出規(guī)定格式以及服務(wù)響應(yīng)

  標(biāo)簽： 104 PC 24位 數(shù)據(jù)采集器

  上傳時間： 2015-11-28

  上傳用戶：星仔

• 四位全加器語言描述是以文本方式上傳的免費(fèi)下載

  資源簡介：四位全加器語言描述是以文本方式上傳的，呵呵，希望大家有幫助

  標(biāo)簽： 全加器 語言 方式

  上傳時間： 2014-01-26

  上傳用戶：siguazgb

• 用vhdl語言采用串行方法實現(xiàn)用1位全加器實現(xiàn)4位全加器免費(fèi)下載

  資源簡介：用vhdl語言采用串行方法實現(xiàn)用1位全加器實現(xiàn)4位全加器

  標(biāo)簽： vhdl 全加器 語言 串行

  上傳時間： 2016-05-27

  上傳用戶：hongmo

• 一個數(shù)模轉(zhuǎn)換器的vhdl源碼 一個數(shù)模轉(zhuǎn)換器的vhdl源碼免費(fèi)下載

  資源簡介：一個數(shù)模轉(zhuǎn)換器的vhdl源碼 一個數(shù)模轉(zhuǎn)換器的vhdl源碼

  標(biāo)簽： vhdl 數(shù)模轉(zhuǎn)換器 源碼

  上傳時間： 2016-08-28

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• 用vhdl語言設(shè)計四位全加器免費(fèi)下載

  資源簡介：用vhdl語言設(shè)計四位全加器，有低位進(jìn)位和高位進(jìn)位。

  標(biāo)簽： vhdl 語言 全加器

  上傳時間： 2013-12-26

  上傳用戶：6546544

• 該程序?qū)崿F(xiàn)的是n位全加器免費(fèi)下載

  資源簡介：該程序?qū)崿F(xiàn)的是n位全加器，首先用與非門實現(xiàn)一位全家器，最后實現(xiàn)n位的全加器。

  標(biāo)簽： 程序 全加器

  上傳時間： 2015-04-18

  上傳用戶：fandeshun