七位巴克碼生成代碼 用vhdl語言編寫。將代碼復制到quartus里面就可以用了
資源簡介:七位巴克碼生成代碼 用vhdl語言編寫。將代碼復制到quartus里面就可以用了
上傳時間: 2016-12-18
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資源簡介:本文為用vhdl語言編寫的2進制到10進制轉換的程序,為doc格式,使用前復制于maxplus等相應軟件中使用。
上傳時間: 2013-12-21
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資源簡介:巴克碼生成與測試電路。 當計數脈沖不斷進入由Q3Q2Q1組成的三位二進制異步計數器時,3-8譯碼器的8個輸出經反相器后順序輸出高電平。其中五路信號經“或非”后再和其中3路“或”,在Y端便可順序產生11000100代碼序列。
上傳時間: 2016-04-18
上傳用戶:極客
資源簡介:13位巴克碼+線形調頻信號,進行脈沖壓縮處理,中間經過解調處理。
上傳時間: 2014-11-22
上傳用戶:tianyi223
資源簡介:產生7位巴克碼和線性調頻的混合調制信號
上傳時間: 2014-01-03
上傳用戶:lvzhr
資源簡介:system軟件實現的7位巴克碼的編碼解碼過程!
上傳時間: 2013-12-24
上傳用戶:417313137
資源簡介:實現基于逐碼移位法的7位巴克碼集中插入式搜索算法。
上傳時間: 2016-07-30
上傳用戶:tedo811
資源簡介:7位巴克碼的matlab仿真,7位巴克碼的matlab仿真,7位巴克碼的matlab仿真.
上傳時間: 2017-07-23
上傳用戶:daoxiang126
資源簡介:用FPGA實現RS232通信,此代碼是用vhdl語言編寫,非常有用的好東東啊
上傳時間: 2013-08-21
上傳用戶:爺的氣質
資源簡介:用vhdl語言編寫的代碼,以供大家學習和交流,方便大家學習!
上傳時間: 2013-09-05
上傳用戶:龍飛艇
資源簡介:用vhdl語言編寫的代碼,以供大家學習和交流,方便大家學習!
上傳時間: 2015-06-23
上傳用戶:vodssv
資源簡介:用vhdl語言編寫的代碼,以供大家學習和交流,方便大家學習!
上傳時間: 2014-01-02
上傳用戶:Late_Li
資源簡介:用vhdl語言編寫的代碼,以供大家學習和交流,方便大家學習!
上傳時間: 2013-11-29
上傳用戶:jyycc
資源簡介:用vhdl語言編寫的三位二進制的乘法器,其原理是每位相乘后再錯位相加
上傳時間: 2014-08-31
上傳用戶:66666
資源簡介:用vhdl語言編寫的兩個四位二進制數相減,其結果會出現進位
上傳時間: 2015-08-25
上傳用戶:daoxiang126
資源簡介:這是一個連連看游戲程序 用java語言編寫。 對于java游戲編程人員有很大的幫助 是很好的java游戲編程入門程序 通過對本源碼的學習還可以了解連連看這類軟件的功能實現方法。
上傳時間: 2013-11-30
上傳用戶:zl5712176
資源簡介:可以用來查看源碼,因為現在好多的網頁都帶有木馬,所以不能直接打開,就可以用這個打開看到木馬地址!
上傳時間: 2013-12-22
上傳用戶:水口鴻勝電器
資源簡介:基于fpga和sopc的用vhdl語言編寫的EDA8位16進制頻率計
上傳時間: 2016-02-04
上傳用戶:myworkpost
資源簡介:基于fpga和sopc的用vhdl語言編寫的EDA的32位Nios CPU嵌入式系統軟硬件設計
上傳時間: 2016-02-04
上傳用戶:梧桐
資源簡介:基于fpga和sopc的用vhdl語言編寫的EDA的32位Nios CPU嵌入式系統及其DMA設計俄羅斯方塊游戲機
上傳時間: 2013-12-09
上傳用戶:GHF
資源簡介:單片機讀寫u盤的完整程序,代碼全部用c語言編寫。非常有價值的程序。這是本人花2500元購買的開發板源嗎,在此與大家共享。共同提高。
上傳時間: 2013-12-16
上傳用戶:王慶才
資源簡介:詞法分析器代碼,用c語言編寫 詞法分析器代碼,用c語言編寫
上傳時間: 2016-03-06
上傳用戶:zyt
資源簡介:用vhdl語言編寫的PN碼產生程序,希望對大家有所幫助
上傳時間: 2014-07-24
上傳用戶:cc1015285075
資源簡介:此程序用vhdl語言編寫,在四位加法器基礎上完成8位二進制加法,輸出是BCD碼
上傳時間: 2014-11-03
上傳用戶:努力努力再努力
資源簡介:用FPGA實現RS232通信,此代碼是用vhdl語言編寫,非常有用的好東東啊
上傳時間: 2016-07-04
上傳用戶:xiaodu1124
資源簡介:用vhdl語言編寫的LDPC碼硬件實現語言,相對于verilog的,比較簡單
上傳時間: 2016-11-05
上傳用戶:wpt
資源簡介:用vhdl語言編寫設計8位總線收發器,很不錯,大家快下啊
上傳時間: 2017-01-15
上傳用戶:ztj182002
資源簡介:用vhdl語言寫的FIFO代碼,可設FIFO的深度
上傳時間: 2014-01-05
上傳用戶:zhangyi99104144
資源簡介:用vhdl語言編寫的時鐘顯示的源程序代碼
上傳時間: 2014-01-18
上傳用戶:123啊
資源簡介:利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數碼管)之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用vhdl語言實現。這樣設計具有體積小、設計周期短(設計過程中即可實現時序仿真)、調試方便、故障率低、修改升級容易等特點。 本設計采用...
上傳時間: 2014-01-02
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