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基于FPGA的同步數字復接系統的設計.rar

  • 資源大小:3666 K
  • 上傳時間: 2023-10-01
  • 上傳用戶:qdxqdxqdxqdx
  • 資源積分:2 下載積分
  • 標      簽: FPGA

資 源 簡 介

數字復接技術是數字通信網的一項重要技術,能夠將若干路低速信號合并為一路高速信號,進而提高傳輸效率。應用可編程邏輯門陣列(FPGA)芯片實現復接系統便于修改電路結構,增強設計的靈活性,并且節約了系統資源。 本文基于FPGA的同步數字復接系統的設計與建模,首先介紹了EDA技術及其發展,然后對數字復接技術的基木原理進行說明,采用自頂向下的數字系統建模思路,提出了基于FPGA的同步數字復接系統的設計方法,詳細介紹了同步數字復接器和同步數字分接器各組成模塊的設計過程及具體功能,并闡述其設計思想,重點分析了數字分接模塊中幀同步電路和鎖相環提取位同步電路的實現方法,給出了在Quartus II環境下的仿真結果,并對仿真波形進行分析說明。本文設計的數字復接系統的主要功能是在復接端將四個支路的25Mbps數據通過正碼速調整技術,將其合路成一路100 Mbps的高速數據流,在分接端又將此高速數據流恢復成原來的四路25Mbps的數據。整個系統的功能在EDA技術開發平臺上均調試通過,具有較高的實用性和可靠性。

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