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  • 飛思卡爾智能車的舵機(jī)測試程序

    飛思卡爾智能車的舵機(jī)測試程序 #include <hidef.h>      /* common defines and macros */#include <MC9S12XS128.h>     /* derivative information */#pragma LINK_INFO DERIVATIVE "mc9s12xs128" void SetBusCLK_16M(void)             {       CLKSEL=0X00;        PLLCTL_PLLON=1;          //鎖相環(huán)電路允許位    SYNR=0x00 | 0x01;        //SYNR=1    REFDV=0x80 | 0x01;          POSTDIV=0x00;            _asm(nop);              _asm(nop);    while(!(CRGFLG_LOCK==1));       CLKSEL_PLLSEL =1;          } void PWM_01(void) {     //舵機(jī)初始化   PWMCTL_CON01=1;    //0和1聯(lián)合成16位PWM;    PWMCAE_CAE1=0;    //選擇輸出模式為左對齊輸出模式    PWMCNT01 = 0;     //計數(shù)器清零;    PWMPOL_PPOL1=1;    //先輸出高電平,計數(shù)到DTY時,反轉(zhuǎn)電平    PWMPRCLK = 0X40;    //clockA 不分頻,clockA=busclock=16MHz;CLK B 16分頻:1Mhz     PWMSCLA = 0x08;    //對clock SA 16分頻,pwm clock=clockA/16=1MHz;         PWMCLK_PCLK1 = 1;   //選擇clock SA做時鐘源    PWMPER01 = 20000;   //周期20ms; 50Hz;    PWMDTY01 = 1500;   //高電平時間為1.5ms;     PWME_PWME1 = 1;   

    標(biāo)簽: 飛思卡爾智能車 舵機(jī) 測試程序

    上傳時間: 2013-11-04

    上傳用戶:狗日的日子

  • ch451數(shù)碼管驅(qū)動實例程序

    CH451 使用一個系統(tǒng)時鐘信號來同步芯片內(nèi)部的各個功能部件,例如,當(dāng)系統(tǒng)時鐘信號的頻率變高時,顯示驅(qū)動刷新將變快、按鍵響應(yīng)時間將變短、上電復(fù)位信號的寬度將變窄、看門狗周期也將變短。一般情況下,CH451 的系統(tǒng)時鐘信號是由內(nèi)置的阻容振蕩提供的,這樣就不再需要任何外圍電路,但內(nèi)置RC 振蕩的頻率受電源電壓的影響較大,當(dāng)電源電壓降低時,系統(tǒng)時鐘信號的頻率也隨之降低。在某些實際應(yīng)用中,可能希望CH451 提供更長或者更短的顯示刷新周期、按鍵響應(yīng)時間等,這時就需要調(diào)節(jié)系統(tǒng)時鐘信號的頻率。CH451 提供了CLK 引腳,用于外接阻容振蕩。當(dāng)在CLK 引腳與地GND 之間跨接電容后,系統(tǒng)時鐘信號的頻率將變低;當(dāng)在CLK 引腳與正電源VCC 之間跨接電阻后,系統(tǒng)時鐘信號的頻率將變高。因為CH451 的系統(tǒng)時鐘信號被用于芯片內(nèi)部的所有功能部件,所以其頻率不宜進(jìn)行大幅度的調(diào)節(jié),一般情況下,跨接電容的容量在5pF 至100pF 之間,跨接電阻的阻值在20KΩ至500KΩ之間。跨接一個47pF 的電容則頻率降低為一半,跨接一個47KΩ的電阻則頻率升高為兩倍。另外,CH451 的CLK 引腳可以直接輸入外部的系統(tǒng)時鐘信號,但外部電路的驅(qū)動能力不能小于±2mA。CH451 在CLKO 引腳提供了系統(tǒng)時鐘信號的二分頻輸出,對于一些不要求精確定時的實際應(yīng)用,可以由CLKO 引腳向單片機(jī)提供時鐘信號,簡化外圍電路。 單片機(jī)接口程序下面提供了U1(MCS-51 單片機(jī))與U2(CH451)的接口程序,供參考。;**********************;需要主程序定義的參數(shù)CH451_DCLK BIT P1.7 ;串行數(shù)據(jù)時鐘,上升沿激活CH451_DIN BIT P1.6 ;串行數(shù)據(jù)輸出,接CH451 的數(shù)據(jù)輸入CH451_LOAD BIT P1.5 ;串行命令加載,上升沿激活CH451_DOUT BIT P3.2 ;INT0,鍵盤中斷和鍵值數(shù)據(jù)輸入,接CH451 的數(shù)據(jù)輸出CH451_KEY DATA 7FH ;存放鍵盤中斷中讀取的鍵值

    標(biāo)簽: 451 ch 數(shù)碼管 實例程序

    上傳時間: 2013-11-22

    上傳用戶:671145514

  • Arduino學(xué)習(xí)筆記4_Arduino軟件模擬PWM

    注:1.這篇文章斷斷續(xù)續(xù)寫了很久,畫圖技術(shù)也不精,難免錯漏,大家湊合看.有問題可以留言.      2.論壇排版把我的代碼縮進(jìn)全弄沒了,大家將代碼粘貼到arduino編譯器,然后按ctrl+T重新格式化代碼格式即可看的舒服. 一、什么是PWM PWM 即Pulse Wavelength Modulation 脈寬調(diào)制波,通過調(diào)整輸出信號占空比,從而達(dá)到改 變輸出平均電壓的目的。相信Arduino 的PWM 大家都不陌生,在Arduino Duemilanove 2009 中,有6 個8 位精度PWM 引腳,分別是3, 5, 6, 9, 10, 11 腳。我們可以使用analogWrite()控 制PWM 腳輸出頻率大概在500Hz 的左右的PWM 調(diào)制波。分辨率8 位即2 的8 次方等于 256 級精度。但是有時候我們會覺得6 個PWM 引腳不夠用。比如我們做一個10 路燈調(diào)光, 就需要有10 個PWM 腳。Arduino Duemilanove 2009 有13 個數(shù)字輸出腳,如果它們都可以 PWM 的話,就能滿足條件了。于是本文介紹用軟件模擬PWM。 二、Arduino 軟件模擬PWM Arduino PWM 調(diào)壓原理:PWM 有好幾種方法。而Arduino 因為電源和實現(xiàn)難度限制,一般 使用周期恒定,占空比變化的單極性PWM。 通過調(diào)整一個周期里面輸出腳高/低電平的時間比(即是占空比)去獲得給一個用電器不同 的平均功率。 如圖所示,假設(shè)PWM 波形周期1ms(即1kHz),分辨率1000 級。那么需要一個信號時間 精度1ms/1000=1us 的信號源,即1MHz。所以說,PWM 的實現(xiàn)難點在于需要使用很高頻的 信號源,才能獲得快速與高精度。下面先由一個簡單的PWM 程序開始: const int PWMPin = 13; int bright = 0; void setup() { pinMode(PWMPin, OUTPUT); } void loop() { if((bright++) == 255) bright = 0; for(int i = 0; i < 255; i++) { if(i < bright) { digitalWrite(PWMPin, HIGH); delayMicroseconds(30); } else { digitalWrite(PWMPin, LOW); delayMicroseconds(30); } } } 這是一個軟件PWM 控制Arduino D13 引腳的例子。只需要一塊Arduino 即可測試此代碼。 程序解析:由for 循環(huán)可以看出,完成一個PWM 周期,共循環(huán)255 次。 假設(shè)bright=100 時候,在第0~100 次循環(huán)中,i 等于1 到99 均小于bright,于是輸出PWMPin 高電平; 然后第100 到255 次循環(huán)里面,i 等于100~255 大于bright,于是輸出PWMPin 低電平。無 論輸出高低電平都保持30us。 那么說,如果bright=100 的話,就有100 次循環(huán)是高電平,155 次循環(huán)是低電平。 如果忽略指令執(zhí)行時間的話,這次的PWM 波形占空比為100/255,如果調(diào)整bright 的值, 就能改變接在D13 的LED 的亮度。 這里設(shè)置了每次for 循環(huán)之后,將bright 加一,并且當(dāng)bright 加到255 時歸0。所以,我們 看到的最終效果就是LED 慢慢變亮,到頂之后然后突然暗回去重新變亮。 這是最基本的PWM 方法,也應(yīng)該是大家想的比較多的想法。 然后介紹一個簡單一點的。思維風(fēng)格完全不同。不過對于驅(qū)動一個LED 來說,效果與上面 的程序一樣。 const int PWMPin = 13; int bright = 0; void setup() { pinMode(PWMPin, OUTPUT); } void loop() { digitalWrite(PWMPin, HIGH); delayMicroseconds(bright*30); digitalWrite(PWMPin, LOW); delayMicroseconds((255 - bright)*30); if((bright++) == 255) bright = 0; } 可以看出,這段代碼少了一個For 循環(huán)。它先輸出一個高電平,然后維持(bright*30)us。然 后輸出一個低電平,維持時間((255-bright)*30)us。這樣兩次高低就能完成一個PWM 周期。 分辨率也是255。 三、多引腳PWM Arduino 本身已有PWM 引腳并且運行起來不占CPU 時間,所以軟件模擬一個引腳的PWM 完全沒有實用意義。我們軟件模擬的價值在于:他能將任意的數(shù)字IO 口變成PWM 引腳。 當(dāng)一片Arduino 要同時控制多個PWM,并且沒有其他重任務(wù)的時候,就要用軟件PWM 了。 多引腳PWM 有一種下面的方式: int brights[14] = {0}; //定義14個引腳的初始亮度,可以隨意設(shè)置 int StartPWMPin = 0, EndPWMPin = 13; //設(shè)置D0~D13為PWM 引腳 int PWMResolution = 255; //設(shè)置PWM 占空比分辨率 void setup() { //定義所有IO 端輸出 for(int i = StartPWMPin; i <= EndPWMPin; i++) { pinMode(i, OUTPUT); //隨便定義個初始亮度,便于觀察 brights[ i ] = random(0, 255); } } void loop() { //這for 循環(huán)是為14盞燈做漸亮的。每次Arduino loop()循環(huán), //brights 自增一次。直到brights=255時候,將brights 置零重新計數(shù)。 for(int i = StartPWMPin; i <= EndPWMPin; i++) { if((brights[i]++) == PWMResolution) brights[i] = 0; } for(int i = 0; i <= PWMResolution; i++) //i 是計數(shù)一個PWM 周期 { for(int j = StartPWMPin; j <= EndPWMPin; j++) //每個PWM 周期均遍歷所有引腳 { if(i < brights[j])\   所以我們要更改PWM 周期的話,我們將精度(代碼里面的變量:PWMResolution)降低就行,比如一般調(diào)整LED 亮度的話,我們用64 級精度就行。這樣速度就是2x32x64=4ms。就不會閃了。

    標(biāo)簽: Arduino PWM 軟件模擬

    上傳時間: 2013-10-08

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  • 基于FPGA的交通路口車流量檢測方法研究

    為了使車流在交通路口順暢通過,通常需要統(tǒng)計一個交通信號燈周期內(nèi)的車流量,以實現(xiàn)交通信號燈的自動配時。文中提出了一種交通路口的車流量檢測算法。通過在道路前方設(shè)置檢測線,進(jìn)而統(tǒng)計檢測線灰度變化的情況,即可統(tǒng)計出通過的車流量。并對其進(jìn)行FPGA的硬件仿真。實驗結(jié)果表明,此方法實現(xiàn)簡單,運算處理速度快,能夠得到較滿意的結(jié)果。

    標(biāo)簽: FPGA 交通路口 車流量檢測 方法研究

    上傳時間: 2014-01-17

    上傳用戶:simonpeng

  • Altium Designer 6 三維元件庫建模教程

    Altium Designer 6 三維元件庫建模教程 文檔名稱:AD系列軟件三維元件庫建模教程 文檔描述:介紹在 AltiumDesigner集成開發(fā)平臺下三維模型建立和使用方法 文檔版本:V1.0 作     者:林加添(lineay) 編寫時間:2009 年1 月 QQ:181346072 第一章:介紹 在傳統(tǒng)的電子整機(jī)設(shè)計過程中,電路設(shè)計部門和結(jié)構(gòu)設(shè)計部門(或者由外部設(shè)計工作室設(shè)計)往往是被分為 兩個完全獨立的部門,因此在新產(chǎn)品開發(fā)過程中,都是結(jié)構(gòu)設(shè)計好了,然后出內(nèi)部 PCB 位置圖給 PCB 工程師, 而結(jié)構(gòu)工程師并不了解電路設(shè)計過程中一些要點。對 PCB布局一些高度較高元器件位置很多并不符合 PCB 工程 師電路設(shè)計的要求。以至 PCB 工程師不得不將就結(jié)構(gòu)工程師所設(shè)計的元件布局。最后產(chǎn)品出來時,因為 PCB 布 局不合理等各種因素,問題百出。這不僅影響產(chǎn)品開發(fā)速度。也會導(dǎo)致企業(yè)兩部門之間發(fā)生沖突。 然而目前國內(nèi)大多的電子企業(yè)都是停留于這種狀態(tài),關(guān)鍵原因目前電路部門和結(jié)構(gòu)部門沒有一個有效、快捷 的軟件協(xié)作接口來幫助兩個部分之間更好協(xié)調(diào)工作、來有效提高工作效率。而面對競爭日益激烈的市場。時間就 是金錢,產(chǎn)品開發(fā)周期加長而導(dǎo)致開發(fā)成本加劇,也延誤了產(chǎn)品上市的時間。這不僅降低了企業(yè)在市場的競爭力 也加速了企業(yè)倒退的步伐。對于企業(yè)來說,都希望有一個有效的協(xié)調(diào)接口來加速整機(jī)的開發(fā)速度,從而提高產(chǎn)品

    標(biāo)簽: Designer Altium 元件庫 建模

    上傳時間: 2013-11-16

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  • 基于FPGA數(shù)字電壓表的設(shè)計報告

    基于FPGA數(shù)字電壓表的設(shè)計   EDA是電子設(shè)計自動化(Electronic Design Automation)的縮寫,在20世紀(jì)60年代中期從計算機(jī)輔助設(shè)計(CAD)、計算機(jī)輔助制造(CAM)、計算機(jī)輔助測試(CAT)和計算機(jī)輔助工程(CAE)的概念發(fā)展而來的。 EDA技術(shù)就是以計算機(jī)為工具,設(shè)計者在EDA軟件平臺上,用硬件描述語言VHDL完成設(shè)計文件,然后由計算機(jī)自動地完成邏輯編譯、化簡、分割、綜合、優(yōu)化、布局、布線和仿真,直至對于特定目標(biāo)芯片的適配編譯、邏輯映射和編程下載等工作。本電壓表的電路設(shè)計正是用VHDL語言完成的 。此次設(shè)計采用的是Altera公司 的Quartus II 7.0軟件。本次設(shè)計的參考電壓為2.5V,精度為0.01V。此電壓表的設(shè)計特點為通過軟件編程下載到硬件實現(xiàn),設(shè)計周期短,開發(fā)效率高。

    標(biāo)簽: FPGA 數(shù)字電壓表 報告

    上傳時間: 2013-10-22

    上傳用戶:Shaikh

  • 基于SCF及CPLD的程控濾波電路設(shè)計

      SCF原理的基礎(chǔ)是開關(guān)電容與電阻的等效:在電容兩端開關(guān)控 制下,電容被充放電,電荷的轉(zhuǎn)移過程產(chǎn)生脈沖電流,可以計算其平均值。當(dāng)開關(guān)頻率足夠快時,該電流等效于流過電阻的電流,可看作是電阻被開關(guān)電容取代。可 以證明,電阻R可表示為開關(guān)電容Ck與開關(guān)切換周期T的比值:

    標(biāo)簽: CPLD SCF 程控濾波 電路設(shè)計

    上傳時間: 2013-10-22

    上傳用戶:manga135

  • 中興通訊硬件巨作:信號完整性基礎(chǔ)知識

    中興通訊硬件一部巨作-信號完整性 近年來,通訊技術(shù)、計算機(jī)技術(shù)的發(fā)展越來越快,高速數(shù)字電路在設(shè)計中的運用越來 越多,數(shù)字接入設(shè)備的交換能力已從百兆、千兆發(fā)展到幾十千兆。高速數(shù)字電路設(shè)計對信 號完整性技術(shù)的需求越來越迫切。 在中、 大規(guī)模電子系統(tǒng)的設(shè)計中, 系統(tǒng)地綜合運用信號完整性技術(shù)可以帶來很多好處, 如縮短研發(fā)周期、降低產(chǎn)品成本、降低研發(fā)成本、提高產(chǎn)品性能、提高產(chǎn)品可靠性。 數(shù)字電路在具有邏輯電路功能的同時,也具有豐富的模擬特性,電路設(shè)計工程師需要 通過精確測定、或估算各種噪聲的幅度及其時域變化,將電路抗干擾能力精確分配給各種 噪聲,經(jīng)過精心設(shè)計和權(quán)衡,控制總噪聲不超過電路的抗干擾能力,保證產(chǎn)品性能的可靠 實現(xiàn)。 為了滿足中興上研一所的科研需要, 我們在去年和今年關(guān)于信號完整性技術(shù)合作的基 礎(chǔ)上,克服時間緊、任務(wù)重的困難,編寫了這份硬件設(shè)計培訓(xùn)系列教材的“信號完整性” 部分。由于我們的經(jīng)驗和知識所限,這部分教材肯定有不完善之處,歡迎廣大讀者和專家 批評指正。 本教材的對象是所內(nèi)硬件設(shè)計工程師, 針對我所的實際情況, 選編了第一章——導(dǎo)論、 第二章——數(shù)字電路工作原理、第三章——傳輸線理論、第四章——直流供電系統(tǒng)設(shè)計, 相信會給大家?guī)硪嫣帯M瑫r,也希望通過我們的不懈努力能消除大家在信號完整性方面 的煩腦。 在編寫本教材的過程中,得到了沙國海、張亞東、沈煜、何廣敏、鐘建兔、劉輝、曹 俊等的指導(dǎo)和幫助,尤其在審稿時提出了很多建設(shè)性的意見,在此一并致謝!

    標(biāo)簽: 中興通訊 硬件 信號完整性 基礎(chǔ)知識

    上傳時間: 2013-11-03

    上傳用戶:奇奇奔奔

  • 基于FPGA的多功能頻率計的設(shè)計

    基于Altera公司FPGA芯片EP2C8Q208,嵌入MC8051 IP Core,用C語言對MC8051 IP Core進(jìn)行編程,以其作為控制核心,實現(xiàn)系統(tǒng)控制。在FPGA芯片中,利用Verilog HDL語言進(jìn)行編程,設(shè)計了以MC8051 IP Core為核心的控制模塊、計數(shù)模塊、鎖存模塊和LCD顯示模塊等幾部分,實現(xiàn)了頻率的自動測量,測量范圍為0.1Hz~50MHz,測量誤差0.01%。并實現(xiàn)測頻率、周期、占空比等功能。  

    標(biāo)簽: FPGA 多功能 頻率計

    上傳時間: 2013-10-27

    上傳用戶:潛水的三貢

  • 采用基于FPGA 的方法縮短高級醫(yī)療內(nèi)窺鏡系統(tǒng)的開發(fā)時間

      電子發(fā)燒友網(wǎng)核心提示:醫(yī)療內(nèi)窺鏡的市場發(fā)展帶來了各種挑戰(zhàn),例如,要求增強(qiáng)功能,更高的精度,更好的處理性能,以及更小的體積等。本文介紹Altera高級醫(yī)療內(nèi)窺鏡系統(tǒng)解決方案,它使用了1080p視頻設(shè)計工作臺、DSP 構(gòu)建模塊、參考設(shè)計,以及 Stratix® V、Cyclone® V 和 Arria® V FPGA 等。通過下文介紹,資深專家向您支招,教你懂得如何通過采用基于FPGA的方法來縮短高級醫(yī)療內(nèi)窺鏡系統(tǒng)的開發(fā)時間。   引言   對內(nèi)窺鏡檢查的需求在不斷增長,同時還需要不斷改進(jìn)檢查過程,增強(qiáng)醫(yī)療設(shè)備的功能。全球競爭不斷加劇,導(dǎo)致各種新功能的出現(xiàn),新市場的變化也非常快,開發(fā)周期越來越短,工程團(tuán)隊必須集中精力提高核心競爭力,加強(qiáng)系統(tǒng)知識。工程師需要靈活的硬件平臺和支持各種平臺的工作臺工具,使他們能夠針對新標(biāo)準(zhǔn)或者標(biāo)準(zhǔn)的變化而對產(chǎn)品進(jìn)行更新。此外,設(shè)計團(tuán)隊必須更高效的進(jìn)行開發(fā)工作。Altera® 1080p 視頻設(shè)計工作臺和28-nm FPGA提供了靈活的系統(tǒng)方法來滿足當(dāng)前以及不斷發(fā)展的功能需求。   不斷增長的全球需求   很多因素導(dǎo)致對內(nèi)窺鏡檢查的需求越來越強(qiáng)。今后數(shù)十年內(nèi),世界60歲以上的人口數(shù)量將會大幅度增長,對醫(yī)療衛(wèi)生服務(wù)的需求也會隨之增長。而且,胃腸道患病人口在不斷增加,需要進(jìn)行檢查和治療。越來越多的醫(yī)生采用內(nèi)窺鏡檢查方法。很多政府報銷政策鼓勵非置入式治療,這有利于患者更快的恢復(fù),從而降低了治療總成本,患者的體驗會更好。   很多國家增加了在醫(yī)療基礎(chǔ)設(shè)施上的投入,特別是加大了醫(yī)療設(shè)備的采購。反過來,這些新市場需求也擴(kuò)大了對下一代內(nèi)窺鏡系統(tǒng)的需求。設(shè)計團(tuán)隊體驗到需求的不斷增長,而全球競爭導(dǎo)致他們推遲其產(chǎn)品發(fā)布計劃。

    標(biāo)簽: FPGA 內(nèi)窺鏡

    上傳時間: 2013-12-19

    上傳用戶:xc216

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