148個(gè)verilog hdl小程序（有很多testbench）——.
標(biāo)簽： testbench verilog 148 hdl
上傳時(shí)間： 2015-01-28
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Visual C++5 Active X編程指南
標(biāo)簽： Visual Active 編程指南
上傳時(shí)間： 2014-08-31
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用于計(jì)算CRC的verilog HDL源碼
標(biāo)簽： verilog CRC HDL 計(jì)算
上傳時(shí)間： 2015-02-07
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用verilog HDL寫的操作SRAM的源碼
標(biāo)簽： verilog SRAM HDL 操作
上傳用戶：sy_jiadeyi
用verilog HDL實(shí)現(xiàn)曼徹斯特編碼的源碼
標(biāo)簽： verilog HDL 曼徹斯特編碼 源碼
上傳時(shí)間： 2013-12-29
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hdl優(yōu)化設(shè)計(jì)十大戒律-轉(zhuǎn)載
標(biāo)簽： hdl 優(yōu)化設(shè)計(jì)
上傳時(shí)間： 2014-05-29
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Computer Architecture Handbook on Verilog HDL
標(biāo)簽： Architecture Computer Handbook Verilog
上傳時(shí)間： 2015-03-15
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verilog hdl教程135例:verilog hdl語(yǔ)言類似于C語(yǔ)言，便于學(xué)習(xí)。本文檔帶有源代碼，3-6章
標(biāo)簽： verilog hdl 135 C語(yǔ)言
上傳時(shí)間： 2013-12-12
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verilog hdl教程135例:verilog hdl語(yǔ)言類似于C語(yǔ)言，便于學(xué)習(xí)。本文檔帶有源代碼，7-8章
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verilog hdl教程135例:verilog hdl語(yǔ)言類似于C語(yǔ)言，便于學(xué)習(xí)。本文檔帶有源代碼，9-10章
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