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Verilog 下 16位除法算法程序

  • 資源大小:144 K
  • 上傳時(shí)間: 2013-11-26
  • 上傳用戶:susanxuwenjun
  • 資源積分:2 下載積分
  • 標(biāo)      簽: Verilog 除法 算法 程序

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Verilog 下 16位除法算法程序,高精度,固定17個(gè)時(shí)鐘周期

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