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本系統使用VHDL語言進行設計

  • 資源大小:292 K
  • 上傳時間: 2016-01-21
  • 上傳用戶:dongjunxi126
  • 資源積分:2 下載積分
  • 標      簽: VHDL 語言

資 源 簡 介

本系統使用VHDL語言進行設計,采用自上向下的設計方法。目標器件選用Xilinx公司的FPGA器件,并利用Xilinx ISE 7.1 進行VHDL程序的編譯與綜合,然后用Modelsim Xilinx Edition 6.1進行功能仿真和時序仿真。

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