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  標(biāo)簽： xlisp 單片機(jī) 使用手冊(cè)

  上傳時(shí)間： 2013-11-13

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• 使用Verilog硬件描述語(yǔ)言編程的38譯碼器免費(fèi)下載

  資源簡(jiǎn)介：使用Verilog硬件描述語(yǔ)言編程的38譯碼器，包含測(cè)試描述

  標(biāo)簽： Verilog 硬件描述語(yǔ)言 編程 譯碼器

  上傳時(shí)間： 2014-01-23

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• 38譯碼器的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：38譯碼器的設(shè)計(jì)，使用vhdl設(shè)計(jì)譯碼器，可以下載到開(kāi)發(fā)板上看結(jié)果

  標(biāo)簽： 譯碼器

  上傳時(shí)間： 2013-12-17

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• 程序提供了一種高效簡(jiǎn)單的38譯碼器的算法免費(fèi)下載

  資源簡(jiǎn)介：程序提供了一種高效簡(jiǎn)單的38譯碼器的算法，非常實(shí)用

  標(biāo)簽： 程序 譯碼器 算法

  上傳時(shí)間： 2016-11-14

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• 本文為用vhdl語(yǔ)言編寫的38譯碼器免費(fèi)下載

  資源簡(jiǎn)介：本文為用vhdl語(yǔ)言編寫的38譯碼器，為doc格式，請(qǐng)先復(fù)制到相應(yīng)軟件例如maxplus中再使用。

  標(biāo)簽： vhdl 語(yǔ)言 編寫 譯碼器

  上傳時(shí)間： 2013-12-21

  上傳用戶：思琦琦

• 有VHDL寫的一個(gè)38譯碼器,并付仿真波形.免費(fèi)下載

  資源簡(jiǎn)介：有VHDL寫的一個(gè)38譯碼器,并付仿真波形.

  標(biāo)簽： VHDL 譯碼器 仿真 波形

  上傳時(shí)間： 2014-01-25

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• 基于quartus II軟件 用verilog 語(yǔ)言描述的38譯碼器免費(fèi)下載

  資源簡(jiǎn)介：基于quartus II軟件 用verilog 語(yǔ)言描述的38譯碼器

  標(biāo)簽： quartus verilog 軟件 語(yǔ)言

  上傳時(shí)間： 2013-12-01

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• 簡(jiǎn)單的38譯碼器,語(yǔ)句較為簡(jiǎn)捷明了.供大家參考學(xué)習(xí).免費(fèi)下載

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  標(biāo)簽： 譯碼器 家

  上傳時(shí)間： 2017-07-21

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• 基于VDHL的38譯碼器的實(shí)現(xiàn)與58分頻器的實(shí)現(xiàn) FPGA主芯片：CycloneII EP2C35F672C6免費(fèi)下載

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  標(biāo)簽： CycloneII VDHL FPGA 672C

  上傳時(shí)間： 2014-01-17

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• 38譯碼器VHDL語(yǔ)言免費(fèi)下載

  資源簡(jiǎn)介：文件是3線-8線譯碼器的VHDL語(yǔ)言實(shí)現(xiàn)，非常簡(jiǎn)單，僅供參考！！！

  標(biāo)簽： VHDL 譯碼器 語(yǔ)言

  上傳時(shí)間： 2020-05-06

  上傳用戶：nathan1112

• 高速Viterbi譯碼器的FPGA實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：本文提出了一種高速Viterbi譯碼器的FPGA實(shí)現(xiàn)方案。這種Viterbi譯碼器的設(shè)計(jì)方案既可以制成高性能的單片差錯(cuò)控制器，也可以集成到大規(guī)模ASIC通信芯片中，作為全數(shù)字接收的一部分。 本文所設(shè)計(jì)的Viterbi譯碼器采用了基四算法，與基二算法相比，其譯碼速率在理論...

  標(biāo)簽： Viterbi FPGA 譯碼器

  上傳時(shí)間： 2013-04-24

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• 大學(xué)vhdl語(yǔ)言實(shí)驗(yàn)大全,基于max-plus2平臺(tái),內(nèi)有8-3譯碼器,8位加法器,數(shù)字鐘免費(fèi)下載

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  標(biāo)簽： max-plus vhdl 大學(xué) 加法器

  上傳時(shí)間： 2013-12-23

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• 50V50A移相全橋ZVSDCDC變換器的設(shè)計(jì).rar免費(fèi)下載

  資源簡(jiǎn)介：隨著通訊技術(shù)和電力系統(tǒng)的發(fā)展，對(duì)通訊用電源和電力操作電源的性能、重量、體積、效率和可靠性都提出了更高的要求。而應(yīng)用于中大功率場(chǎng)合的全橋變換器與軟開(kāi)關(guān)的結(jié)合解決了這一問(wèn)題。因此，對(duì)其進(jìn)行研究設(shè)計(jì)具有十分重要的意義。 首先，論文闡述PWM DC/DC變換...

  標(biāo)簽： ZVSDCDC 50V50A 移相全橋

  上傳時(shí)間： 2013-08-04

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• 基于FPGA的Turbo碼編譯碼器設(shè)計(jì).rar免費(fèi)下載

  資源簡(jiǎn)介：作為性能優(yōu)異的糾錯(cuò)編碼，Turbo碼自誕生以來(lái)就一直受到理論界以及工程應(yīng)用界的關(guān)注。TD—SCDMA是我國(guó)擁有自主知識(shí)產(chǎn)權(quán)的3G通信標(biāo)準(zhǔn)，該標(biāo)準(zhǔn)把Turbo碼是作為前向糾錯(cuò)體制，但Turbo碼的譯碼算法比較復(fù)雜并且需要多次迭代，這造成Turbo碼譯碼延時(shí)大，譯碼速度慢...

  標(biāo)簽： Turbo FPGA 編譯碼器

  上傳時(shí)間： 2013-05-31

  上傳用戶：huyiming139

• 74LS138譯碼器應(yīng)用--基于8051+Proteus仿真免費(fèi)下載

  資源簡(jiǎn)介：74LS138譯碼器應(yīng)用--基于8051+Proteus仿真

  標(biāo)簽： Proteus 8051 138 74

  上傳時(shí)間： 2013-10-29

  上傳用戶：taozhihua1314

• 學(xué)單片機(jī)之定時(shí)器部分免費(fèi)下載

  資源簡(jiǎn)介：帶您從零學(xué)單片機(jī)之定時(shí)器部分 課程簡(jiǎn)介1定時(shí)器/計(jì)數(shù)器簡(jiǎn)介2定時(shí)器/計(jì)數(shù)器特殊功能寄存器功能講解3?定時(shí)器/計(jì)數(shù)器工作方式4定時(shí)器/計(jì)數(shù)器相關(guān)計(jì)算5定時(shí)器計(jì)數(shù)器應(yīng)用操作流程6定時(shí)器/計(jì)數(shù)器程序?qū)嵗O(shè)計(jì)17定時(shí)器/計(jì)數(shù)器程序?qū)嵗O(shè)計(jì)28課后作業(yè)

  標(biāo)簽： 單片機(jī) 分 定時(shí)器

  上傳時(shí)間： 2013-11-08

  上傳用戶：tiantian

• 44b0蜂鳴器實(shí)驗(yàn).rar免費(fèi)下載

  資源簡(jiǎn)介：44b0蜂鳴器實(shí)驗(yàn).rar

  標(biāo)簽： 44b0 蜂鳴器 實(shí)驗(yàn)

  上傳時(shí)間： 2015-02-14

  上傳用戶：gyq

• FAT32的部分操作C語(yǔ)言實(shí)現(xiàn)代碼.rar是fat32的c語(yǔ)言實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：FAT32的部分操作C語(yǔ)言實(shí)現(xiàn)代碼.rar是fat32的c語(yǔ)言實(shí)現(xiàn)

  標(biāo)簽： 32 FAT fat

  上傳時(shí)間： 2014-01-03

  上傳用戶：懶龍1988

• 奇異樣本對(duì)感知器神經(jīng)網(wǎng)絡(luò)訓(xùn)練的影響,分三部分:創(chuàng)建感知器神經(jīng)網(wǎng)絡(luò),訓(xùn)練該感知器神經(jīng)網(wǎng)絡(luò),驗(yàn)感器神經(jīng)網(wǎng)絡(luò)免費(fèi)下載

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  標(biāo)簽： 神經(jīng)網(wǎng)絡(luò) 分 樣本

  上傳時(shí)間： 2015-06-14

  上傳用戶：tianjinfan

• MS VC++6.0 程序員指南 第一部分：基礎(chǔ)知識(shí) 第二部分：編輯器 第三部分：編程指南 第四部分：ActiveX控件 第五部分：高級(jí)主題 第六部分：附錄免費(fèi)下載

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  標(biāo)簽： 分 ActiveX 6.0 MS

  上傳時(shí)間： 2013-12-17

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• 本文詳細(xì)介紹了制作電路板的方法及步驟. 實(shí)驗(yàn)板的功能 這個(gè)實(shí)驗(yàn)板可以做如下實(shí)驗(yàn)： 1．可以進(jìn)行運(yùn)算器（加、減、乘和除法）、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實(shí)驗(yàn) 2．可以進(jìn)免費(fèi)下載

  資源簡(jiǎn)介：本文詳細(xì)介紹了制作電路板的方法及步驟. 實(shí)驗(yàn)板的功能 這個(gè)實(shí)驗(yàn)板可以做如下實(shí)驗(yàn)： 1．可以進(jìn)行運(yùn)算器（加、減、乘和除法）、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實(shí)驗(yàn) 2．可以進(jìn)行觸發(fā)器、寄存器、計(jì)數(shù)器和一般時(shí)序電路的實(shí)驗(yàn) 3．可...

  標(biāo)簽： 實(shí)驗(yàn)板 實(shí)驗(yàn) 詳細(xì)介紹 電路板

  上傳時(shí)間： 2015-10-02

  上傳用戶：colinal

• 《JAVA2簡(jiǎn)明教程》部分課后答案及JAVA實(shí)驗(yàn)題目及答案免費(fèi)下載

  資源簡(jiǎn)介：《JAVA2簡(jiǎn)明教程》部分課后答案及JAVA實(shí)驗(yàn)題目及答案

  標(biāo)簽： JAVA2 JAVA 簡(jiǎn)明教程 分

  上傳時(shí)間： 2016-03-18

  上傳用戶：youmo81

• 232界面編碼器部分免費(fèi)下載

  資源簡(jiǎn)介：232界面編碼器部分，非常有用，各位可以看看，很有幫助的。

  標(biāo)簽： 232 編碼器 分

  上傳時(shí)間： 2016-07-08

  上傳用戶：風(fēng)之驕子

• 這是我用Verilog寫的DES加解密程序,準(zhǔn)確的說(shuō)這是一份實(shí)驗(yàn)報(bào)告,里面不但有程序還有簡(jiǎn)單的注釋[主要是針對(duì)仿真的波形的],我主要寫的是主控部分,密鑰生成部分參考了下版原康宏的程序.該程序即可加密也免費(fèi)下載

  資源簡(jiǎn)介：這是我用Verilog寫的DES加解密程序,準(zhǔn)確的說(shuō)這是一份實(shí)驗(yàn)報(bào)告,里面不但有程序還有簡(jiǎn)單的注釋[主要是針對(duì)仿真的波形的],我主要寫的是主控部分,密鑰生成部分參考了下版原康宏的程序.該程序即可加密也可解密,選用CycloneII器件即能跑到100Mhz以上.

  標(biāo)簽： Verilog 程序 DES 分

  上傳時(shí)間： 2013-12-16

  上傳用戶：refent

• 3-8譯碼器的仿真實(shí)驗(yàn)。本實(shí)驗(yàn)選用的仿真開(kāi)發(fā)軟件是MAX+plus II Version 9.3免費(fèi)下載

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  標(biāo)簽： Version plus MAX 9.3

  上傳時(shí)間： 2016-12-14

  上傳用戶：米卡

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  標(biāo)簽： 編碼 數(shù)據(jù)結(jié)構(gòu) 實(shí)驗(yàn) 譯碼器

  上傳時(shí)間： 2017-01-05

  上傳用戶：1079836864

• 卷積碼編譯碼器前段時(shí)間在學(xué)校做通信系統(tǒng)課程設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： 卷積碼 編譯碼器 通信系統(tǒng)

  上傳時(shí)間： 2017-01-28

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• 模擬cmmb系統(tǒng)中l(wèi)dpc譯碼的部分免費(fèi)下載

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  標(biāo)簽： cmmb ldpc 模擬 分

  上傳時(shí)間： 2013-12-04

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  標(biāo)簽： 7758 ade 讀寫程序 初始化

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