veilog實現的狀態機乘法器.可以參考
標簽： veilog 狀態 乘法器
上傳時間： 2013-12-31
上傳用戶：yulg
該源碼實現了一個8*8位的乘法器，在實現的過程中用到了宏單元
標簽： 源碼 乘法器
上傳時間： 2013-12-28
上傳用戶：bakdesec
布斯乘法器的VHDL程序,下載後直接解壓縮複製貼上到你的EDATOOL就可以.
標簽： EDATOOL VHDL 乘法器 程序
上傳時間： 2015-05-20
上傳用戶：zycidjl
這是用vhdl編寫的四位加法器，請多指教
標簽： vhdl 編寫 加法器
上傳時間： 2013-12-12
上傳用戶：yepeng139
基于maxplus2的八位加法器，已經通過仿真
標簽： maxplus2 加法器
上傳時間： 2014-01-19
上傳用戶：cc1
數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述，集成在一個模塊中，提供VHDL源程序供大家學習和討論。
標簽： VHDL 寄存器 數控振蕩器 加法器
上傳時間： 2014-08-31
上傳用戶：yan2267246
加法器 乘法器電路 除法器電路設計 鍵盤掃描電路設計 顯示電路
標簽： 電路設計 加法器 乘法器 電路
上傳時間： 2015-05-29
上傳用戶：671145514
加法器核，帶進位位的，xilinx公司的核，能用
標簽： 加法器
上傳時間： 2015-05-31
上傳用戶：gtf1207
verilog shi 實現的加法器（8位）適用于初學asic
標簽： verilog asic shi 8位
上傳時間： 2015-06-02
上傳用戶：一諾88
本系統基于直接數字頻率合成技術；以凌陽SPCE061A單片機為控制核心；采用寬帶運放AD811和AGC技術使得50Ω負載上峰值達到6V±1V；由模擬乘法器AD835產生調幅信號；由數控電位器程控調制度；通過單片機改變頻率字實現調頻信號，最大頻偏可控；通過模擬開關產生ASK、PSK信號。系統的頻率范圍在100Hz～12MHz,穩定度優于10-5，最小步進為10Hz
標簽： SPCE 061A AD 061
上傳時間： 2015-06-03
上傳用戶：清風冷雨
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