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verilog-ieee

Verilog 編寫的fir濾波器

Verilog 編寫的fir濾波器，可以實現fir濾波器的功能

標簽： Verilog fir 編寫濾波器

上傳時間： 2014-09-08

上傳用戶：gundamwzc
THE STANDDART OF ESD FORM IEEE,IEEE的ESD標準。非常珍貴的設計參考資料

THE STANDDART OF ESD FORM IEEE,IEEE的ESD標準。非常珍貴的設計參考資料，從事這方面的人士不得不看。

標簽： IEEE STANDDART ESD FORM

上傳時間： 2014-01-03

上傳用戶：qiao8960
verilog 實現幀同步,比較簡短的一個程序

verilog 實現幀同步,比較簡短的一個程序

標簽： verilog 幀同步比較程序

上傳時間： 2015-10-28

上傳用戶：jennyzai
File: multipath_sim.m Matlab Simulink IEEE 802.15.3a compliant channel model

File: multipath_sim.m Matlab Simulink IEEE 802.15.3a compliant channel model

標簽： multipath_sim compliant Simulink channel

上傳時間： 2015-10-30

上傳用戶：Divine
一個小單片機的verilog源代碼, 包含說明文檔

一個小單片機的verilog源代碼, 包含說明文檔

標簽： verilog 單片機源代碼文檔

上傳時間： 2013-12-05

上傳用戶：gaojiao1999
同步FIFO的verilog編碼同步FIFO的verilog編碼

同步FIFO的verilog編碼同步FIFO的verilog編碼

標簽： verilog FIFO 編碼

上傳時間： 2013-12-30

上傳用戶：gonuiln
fifo verilog hdl 源程序

fifo verilog hdl 源程序

標簽： verilog fifo hdl 源程序

上傳時間： 2014-01-01

上傳用戶：我干你啊
Verilog-HDL編寫規范-非常全,非常適合初學者

Verilog-HDL編寫規范-非常全,非常適合初學者

標簽： Verilog-HDL 編寫初學者

上傳時間： 2013-12-22

上傳用戶：aappkkee
verilog中的一個不用狀態機和決斷函數就可以實現多重函數賦值的例子

verilog中的一個不用狀態機和決斷函數就可以實現多重函數賦值的例子，希望對你用幫助。

標簽： verilog 函數狀態多重

上傳時間： 2014-01-14

上傳用戶：2525775
< 大型RISC處理器設計--用描述語言Verilog設計VLSI芯片>>光盤

< 大型RISC處理器設計--用描述語言Verilog設計VLSI芯片>>光盤

標簽： Verilog RISC VLSI gt

上傳時間： 2015-11-01

上傳用戶：hebmuljb