用VHDL語言在FPGA或者CPLD上實現任意波形的產生
資源簡介:用VHDL語言在FPGA或者CPLD上實現任意波形的產生
上傳時間: 2013-12-18
上傳用戶:playboys0
資源簡介:用VHDL語言在FPGA上實現浮點運算,大家共享
上傳時間: 2013-08-19
上傳用戶:epson850
資源簡介:用VHDL語言在FPGA上實現浮點運算,大家共享
上傳時間: 2013-12-24
上傳用戶:a6697238
資源簡介:在FPGA或CPLD上實現的一中非常實用的倍頻電路,只要輸入頻率高,精度就很高
上傳時間: 2014-08-30
上傳用戶:jkhjkh1982
資源簡介:利用FPGA的資源實現任意波形的產生,再若和單片機配合就能做成任意的波形發生器。
上傳時間: 2014-08-22
上傳用戶:shus521
資源簡介:用VHDL語言在CPLD/FPGA上實現浮點運算的方法
上傳時間: 2013-09-05
上傳用戶:life840315
資源簡介:用VHDL語言在CPLD/FPGA上實現浮點運算的方法
上傳時間: 2015-04-27
上傳用戶:fandeshun
資源簡介:用VHDL語言在CPLD/FPGA上實現浮點運算,資源多多共享,不亦樂乎!
上傳時間: 2014-01-21
上傳用戶:invtnewer
資源簡介:用VHDL語言在CPLD上實現串行通信
上傳時間: 2013-09-06
上傳用戶:q3290766
資源簡介:用VHDL語言在CPLD上實現串行通信
上傳時間: 2014-01-03
上傳用戶:jackgao
資源簡介:智能全數字鎖相環的設計用VHDL語言在CPLD上實現串行通信
上傳時間: 2014-01-08
上傳用戶:weiwolkt
資源簡介:錯誤檢測與糾正電路的設計與實現用VHDL語言在CPLD上實現串行通信.doc
上傳時間: 2015-11-06
上傳用戶:hwl453472107
資源簡介:用verilog語言在FPGA中實現fifo功能!
上傳時間: 2015-05-02
上傳用戶:epson850
資源簡介:用Verilog語言在FPGA內實現一256個采樣點的正弦波,已嘗試,挺好用的~~~
上傳時間: 2017-03-18
上傳用戶:685
資源簡介:lab1——FPGA這個文件中體統了如何如何使用verilog Hdl以及如何使其在FPGA開發板上實現
上傳時間: 2013-08-18
上傳用戶:qwe1234
資源簡介:verilog語言在maxII系列芯片上實現iic功能
上傳時間: 2013-12-15
上傳用戶:1583060504
資源簡介:lab1——FPGA這個文件中體統了如何如何使用verilog Hdl以及如何使其在FPGA開發板上實現
上傳時間: 2014-10-29
上傳用戶:stella2015
資源簡介:在max_plus2和FPGA實驗箱上實現頻率計的功能,原創
上傳時間: 2013-12-31
上傳用戶:silenthink
資源簡介:這是在C5000系列DSP上實現FIR濾波器的源碼,是用匯編語言編寫的,可直接在CCS上運行
上傳時間: 2016-06-12
上傳用戶:aeiouetla
資源簡介:本程序能夠在dsp2812擴展板上實現播放音樂的功能
上傳時間: 2013-12-21
上傳用戶:hongmo
資源簡介:用matlab語言和多小波方法實現了數據的壓縮功能,可以實現已經驗證過了
上傳時間: 2014-10-29
上傳用戶:rocketrevenge
資源簡介:在EPM570開發板上實現LED控制的程序
上傳時間: 2017-01-15
上傳用戶:lz4v4
資源簡介:這是用于檢測心電信號QRS波的源碼用來雙正交小波能夠實現QRS波形的準確檢測
上傳時間: 2014-01-21
上傳用戶:奇奇奔奔
資源簡介:用VHDL語言編寫的乒乓球游戲,可在CPLD上實現,具體的資料見文檔內部
上傳時間: 2014-02-24
上傳用戶:woshini123456
資源簡介:利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數碼管)之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用VHDL語言實現。這樣設計具有體積小、設計周期短(設計過程中即可實現時序仿真)、調試方便、故障率低、修改升級容易等特點
上傳時間: 2013-08-11
上傳用戶:hn891122
資源簡介:利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數碼管)之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用VHDL語言實現。這樣設計具有體積小、設計周期短(設計過程中即可實現時序仿真)、調試方便、故障率低、修改升級容易等特點。 本設計采用...
上傳時間: 2014-01-02
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資源簡介:利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數碼管)之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用VHDL語言實現。這樣設計具有體積小、設計周期短(設計過程中即可實現時序仿真)、調試方便、故障率低、修改升級容易等特點
上傳時間: 2013-12-26
上傳用戶:qwe1234
資源簡介:用VHDL 語言設計交通燈控制系統, 并在MAX+PLUS II 系統對FPGA/ CPLD 芯片進行下載, 由于生成的是集成化的數字電 路, 沒有傳統設計中的接線問題, 所以故障率低、可靠性高, 而且體積小。體現了EDA 技術在數字電路設計中的優越性。
上傳時間: 2013-12-28
上傳用戶:zhengzg
資源簡介:用VHDL語言設計基于FPGA器件的高采樣率FIR濾波器,基于VHDL與CPLD器件的FIR數字濾波器的設計
上傳時間: 2013-08-07
上傳用戶:ukuk
資源簡介:一個用VHDL編寫的在CPLD上實現模擬交通燈的程序源代碼
上傳時間: 2014-01-24
上傳用戶:宋桃子