常用2、4、6及任意偶數(shù)分頻器的VHDL代碼實(shí)現(xiàn)（原創(chuàng)）
資源簡介：常用2、4、6及任意偶數(shù)分頻器的VHDL代碼實(shí)現(xiàn)（原創(chuàng)）
上傳時(shí)間： 2013-12-17
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資源簡介：常用1、3、5及任意奇數(shù)分頻器的VHDL代碼實(shí)現(xiàn)（原創(chuàng)）
上傳時(shí)間： 2013-12-26
上傳用戶：rishian
資源簡介：任意整數(shù)分頻器的VHDL源程序,放心使用. 無版權(quán)問題,歡迎copy.
上傳時(shí)間： 2016-01-28
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資源簡介：第7章數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例 7.1 半整數(shù)分頻器的設(shè)計(jì) 7.2 音樂發(fā)生器 7.3 2FSK/2PSK信號(hào)產(chǎn)生器 7.4 實(shí)用多功能電子表 7.5 交通燈控制器 7.6 數(shù)字頻率計(jì)
上傳時(shí)間： 2015-06-23
上傳用戶：tianyi223
資源簡介：數(shù)控分頻器的輸出信號(hào)頻率為輸入數(shù)據(jù)的函數(shù)。用傳統(tǒng)的方法設(shè)計(jì),其設(shè)計(jì)過程和電路都比較復(fù)雜,且設(shè)計(jì)成 果的可修改性和可移植性都較差。基于VHDL 的數(shù)控分頻器設(shè)計(jì),整個(gè)過程簡單、快捷,極易修改,可移植性強(qiáng)。他可利用 并行預(yù)置數(shù)的加法計(jì)數(shù)器和減法計(jì)數(shù)器實(shí)現(xiàn)...
上傳時(shí)間： 2014-11-29
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資源簡介：任意小數(shù)分頻器產(chǎn)生原理，及詳細(xì)說明文檔，任意數(shù)分頻(包括奇偶數(shù)和小數(shù))的設(shè)計(jì)方法(含VHDL例子)
上傳時(shí)間： 2013-12-11
上傳用戶：daoxiang126
資源簡介：全加器的VHDL程序?qū)崿F(xiàn)及仿真
上傳時(shí)間： 2014-01-13
上傳用戶：hoperingcong
資源簡介：數(shù)據(jù)結(jié)構(gòu)》的全部代碼實(shí)現(xiàn)（C語言）,配合《數(shù)據(jù)結(jié)構(gòu)》算法實(shí)現(xiàn)及解析使用。
上傳時(shí)間： 2015-08-05
上傳用戶：Amygdala
資源簡介：任意N進(jìn)制分頻器的標(biāo)準(zhǔn)VHDL代碼（原創(chuàng)）
上傳時(shí)間： 2013-12-25
上傳用戶：洛木卓
資源簡介：2級流水線實(shí)現(xiàn)的8位全加器的VHDL代碼，適用于altera系列的FPGA/CPLD
上傳時(shí)間： 2014-06-15
上傳用戶：zhanditian
資源簡介：用VERILOG HDL實(shí)現(xiàn)的任意 頻率分頻器源代碼，是一個(gè)通用的程序
上傳時(shí)間： 2014-01-07
上傳用戶：alan-ee
資源簡介：一個(gè)任意整數(shù)分頻程序,采用VHDL語言編寫，編譯通過
上傳時(shí)間： 2017-07-04
上傳用戶：xiaoxiang
資源簡介：（1）2-1.asm對應(yīng)第二章主程序代碼； （2）2-2.asm對應(yīng)第二章主程序中斷向量代碼； （3）2-3.cmd對應(yīng)第二章主程序配置文件代碼； （4）2-4.asm對應(yīng)第二章寫Flash程序代碼； （5）2-5.cmd對應(yīng)第二章寫Flash配置文件代碼； （6）2-6.asm對應(yīng)第二...
上傳時(shí)間： 2014-01-24
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資源簡介：DSP嵌入式系統(tǒng)開發(fā)典型案例 （1）3-1.asm對應(yīng)第三章AD測試程序代碼； （2）3-2.asm對應(yīng)第三章AD測試程序中斷向量代碼； （3）3-3.cmd對應(yīng)第三章AD測試程序配置文件代碼； （4）3-4.asm對應(yīng)第三章DA測試程序代碼； （5）3-5.cmd對應(yīng)第三章DA測...
上傳時(shí)間： 2017-02-17
上傳用戶：變形金剛
資源簡介：向數(shù)組中輸入8、7、6、5、4、3、2、1，對其任一元素都進(jìn)行1+2+……+N計(jì)算，并將結(jié)果存入RESULT數(shù)組中，結(jié)果在屏幕上，按十進(jìn)制顯示出來。
上傳時(shí)間： 2016-03-12
上傳用戶：thesk123
資源簡介：數(shù)碼管掃描顯示控制器,同時(shí)顯示0、1、2、3、4、5這6個(gè)不同的數(shù)字圖形到6個(gè)數(shù)碼管上。復(fù)位時(shí)所有數(shù)碼管全滅。
上傳時(shí)間： 2016-05-30
上傳用戶：hgy9473
資源簡介：1、 可顯示當(dāng)前鼠標(biāo)的行列位置 2、 實(shí)現(xiàn)字符串的查找與替換 3、 實(shí)現(xiàn)記事本中的常用菜單項(xiàng) 4、 *實(shí)現(xiàn)文件的打開與保存 5、 *設(shè)置文本的字體
上傳時(shí)間： 2014-01-08
上傳用戶：maizezhen
資源簡介：多用戶多級目錄的文件系統(tǒng),（1）具有l(wèi)ogin (用戶登錄) （2）系統(tǒng)初始化（建文件卷、提供登錄模塊） （3）文件的創(chuàng)建： create （4）文件的打開：open （5）文件的讀：read （6）文件的寫：write （7）文件關(guān)閉：close （8）刪除文件：delete （9）創(chuàng)...
上傳時(shí)間： 2014-01-03
上傳用戶：love_stanford
資源簡介：《Java語言程序設(shè)計(jì)》的源代碼第2、3、4、5章源代碼。
上傳時(shí)間： 2013-12-22
上傳用戶：vodssv
資源簡介：（1）為客戶提供24小時(shí)方便快捷的在線訂購服務(wù)。 （2）商品信息的維護(hù)與管理,包括價(jià)格的調(diào)整、現(xiàn)有商品信息的修改、新商品信息的加入、過時(shí)商品信息的刪除等。 （3）高效的商品數(shù)據(jù)方案,對商品信息進(jìn)行科學(xué)、靈活地分類、存儲(chǔ),方便客戶迅速從少則幾萬,多則...
上傳時(shí)間： 2014-01-23
上傳用戶：it男一枚
資源簡介：系統(tǒng)的功能需求包括以下幾方面。 （1） 客戶可以通過不同的方式（包括電話、前臺(tái)、網(wǎng)上）預(yù)訂書籍。 （2） 能夠保存客戶的預(yù)訂申請單。 （3） 能夠保存客戶的歷史記錄。 （4） 員工可以處理客戶申請。 （5） 技術(shù)人員可以保存對書籍檢修的結(jié)果。
上傳時(shí)間： 2013-12-24
上傳用戶：362279997
資源簡介：利用計(jì)數(shù)器和分頻器設(shè)計(jì)一個(gè)實(shí)時(shí)的時(shí)鐘。一共需要1個(gè)模24計(jì)數(shù)器、2個(gè)模6計(jì)數(shù)器、2個(gè)模10計(jì)數(shù)器、一個(gè)生成1Hz的分頻器和6個(gè)數(shù)碼管解碼器。最終用HEX5~HEX4顯示小時(shí)（0~23），用HEX3~HEX2顯示分鐘（0~59），用HEX1~HEX0顯示秒鐘（0~59）。
上傳時(shí)間： 2014-12-20
上傳用戶：dbs012280
資源簡介：（1）、深度優(yōu)先搜索。 （2）、可以點(diǎn)擊面板上的按鈕設(shè)置七種默認(rèn)的初始狀態(tài)。 （3）、點(diǎn)擊“自定義”按鈕可以自行設(shè)定初始狀態(tài)。 （4）、設(shè)定初始狀態(tài)后點(diǎn)擊“搜索”按鈕，啟動(dòng)搜索算法，若找到走法，則彈出對話框提示“已找到解”，接著點(diǎn)擊“下一步”按...
上傳時(shí)間： 2017-09-04
上傳用戶：lhc9102
資源簡介：/************************** 0 1 2 3 4 5 6 7 8 9 . CLR + - = CLR ***************************/ 用鍵盤掃描,數(shù)碼管顯示實(shí)現(xiàn)計(jì)算功能,能實(shí)現(xiàn)xxx.x任意正數(shù)的加減 運(yùn)算,超過范圍顯0000,功能鍵如上
上傳時(shí)間： 2013-12-20
上傳用戶：dongqiangqiang
資源簡介：三篇關(guān)于Viterbi FPGA編譯碼器的優(yōu)化設(shè)計(jì)文檔： 1、Viterbi譯碼器的FPGA設(shè)計(jì)實(shí)現(xiàn)與優(yōu)化.pdf 2、Viterbi譯碼器的低功耗設(shè)計(jì).pdf 3、基于FPGA的高速并行Viterbi譯碼器的設(shè)計(jì)與實(shí)現(xiàn).pdf
上傳時(shí)間： 2013-11-27
上傳用戶：邶刖
資源簡介：采用FCFS、SJF、響應(yīng)比高者優(yōu)先算法模擬設(shè)計(jì)作業(yè)調(diào)度程序。 [提示]： （1）每個(gè)作業(yè)的JCB中包括作業(yè)名、提交時(shí)刻、要求運(yùn)行時(shí)間； （2）假設(shè)第一個(gè)作業(yè)提交時(shí)，系統(tǒng)中無正在執(zhí)行的作業(yè)，即第一個(gè)作業(yè)一提交系統(tǒng)便調(diào)度該作業(yè)。 要求： 輸入：一批作業(yè)中各...
上傳時(shí)間： 2014-01-03
上傳用戶：佳期如夢
資源簡介：這些是我們在學(xué)校里做匯編實(shí)驗(yàn)時(shí)做的。實(shí)驗(yàn)列表如下。里面有源代碼。 1. 實(shí)驗(yàn)一 匯編編譯器的使用及程序調(diào)試（必做） 4 2. 實(shí)驗(yàn)二 非壓縮/壓縮十進(jìn)制碼轉(zhuǎn)換程序的設(shè)計(jì)與實(shí)現(xiàn)（必做） 11 3. 實(shí)驗(yàn)三 順序程序設(shè)計(jì)（選做） 13 4. 實(shí)驗(yàn)四 分支程序設(shè)計(jì)（選...
上傳時(shí)間： 2014-01-02
上傳用戶：siguazgb
資源簡介：偽隨機(jī)序列碼發(fā)生器及基帶傳輸CMI碼編、譯碼的VHDL語言實(shí)現(xiàn)
上傳時(shí)間： 2014-01-18
上傳用戶：maizezhen
資源簡介：該論文闡述了用于硬件信號(hào)處理的基于4基數(shù)12點(diǎn)快速傅立葉變換的VHDL核的設(shè)計(jì)過程。作者：Vite-Frias Jose Alberto、Romero-Troncoso Rene de Jesus、Ordaz-Moreno
上傳時(shí)間： 2014-01-23
上傳用戶：xmsmh
資源簡介：用匯編語言來使鍵盤成為一個(gè)演奏音樂的電子琴。高音依次1,2,3,4,5,6,7 。中音依次為q,w,e,r,t,y,u 。低音依次為a,s,d,f,g,h,j
上傳時(shí)間： 2013-12-17
上傳用戶：wangdean1101
