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  資源簡介：verilog 實(shí)現(xiàn)的 jtag TAP ， 轉(zhuǎn)自 opencore.com， 已通過驗(yàn)證

  標(biāo)簽： verilog jtag TAP

  上傳時間： 2016-04-03

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• verilog 實(shí)現(xiàn)的 jtag TAP免費(fèi)下載

  資源簡介：verilog 實(shí)現(xiàn)的 jtag TAP ， 轉(zhuǎn)自 opencore.com， 已通過驗(yàn)證

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  上傳時間： 2016-04-03

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• verilog 實(shí)現(xiàn)的 jtag TAP免費(fèi)下載

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• verilog 實(shí)現(xiàn)的 jtag TAP免費(fèi)下載

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  上傳時間： 2014-12-08

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• 用verilog實(shí)現(xiàn)的以太網(wǎng)接口免費(fèi)下載

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  上傳時間： 2013-07-13

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  標(biāo)簽： verilog 串口 收發(fā) 數(shù)據(jù)

  上傳時間： 2013-08-21

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• verilog實(shí)現(xiàn)的DDS正弦信號發(fā)生器和測頻測相模塊免費(fèi)下載

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  標(biāo)簽： verilog DDS 正弦信號發(fā)生器 模塊

  上傳時間： 2013-08-28

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  標(biāo)簽： verilog Quartus 鍵盤程序 編譯

  上傳時間： 2015-05-13

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• 此代碼是用verilog實(shí)現(xiàn)的以太網(wǎng)接口,在此基礎(chǔ)上做修改,可以作為一般的以太網(wǎng)接口程序開發(fā).免費(fèi)下載

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  上傳時間： 2014-01-20

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  上傳時間： 2015-10-01

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  標(biāo)簽： verilog FPGA 2048 FFT

  上傳時間： 2014-12-02

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  上傳時間： 2013-12-28

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  上傳時間： 2015-11-15

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  標(biāo)簽： verilog DDS 正弦信號發(fā)生器 模塊

  上傳時間： 2013-12-09

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• 本文件中包含了多個verilog實(shí)現(xiàn)的實(shí)用小程序免費(fèi)下載

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  上傳時間： 2016-01-07

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  上傳時間： 2016-01-21

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  資源簡介：verilog 實(shí)現(xiàn)的hamming碼生成，用于fpga

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  上傳時間： 2016-01-21

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  上傳時間： 2014-12-04

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  標(biāo)簽： verilog Quartus 電子日歷 程序

  上傳時間： 2014-01-08

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• 用verilog實(shí)現(xiàn)的搶答器程序,在Quartus II上編譯通過并成功運(yùn)行免費(fèi)下載

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  標(biāo)簽： verilog Quartus 搶答器 程序

  上傳時間： 2014-01-14

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  標(biāo)簽： verilog CPU 程序

  上傳時間： 2013-12-18

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  上傳時間： 2013-12-20

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• 利用verilog實(shí)現(xiàn)的一個（2,1,2）卷積碼的編碼器,很有用的喲!免費(fèi)下載

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  標(biāo)簽： verilog 卷積碼 編碼器

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