3D光立方
資源簡(jiǎn)介：3D光立方
上傳時(shí)間： 2013-11-20
上傳用戶：zhulei420
資源簡(jiǎn)介：3D光立方
上傳時(shí)間： 2013-11-15
上傳用戶：feifei0302
資源簡(jiǎn)介：基于單片機(jī)的夢(mèng)幻光立方3D顯示器設(shè)計(jì)與制作
上傳時(shí)間： 2021-11-04
上傳用戶：默默
資源簡(jiǎn)介：基于FPGA的3D圖像處理器IP核的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間： 2013-05-18
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資源簡(jiǎn)介：基于FPGA的LCD&VGA控制器設(shè)計(jì) 字?jǐn)?shù)不夠
上傳時(shí)間： 2013-08-05
上傳用戶：ginani
資源簡(jiǎn)介：基于FPGA的樂(lè)曲發(fā)生器電路設(shè)計(jì) 附含源代碼（quartersii環(huán)境下運(yùn)行）
上傳時(shí)間： 2013-08-07
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資源簡(jiǎn)介：優(yōu)秀碩士論文，基于FPGA的雷達(dá)信號(hào)模擬器設(shè)計(jì)，對(duì)學(xué)FPGA的，特別是學(xué)雷達(dá)的同學(xué)有很好的參考價(jià)值
上傳時(shí)間： 2013-08-10
上傳用戶：dianxin61
資源簡(jiǎn)介：為了滿足對(duì)隨機(jī)數(shù)性能有一定要求的系統(tǒng)能夠?qū)崟r(shí)檢測(cè)隨機(jī)數(shù)性能的需求，提出了一種基于FPGA的隨機(jī)數(shù)性能檢測(cè)設(shè)計(jì)方案。根據(jù)NIST的測(cè)試標(biāo)準(zhǔn)，采用基于統(tǒng)計(jì)的方法，在FPGA內(nèi)部實(shí)現(xiàn)了對(duì)隨機(jī)序列的頻率測(cè)試、游程測(cè)試、最大游程測(cè)試、離散傅里葉變換測(cè)試和二元矩陣...
上傳時(shí)間： 2013-11-13
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資源簡(jiǎn)介：基于FPGA的數(shù)字濾波系統(tǒng)設(shè)計(jì)
上傳時(shí)間： 2013-11-07
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資源簡(jiǎn)介：以Altera公司的Quartus Ⅱ 7.2作為開(kāi)發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核Nios II，構(gòu)成可編程片上系統(tǒng)（SOPC），利用...
上傳時(shí)間： 2013-11-06
上傳用戶：songkun
資源簡(jiǎn)介：一般由信源發(fā)出的數(shù)字基帶信號(hào)含有豐富的低頻分量，甚至直流分量，這些信號(hào)往往不宜直接用于傳輸，易產(chǎn)生碼間干擾進(jìn)而直接影響傳輸?shù)目煽啃裕蚨獙?duì)其進(jìn)行編碼以便傳輸。傳統(tǒng)的井下信號(hào)在傳輸過(guò)程中普遍采用曼徹斯特碼的編解碼方式，而該方式的地面解碼電路...
上傳時(shí)間： 2013-05-26
上傳用戶：teddysha
資源簡(jiǎn)介：一般由信源發(fā)出的數(shù)字基帶信號(hào)含有豐富的低頻分量，甚至直流分量，這些信號(hào)往往不宜直接用于傳輸，易產(chǎn)生碼間干擾進(jìn)而直接影響傳輸?shù)目煽啃裕蚨獙?duì)其進(jìn)行編碼以便傳輸。傳統(tǒng)的井下信號(hào)在傳輸過(guò)程中普遍采用曼徹斯特碼的編解碼方式，而該方式的地面解碼電路...
上傳時(shí)間： 2013-04-24
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資源簡(jiǎn)介：基于FPGA的誤碼率測(cè)試儀設(shè)計(jì)基于FPGA的誤碼率測(cè)試儀設(shè)計(jì)
上傳時(shí)間： 2013-08-02
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資源簡(jiǎn)介：基于單片機(jī)的紅外遙控系統(tǒng)設(shè)計(jì)_李寶營(yíng)
上傳時(shí)間： 2013-11-17
上傳用戶：ligi201200
資源簡(jiǎn)介：為了滿足對(duì)隨機(jī)數(shù)性能有一定要求的系統(tǒng)能夠?qū)崟r(shí)檢測(cè)隨機(jī)數(shù)性能的需求，提出了一種基于FPGA的隨機(jī)數(shù)性能檢測(cè)設(shè)計(jì)方案。根據(jù)NIST的測(cè)試標(biāo)準(zhǔn)，采用基于統(tǒng)計(jì)的方法，在FPGA內(nèi)部實(shí)現(xiàn)了對(duì)隨機(jī)序列的頻率測(cè)試、游程測(cè)試、最大游程測(cè)試、離散傅里葉變換測(cè)試和二元矩陣...
上傳時(shí)間： 2015-01-01
上傳用戶：瓦力瓦力hong
資源簡(jiǎn)介：基于FPGA的數(shù)字濾波系統(tǒng)設(shè)計(jì)
上傳時(shí)間： 2015-01-01
上傳用戶：fudong911
資源簡(jiǎn)介：以Altera公司的Quartus Ⅱ 7.2作為開(kāi)發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核Nios II，構(gòu)成可編程片上系統(tǒng)（SOPC），利用...
上傳時(shí)間： 2013-12-22
上傳用戶：forzalife
資源簡(jiǎn)介：_基于MATLAB的系統(tǒng)分析與設(shè)計(jì)_小波分析,一本好書(shū)的全源碼
上傳時(shí)間： 2015-05-18
上傳用戶：釣鰲牧馬
資源簡(jiǎn)介：UCLINUX2.6核下的vga驅(qū)動(dòng)。基于framebuffer機(jī)理。硬件設(shè)計(jì)采用基于FPGA的軟核NIOSII設(shè)計(jì)。
上傳時(shí)間： 2015-10-03
上傳用戶：拔絲土豆
資源簡(jiǎn)介：基于FPGA的分頻器設(shè)計(jì),已經(jīng)通過(guò)了仿真(VHDL語(yǔ)言編寫(xiě))
上傳時(shí)間： 2013-12-14
上傳用戶：haoxiyizhong
資源簡(jiǎn)介：今今日電子--基于FPGA的PCI總線接口設(shè)計(jì) (圖)日電子--基于FPGA的PCI總線接口設(shè)計(jì) (圖)今日電子--基于FPGA的PCI總線接口設(shè)計(jì) (圖)
上傳時(shí)間： 2016-02-19
上傳用戶：sevenbestfei
資源簡(jiǎn)介：基于PC104_VxWorks的無(wú)人機(jī)仿真系統(tǒng)設(shè)計(jì)_實(shí)現(xiàn)
上傳時(shí)間： 2013-12-10
上傳用戶：Zxcvbnm
資源簡(jiǎn)介：基于FPGA的正弦波發(fā)生器設(shè)計(jì)，有一定的參考價(jià)值，寫(xiě)的比較詳細(xì)
上傳時(shí)間： 2016-09-19
上傳用戶：lunshaomo
資源簡(jiǎn)介：基于FPGA的頻率計(jì)模塊設(shè)計(jì)，帶quartus下的圖形文件
上傳時(shí)間： 2017-04-22
上傳用戶：xcy122677
資源簡(jiǎn)介：基于FPGA的交織編碼器設(shè)計(jì)，主要講敘如何在FPGA上實(shí)現(xiàn)交織編碼器。
上傳時(shí)間： 2017-05-28
上傳用戶：xjz632
資源簡(jiǎn)介：基于FPGA的樂(lè)曲發(fā)生器電路設(shè)計(jì) 附含源代碼（quartersii環(huán)境下運(yùn)行）
上傳時(shí)間： 2014-01-07
上傳用戶：sammi
資源簡(jiǎn)介：基于FPGA的LCD&VGA控制器設(shè)計(jì) 字?jǐn)?shù)不夠
上傳時(shí)間： 2017-09-14
上傳用戶：moshushi0009
資源簡(jiǎn)介：基于FPGA的函數(shù)信號(hào)發(fā)生器設(shè)計(jì)，詳細(xì)系統(tǒng)流程
上傳時(shí)間： 2017-08-10
上傳用戶：sauno
資源簡(jiǎn)介：該文檔為基于FPGA的串口通信設(shè)計(jì)與實(shí)現(xiàn)講解資料，講解的還不錯(cuò)，感興趣的可以下載看看…………………………
上傳時(shí)間： 2021-10-31
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資源簡(jiǎn)介：該文檔為基于FPGA的軟件無(wú)線電平臺(tái)設(shè)計(jì)簡(jiǎn)介文檔，是一份很不錯(cuò)的參考資料，具有較高參考價(jià)值，感興趣的可以下載看看………………
上傳時(shí)間： 2021-11-18
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