verilog編寫的watchdog代碼!請參考!
資源簡介:verilog編寫的watchdog代碼!請參考!
上傳時間: 2014-01-06
上傳用戶:xuan‘nian
資源簡介:一個用數據庫編寫的學生信息管理系統!做課程設計的同學可以做為參考!
上傳時間: 2015-03-31
上傳用戶:songnanhua
資源簡介:一個非常簡單的cpu設計的原代碼,是用verilog編寫的
上傳時間: 2014-12-08
上傳用戶:siguazgb
資源簡介:一個關于MEMORY設計的原代碼,使用verilog編寫的 希望對大家有些幫助
上傳時間: 2013-12-24
上傳用戶:change0329
資源簡介:uart串行口,用verilog編寫的.供大家參考
上傳時間: 2013-12-15
上傳用戶:417313137
資源簡介:verilog語言編寫的FPGA代碼。功能為pc機通過epp不斷寫數到sram中,然后pc發送中斷信號打斷寫過程讀取sram中的數據。rar包中包含epp協議,模塊文件和測試文件(test)。
上傳時間: 2013-12-17
上傳用戶:1966640071
資源簡介:Convert File 基本的 對文件的IO 操作 使用scanner 比較基礎 具體的輸出格式請參考代碼
上傳時間: 2013-12-20
上傳用戶:hxy200501
資源簡介:聊天JSP!運用JSp編寫的聊天代碼·! TOMCAT中可以是想其功能 ·
上傳時間: 2016-06-30
上傳用戶:qiaoyue
資源簡介:代碼為verilog編寫的流水等程序,已在quartuous6.0上編譯仿真通過,下載入電路板已實現
上傳時間: 2016-07-11
上傳用戶:wfeel
資源簡介:用verilog編寫的fir濾波器程序!
上傳時間: 2016-11-26
上傳用戶:D&L37
資源簡介:verilog 編寫的tiny cpu 代碼,可實現簡單的指令和計算
上傳時間: 2017-02-03
上傳用戶:lijianyu172
資源簡介:用verilog編寫的標準異步串行通行程序,供大家參考!
上傳時間: 2013-12-09
上傳用戶:498732662
資源簡介:linux s3c2440 下USB gadget 驅動的源代碼,具體請參考代碼詳細內容
上傳時間: 2013-11-30
上傳用戶:Thuan
資源簡介:基于verilog HDL的SPI代碼,可在FPGA上實現SPI接口,請大家參考
上傳時間: 2017-05-24
上傳用戶:www240697738
資源簡介:用verilog編寫的一個簡單的產生偽隨機序列的代碼(m序列),比較實用。
上傳時間: 2017-06-27
上傳用戶:dave520l
資源簡介:QT4 下的文件copy 代碼,請參考.
上傳時間: 2014-02-07
上傳用戶:watch100
資源簡介:VHDL語言編寫的DAC0832代碼,簡短而又易懂,可供參考
上傳時間: 2013-08-21
上傳用戶:hullow
資源簡介:這是一個很好的verilog 編寫的8位RISC CPU源碼(可做為MCU),并且包括完整的C 語言的測試代碼。
上傳時間: 2014-01-05
上傳用戶:李夢晗
資源簡介:加法器(使用verilog編寫的),雖然簡單,但是這也是學習verilog最基礎的東西!希望大家一起學習!
上傳時間: 2013-12-10
上傳用戶:410805624
資源簡介:利用delphi編寫的原代碼,用做參考和學習。
上傳時間: 2013-12-19
上傳用戶:zxc23456789
資源簡介:采用verilog編寫的串口通信程序,采用了狀態機設計!程序簡單,消耗資源少
上傳時間: 2014-12-08
上傳用戶:yd19890720
資源簡介:verilog編寫的簡單異步串口 完全原創,站長請查看內容
上傳時間: 2014-01-13
上傳用戶:LouieWu
資源簡介:這是我學習過程中編寫的測試代碼,用STD2.51開發環境,C語言編寫,以MICETEK EV44B0-II開發板為硬件測試平臺,用到串口,液晶,鍵盤,LED。 液晶包括圖片顯示、劃線、ASCII碼顯示、4000多常用的漢字庫,可以顯示任意常用的漢字。 鍵盤采用中斷觸發!
上傳時間: 2015-08-04
上傳用戶:561596
資源簡介:VHDL語言編寫的DAC0832代碼,簡短而又易懂,可供參考
上傳時間: 2014-01-18
上傳用戶:aix008
資源簡介:在Xilinx7.1平臺下編寫的ALU代碼,可以實現五位加法、減法、與、異或四種運算!
上傳時間: 2013-12-27
上傳用戶:rishian
資源簡介:用java編寫的QQ代碼,請有興趣的朋友看看,有不足的地方指出來
上傳時間: 2013-12-10
上傳用戶:BIBI
資源簡介:用qt編寫的時鐘代碼。包括一個數字時鐘,一個模擬時鐘!
上傳時間: 2017-04-24
上傳用戶:libenshu01
資源簡介:用verilog編寫的搶答器實驗設計,適合新手學習參考
上傳時間: 2022-04-26
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資源簡介:使用verilog編寫的同步FIFO,可通過設置程序中的DEPTH設置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中寫入數據,\r\nFIFO_READ_CLOCK上升沿讀取數據。本程序對FIFO上層操作簡單實用。
上傳時間: 2013-08-12
上傳用戶:ljt101007
資源簡介:verilog 編寫的I2c協議程序,用于cpld讀寫EEPROM
上傳時間: 2013-08-31
上傳用戶:csgcd001