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FPGA實現全數字鎖相環

  • 資源大小:5 K
  • 上傳時間: 2014-01-09
  • 上傳用戶:zxixi2007
  • 資源積分:2 下載積分
  • 標      簽: 全數字 鎖相環

資 源 簡 介

FPGA實現全數字鎖相環,利用硬件描述評議verilog HDL,頂層文件DPLL.V

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